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电巢直播8月计划
楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2008-10-27 20:33 | 只看该作者

封装转换问题

本帖最后由 jimmy 于 2009-1-22 18:25 编辑 + H  Z: _# F! J8 L$ j0 S
- e$ l2 N- \- p: [7 Q. z6 v9 _
用的是4.0版本,转过来的pcb能够打开,不过把其中封装保存到库里,再编辑的时候没有外轮廓,不知怎吗回事,大家试试看,有没有这个问题。
) c; f9 O# u5 v0 p0 t. F" S8 t/ c3 c; q* z% E) S: P6 @
jimmy:
5 y; i1 T' \. ], D3 i1 ?, y ! L3 h) Z* W$ _; q2 C) S. @
元件库的外框设置在丝印层,你没有打开丝印层的color ,所以不可见。4 {# k' s+ }5 A3 J
* @) d% s/ u$ U( q
把相关层的color打开就OK了

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发表于 2008-10-27 21:05 | 只看该作者
本帖最后由 jimmy 于 2009-2-4 09:08 编辑 / Z+ M. C) H4 Z5 s& E6 _8 D  U5 c

! ?  l/ u7 H. x0 p问过简单的问题。。Layout中不是有自动布局和自动不线吗? 2 E% @5 ^7 |& l& B& t5 _
但我没找到自动布线在啦。。麻烦版主指点12.。。
/ k' \: k# q. p+ B: w& t) W' E* U8 |
5 Z9 ~; c/ |/ h  |
jimmy:
( n( i9 Y. V; n) |
6 b$ |; z) o+ E' E, G, J! [8 _在router软件里面进行。

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发表于 2008-10-28 08:53 | 只看该作者

回复 16#

封装转换问题% s( i1 s6 {- b% @) i; i
用的是4.0版本,转过来的pcb能够打开,不过把其中封装保存到库里,再编辑的时候没有外轮廓,不知怎吗回事,大家试试看,有没有这个问题。 2 R+ k9 b+ ^3 y4 W8 X: f' R7 y
- {- W% g% E, j4 n
你封装外框所在层的颜色可能设置的是黑色,和底色一样,随意看不到~
/ a& p7 g' C+ B0 r! ]7 m改一下丝印层的颜色就可以看的到了吧~

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对的  发表于 2011-10-31 13:54

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发表于 2008-10-28 12:19 | 只看该作者

回复 18# 的帖子

谢谢 我试试

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 楼主| 发表于 2008-10-28 20:58 | 只看该作者
原帖由 hanicesnow 于 2008-9-24 14:53 发表 # O3 e9 ^9 |4 U" m. d  o$ m; R
我用的是2007,别人用2005设计的板子,我用2007打开这个板子,用ORCAD10.5输出网表,再导入到这个板子中,
& T! C5 U* q2 i) A% g原理图中更改的地方在PCB中没有显示.为什么啊.请楼主帮忙.为什么还将EGND网络自己删除了.这不是白改原理图了吗, ...

, E5 n2 a! I' X8 W% C
. T' g9 l' v8 ]对ECO对比时还要选上UPDATE,这样就可以将PCB与原理图一一对应。6 c0 S* j% N4 T( N4 `/ f
) h; l" R$ w; I! I1 s* o, c1 D
EGND网络自己删除了是你在原理图上面没有进行连接。

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 楼主| 发表于 2008-10-28 20:59 | 只看该作者
本帖最后由 jimmy 于 2009-2-8 12:09 编辑 ) E* w+ p4 O& M- G; a
原帖由 hanicesnow 于 2008-9-24 14:53 发表
1 w5 C9 a7 q6 p) G我用的是2007,别人用2005设计的板子,我用2007打开这个板子,用ORCAD10.5输出网表,再导入到这个板子中,
! x* o+ W+ S# P2 L7 O原理图中更改的地方在PCB中没有显示.为什么啊.请楼主帮忙.为什么还将EGND网络自己删除了.这不是白改原理图了吗, ...

3 a2 i! D* s! G/ p& _0 m, x1 d
1 ~* R# ?7 p4 C+ X. N在ECO对比的时候,要选上UPDATE。& [/ _/ G3 R. H" `
/ p, v8 `3 a# `5 l7 c* n

9 h$ T4 [3 q2 t1 d- PEGND网络被删除是因为你在原理图没有连接此网络。

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 楼主| 发表于 2008-10-28 21:01 | 只看该作者

回复 7# 的帖子

已有QQ群:28326856

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版主的群貌似未开放哦!什么时候开放?向大家学习讨论!  发表于 2011-11-19 16:06

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 楼主| 发表于 2008-10-28 21:03 | 只看该作者

回复 8# 的帖子

自建封装方便管理,标准化。

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 楼主| 发表于 2008-10-28 21:03 | 只看该作者

回复 4# 的帖子

多请教高手吧2 e9 m4 L/ I! Q: ~& t1 ~9 r% B

9 O/ k5 G+ x* S好的设计习惯不是能用文字表达得清楚的。
8 g9 b! L- O0 d  D
+ W: o! O% J% o7 A就像好的生活习惯一样

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 楼主| 发表于 2008-10-28 21:05 | 只看该作者
原帖由 思齐 于 2008-9-26 10:59 发表 ! r: E# v0 r/ Q4 f+ F1 I* B
钻孔对问题# P* i( r" u: T$ g5 ~" ~3 ^
看到一般的PCB,都设有有限的几个钻孔对,如8层板,设1-2、2-7、7-8、1-8,可有些信号只到3层,或4、5层的,什么也要用2-7的钻孔呢?/ Q0 {4 w; @9 [6 F% V
还有个“地”的问题8 s3 p& @& @' ?' v9 O  V/ \( g5 `
手机中有模拟地和数字地,它们是布在同一层还有不 ...

3 u" b" q) i( @, j( j3 j. l2 V& |0 ~/ }# o$ p' w) H
这是盲埋孔常识。相关的资料可到群共享下载(PADS手机盲埋孔设计资料)' h4 S, C! f5 s  u9 y) L( W
3 D& e$ ^9 c1 M
模拟地与数字地分开,最后在单点接地这是老生常谈的经验,相关资料可在论坛上面找到。

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 楼主| 发表于 2008-10-28 21:09 | 只看该作者
原帖由 loveineda 于 2008-10-10 13:18 发表 " {1 M) ?# ?" P" a
初次使用PADS,出现如图中央的问题,左边的电容和右边FPGA不能正常连接!
9 v- B9 `% c  b; c可能是我的走线比FPGA的管脚要粗吧,导致在DRP模式下,出现FPGA这边用非常细的线来连接$ L* J. B) O% Y7 S
这个问题能在开DRC模式下解决吗,有的话,告诉我方 ...
) s& @3 o8 C6 R+ j5 x

8 A- q! _1 o! i" b那是因为你设置了安全间距不当的原因。比如你的FPGA的元件脚间距才6mil,而你的安全间距值设了10mil 或6mil以上,而又开启了DRP走线的话,当然无法连接。
0 k2 z5 S" s# x# I. i
3 f  R4 y: N# v4 B3 O, E我很少开着DRP走线。都是设置好显示栅格和设计栅格好,利用栅格的功能来进行走线。很少修线。

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 楼主| 发表于 2008-10-28 21:11 | 只看该作者
原帖由 maozhiqiang 于 2008-10-22 15:02 发表
5 b" p: X% b1 r4 {: `Value值显示问题7 ~8 D' l& `; ?. k5 Q4 i( Q
最近画了一块板,线也弄完了,最后时,老板要求出图制版是显示出VALUE值来,
' F9 K0 w  z6 _+ [9 ~  F我用allegro画的原理图,PADS布的线,现在板子布好了,想加进去VALUE值,却不可以;; Y2 [" v& L) a
关键是我最开始导网表是没在后面 ...
/ X/ G" a2 Q. Z8 |. R6 K

/ @3 h9 ?3 e6 U) _+ z4 E2 h$ Z用ORCAD重新生成NET,再导入进行对比,更新是可以做到的。

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 楼主| 发表于 2008-10-28 21:15 | 只看该作者
原帖由 古域清流 于 2008-10-22 20:07 发表 / d0 j4 L7 J8 Y- b2 V# n/ |  D9 o
请问有尊敬的版主,我在使用LOGIC的时候,为什么不能接地??按右键选地的时候弹出一个窗口,提示:
" u0 Y0 O; @  q) P" p+ ypin discrepency    decal gatefor gate number#   
; y0 \. }$ M" a0 p还有就是我画线的时候可以在线走到一半的时候双击左键悬空,而 ...
& o) |2 J1 n) `: C$ T/ V6 x
! _8 p- F( Q# Z# g6 P

, t8 `' V$ }/ W" m可以接地。画走线的时候按SHIRT+空格就可以了,TAB可以进行却换.
( N7 H8 A9 ]# R4 \" W$ M$ L8 |5 g9 i# K* d: O3 v$ o+ h( I
请用默认设置。

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 楼主| 发表于 2008-10-28 21:17 | 只看该作者
原帖由 maozhiqiang 于 2008-10-27 15:58 发表   P$ v. V; T9 F' X1 e. M
求助:网表问题
7 H4 h! E) a. l1 d0 P9 z重新装了下电脑结果,输出网表时提示      : ) d, r/ Z: M; g# N  w+ f
Design Name: D:\资料\复件 FINAL.DSN/ Z) Z5 _' ^$ D! P' ?" Z- J; e
[FMT0012] Can't open first output file( [/ s& `9 b$ A' M
#各位碰到过没有,帮忙啊,先谢谢拉!
$ m( P0 @- D/ N7 a) {5 `: e. z+ [0 Q8 H- N4 I2 Z
斑竹救命

5 N6 Q, Q$ m" ]6 y7 N0 V
5 b' W) h' q! Z1 G+ I- T& D) b. ~请将FINAL.DSN改为FINAL.ASC

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 楼主| 发表于 2008-10-28 21:18 | 只看该作者
原帖由 qisaiman 于 2008-10-27 20:33 发表
! T) V" M8 U7 F+ ^5 j7 f用的是4.0版本,转过来的pcb能够打开,不过把其中封装保存到库里,再编辑的时候没有外轮廓,不知怎吗回事,大家试试看,有没有这个问题。13260
: B% [% j. B1 M5 s
5 R9 U+ T, d/ x; o3 l/ H% n
因为转过来的封装的2D线是放在顶层丝印层,而默认的显示顶层丝印层是没有设置COLORS的,你把顶层丝印层的COLORS打开就可以看到了。
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