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楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2008-10-27 20:33 | 只看该作者

封装转换问题

本帖最后由 jimmy 于 2009-1-22 18:25 编辑 + {2 C6 Y, o; ^: e

# Z0 v; E3 z6 _; E用的是4.0版本,转过来的pcb能够打开,不过把其中封装保存到库里,再编辑的时候没有外轮廓,不知怎吗回事,大家试试看,有没有这个问题。 1 P# D! [* s3 L
$ H7 t. V' a. R" Y3 c7 d
jimmy:
( m: P. G/ Y0 k, \   {5 Z  c6 j- h+ c# h; g
元件库的外框设置在丝印层,你没有打开丝印层的color ,所以不可见。/ J3 v) g2 P6 E, _! u
- Y5 L( O5 J! T
把相关层的color打开就OK了

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发表于 2008-10-27 21:05 | 只看该作者
本帖最后由 jimmy 于 2009-2-4 09:08 编辑 $ y( {  Z8 N% D# o! [
' ]2 D2 ]: r4 w$ a- |  I
问过简单的问题。。Layout中不是有自动布局和自动不线吗? & l! r# N' \& G, G
但我没找到自动布线在啦。。麻烦版主指点12.。。
4 {7 S4 f" A- s" o; {# Y3 H' R, M9 f' B7 K) q' ~
3 T6 f- W) f, I. o# ^1 h
jimmy:
: ~7 ^( `4 n1 ?/ F1 X ' |& J: c2 O4 b' [! X
在router软件里面进行。

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发表于 2008-10-28 08:53 | 只看该作者

回复 16#

封装转换问题" j8 x1 k, q, \0 S( X
用的是4.0版本,转过来的pcb能够打开,不过把其中封装保存到库里,再编辑的时候没有外轮廓,不知怎吗回事,大家试试看,有没有这个问题。
5 S5 _# H  B+ u3 h1 F5 d% [( Q" F9 d. r7 W
你封装外框所在层的颜色可能设置的是黑色,和底色一样,随意看不到~# G* X" {& c3 E  P* g  A
改一下丝印层的颜色就可以看的到了吧~

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对的  发表于 2011-10-31 13:54

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发表于 2008-10-28 12:19 | 只看该作者

回复 18# 的帖子

谢谢 我试试

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 楼主| 发表于 2008-10-28 20:58 | 只看该作者
原帖由 hanicesnow 于 2008-9-24 14:53 发表
; a) X) ^6 U, p* i1 Z. Z) t1 j9 s我用的是2007,别人用2005设计的板子,我用2007打开这个板子,用ORCAD10.5输出网表,再导入到这个板子中,
- Z) B7 r6 a& ?& j% ?* t5 B1 ]原理图中更改的地方在PCB中没有显示.为什么啊.请楼主帮忙.为什么还将EGND网络自己删除了.这不是白改原理图了吗, ...
5 {# X, }/ M8 L

" E  X1 N) h6 ^6 u- |对ECO对比时还要选上UPDATE,这样就可以将PCB与原理图一一对应。% E  i8 T" V$ Y+ Q5 C" J

  S! m) s, l% u/ k0 Y) q: GEGND网络自己删除了是你在原理图上面没有进行连接。

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 楼主| 发表于 2008-10-28 20:59 | 只看该作者
本帖最后由 jimmy 于 2009-2-8 12:09 编辑
3 x( d2 Q) F( m' }
原帖由 hanicesnow 于 2008-9-24 14:53 发表
3 S- G1 a* k! T3 i, R' s我用的是2007,别人用2005设计的板子,我用2007打开这个板子,用ORCAD10.5输出网表,再导入到这个板子中,
" S" b; Q! Y1 _原理图中更改的地方在PCB中没有显示.为什么啊.请楼主帮忙.为什么还将EGND网络自己删除了.这不是白改原理图了吗, ...

5 ]9 ~2 r5 I# K/ @: q1 o; M
" H' V2 r2 q+ o1 ~+ X, S3 d0 o在ECO对比的时候,要选上UPDATE。
+ R  s" B$ l3 Y* x* t" g" e / {5 S% q- j& g  c3 P2 j2 b" Y

: K" e$ E4 k8 x2 ?: Q; iEGND网络被删除是因为你在原理图没有连接此网络。

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 楼主| 发表于 2008-10-28 21:01 | 只看该作者

回复 7# 的帖子

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版主的群貌似未开放哦!什么时候开放?向大家学习讨论!  发表于 2011-11-19 16:06

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 楼主| 发表于 2008-10-28 21:03 | 只看该作者

回复 8# 的帖子

自建封装方便管理,标准化。

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 楼主| 发表于 2008-10-28 21:03 | 只看该作者

回复 4# 的帖子

多请教高手吧
( Y' s& L6 V: r( G7 X, I% m- l% j& ?& ?" t& o
好的设计习惯不是能用文字表达得清楚的。* P, q& l5 a, D5 R6 `

! W9 o! Y9 i- k, M/ b就像好的生活习惯一样

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 楼主| 发表于 2008-10-28 21:05 | 只看该作者
原帖由 思齐 于 2008-9-26 10:59 发表
6 q) K/ I8 P2 P' c9 z- P: w钻孔对问题
# F6 t. P5 Y) U: P  Z1 \' G看到一般的PCB,都设有有限的几个钻孔对,如8层板,设1-2、2-7、7-8、1-8,可有些信号只到3层,或4、5层的,什么也要用2-7的钻孔呢?* J! ?: N- P& M
还有个“地”的问题  d& S  P, H( W
手机中有模拟地和数字地,它们是布在同一层还有不 ...
$ I, s9 h$ U- ^! c+ y6 H

* B8 o; L" Q: i: E4 K+ x* z" j3 z这是盲埋孔常识。相关的资料可到群共享下载(PADS手机盲埋孔设计资料)6 m4 c6 w2 d& L0 \% Y4 G

( s+ {* r; @4 m3 ]% T4 i3 y模拟地与数字地分开,最后在单点接地这是老生常谈的经验,相关资料可在论坛上面找到。

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 楼主| 发表于 2008-10-28 21:09 | 只看该作者
原帖由 loveineda 于 2008-10-10 13:18 发表
' ~$ w9 y1 N9 b6 \0 h初次使用PADS,出现如图中央的问题,左边的电容和右边FPGA不能正常连接!
: H# A& }! T/ [8 E! p4 a可能是我的走线比FPGA的管脚要粗吧,导致在DRP模式下,出现FPGA这边用非常细的线来连接& s+ ~  s, J' |! X4 i, ~
这个问题能在开DRC模式下解决吗,有的话,告诉我方 ...
9 V8 w1 ^0 Y$ d/ b: t! H# ~
% |0 N2 ^4 ~3 D* w( a0 A& ~" I7 F3 M
那是因为你设置了安全间距不当的原因。比如你的FPGA的元件脚间距才6mil,而你的安全间距值设了10mil 或6mil以上,而又开启了DRP走线的话,当然无法连接。
5 u# x( O, ?0 G. C- G, b
  j) z* [/ s4 ?* z0 E9 ^4 R我很少开着DRP走线。都是设置好显示栅格和设计栅格好,利用栅格的功能来进行走线。很少修线。

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 楼主| 发表于 2008-10-28 21:11 | 只看该作者
原帖由 maozhiqiang 于 2008-10-22 15:02 发表
) |% G! l3 y2 Z; O+ dValue值显示问题% O$ @$ ]0 Z: L5 ]. R; u8 @4 F3 e. }
最近画了一块板,线也弄完了,最后时,老板要求出图制版是显示出VALUE值来,) Z+ a- I, a  ^7 ]- M/ ?% B
我用allegro画的原理图,PADS布的线,现在板子布好了,想加进去VALUE值,却不可以;
; @3 [& P! m) q8 u( c: D7 {: P0 P关键是我最开始导网表是没在后面 ...
# K, ]' M1 m" W3 j

  J( Z# a( p0 a) W+ m9 p用ORCAD重新生成NET,再导入进行对比,更新是可以做到的。

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 楼主| 发表于 2008-10-28 21:15 | 只看该作者
原帖由 古域清流 于 2008-10-22 20:07 发表 ' Z$ R7 j: w1 @$ h- _% O! a
请问有尊敬的版主,我在使用LOGIC的时候,为什么不能接地??按右键选地的时候弹出一个窗口,提示:
$ `3 n+ [  c( Q3 q! f2 L0 apin discrepency    decal gatefor gate number#   : X9 Q6 D( K2 X4 h4 l  V1 D
还有就是我画线的时候可以在线走到一半的时候双击左键悬空,而 ...

' W1 K, j/ }* C) j: A) `
: r6 s9 V: H% y
- X9 ]; A1 v2 }! x  s/ G! U可以接地。画走线的时候按SHIRT+空格就可以了,TAB可以进行却换.
7 S* V: C7 ], C0 Z# a, \  l
) h; J. X; n) E- G% p' m请用默认设置。

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 楼主| 发表于 2008-10-28 21:17 | 只看该作者
原帖由 maozhiqiang 于 2008-10-27 15:58 发表
, V$ g) d! O1 D! w4 U: P求助:网表问题4 \; Q0 S( f2 W- g2 [1 M
重新装了下电脑结果,输出网表时提示      : 2 g! v- U5 ]  x) E+ T
Design Name: D:\资料\复件 FINAL.DSN8 g, m, q; h9 y# d
[FMT0012] Can't open first output file
) P; f' m8 k! F8 N$ m#各位碰到过没有,帮忙啊,先谢谢拉!
5 G" f% X: d: z4 `3 h6 Z& v* Y& b
- R$ A" f0 N+ V4 g! p6 u* G斑竹救命
' ~' D0 ~; d9 z4 _  J
7 D/ N) C0 b/ r# Y6 G6 N
请将FINAL.DSN改为FINAL.ASC

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 楼主| 发表于 2008-10-28 21:18 | 只看该作者
原帖由 qisaiman 于 2008-10-27 20:33 发表
1 ]; i% a) ~% T2 \4 a用的是4.0版本,转过来的pcb能够打开,不过把其中封装保存到库里,再编辑的时候没有外轮廓,不知怎吗回事,大家试试看,有没有这个问题。13260
! |  c* `: L. c+ F9 L/ E: {6 }) _
+ I, H4 Z! U; ^/ F% t" \
因为转过来的封装的2D线是放在顶层丝印层,而默认的显示顶层丝印层是没有设置COLORS的,你把顶层丝印层的COLORS打开就可以看到了。
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