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电巢直播8月计划
楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2011-6-27 17:46 | 只看该作者
回复 如风 的帖子! R3 O8 P- V* g  C" R, Y/ W
$ g2 U3 D0 I, A3 l- f
呵呵我也是被逼得没办法了,电子工程师老是改这改那,没办法, 有时赶时间就手工联线,发了板再改原理图,唉

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发表于 2011-6-28 09:24 | 只看该作者
谢谢,可以了,两层也行,层属性设置好久可以了
  L1 n6 Z2 a4 W& e2 k
4 Z8 m5 e5 X/ @; M5 F% h
/ L1 ~: [1 [* ^8 V+ P- s                                                                                                                                                                                                                                                                                                                                                                                                                                                                                          

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发表于 2011-6-28 10:08 | 只看该作者
好像俩曾值与用si 计算的值不对应

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是的.还要更改介质厚度  发表于 2011-6-30 16:05
头像被屏蔽

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发表于 2011-6-28 15:34 | 只看该作者
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发表于 2011-6-30 10:52 | 只看该作者
回复 jimmy 的帖子! K; P0 N, d, c8 Y
7 o/ W. M+ a9 w/ ?- w
你好,我画的图出现这样的问题,怎么解决呢?https://www.eda365.com/thread-13627-1-1.html
- z9 I8 R1 D; B* @
- }" B2 a- D8 K/ A/ T) N$ I类似问题https://www.eda365.com/forum.php?mod=viewthread&tid=31122&extra=#pid454087: _% u! l$ k8 M0 M
求解
2 J2 s" z! Y- K4 z8 V

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贴子里面已有答案.  发表于 2011-6-30 16:06

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发表于 2011-7-2 12:44 | 只看该作者
请问下楼主,我在别人PCB上保存下的decals建起老是出错,我想知道这其中的差别是?

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别人PCB的层数是不是被max layer了?  发表于 2011-7-4 11:59

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发表于 2011-7-4 21:25 | 只看该作者
挖坟啦,挖坟啦! 28326856这个群貌似已经不允许加入。% ]/ O. k/ |0 U/ S% k% [9 h
- e% v+ a6 }2 K& t* R8 A1 Y
加不了!!

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发表于 2011-7-4 21:28 | 只看该作者
PCB中,默认规则中,设为6MIL。由于有个芯片引脚间间距比较密(小于6MIL),如果采用默认的设计规则,DRC时,会显示报错。因而采用规则优先级,在COMPONENT中,对此元器件单独设置,间距设为5MIL* y" |: J* j0 ?1 V" N4 R: G
    但再进行DRC时还会报错。不知道是什么原因?    注:此DRC虽然不影响最终的PCB生产,自己明白是由于引脚太密造成了,但这个问题不解决心里总不爽
; y& h7 ~# i' g; s2 G1 z   还请JIMMY指点下

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我是用6mil检查一次后,发现只有芯片这里报错.我会将规改成5mil再检查一次...如果没有问题就OK了  发表于 2011-7-5 09:58

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发表于 2011-7-6 10:21 | 只看该作者
本帖最后由 jimmy 于 2011-7-6 12:55 编辑
1 l, e  m. ?3 \; t3 @  Q0 A
4 T+ G$ r- ?  J. Q7 t6 \请教JIMMY,PADS ROUTE的用法,在PADS ROUTE里布线的话LAYOUT里没有同步啊.这是什么原因?
3 q# N: S1 U8 c# x
* m4 E1 X6 F5 Z3 J3 U
# R3 R. n/ x( a: C4 @- F! r& B( ]! `) x6 A( J) D
jimmy回复:
" E- p( @. F" H+ b9 V% }0 B# ^9 Q! l

" p4 L4 [6 ]8 F$ o8 W% u1 O- c
/ P0 L  D8 G0 p2 F, _: y

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发表于 2011-7-6 10:27 | 只看该作者
还有就是ROUTE里加过孔怎么加啊

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shift+左键  发表于 2011-7-6 12:55

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发表于 2011-7-6 17:13 | 只看该作者
本帖最后由 jimmy 于 2011-7-8 11:02 编辑 . n& x; y# {7 x7 X

8 Y6 i1 N' S: |* G请教,如何把在布线的时候切换过孔,VIA我设置了有两种,但布线的时候一直是一种,不会切换,如何切换呢???
# ?8 I" J/ Z: b1 k/ K6 Q' \7 l
9 {0 v$ R! S1 D" Z( i9 t
jimmy回复:
$ }2 o# {- f& \! m 8 k! @8 H3 ]+ _+ f$ S- z
键入无模命令VT,回车后,就可以进行选择了.
$ A! z/ T7 j2 z4 z5 O7 n/ g" \
% T& U8 i" @8 i* i9 T6 |
0 G  Z3 ^5 B- D! E6 ~% Z& D

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发表于 2011-7-7 08:59 | 只看该作者
请教JIMMY,PADS里要画多张原理图,有没有主次规定呢?就直接添加页,导出就可以吗??

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通过页间连接符off-page就可以了  发表于 2011-7-8 11:03

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发表于 2011-7-7 11:51 | 只看该作者
请问:
& V& D& _, c2 H4 B3 {  K& Apads2007在手动布线时,怎么看不到当前线的宽带?请高手指教!
6 o( t: O* F" ]$ z( ?* R

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设好相关的规则就可以了,如default,class或net规则  发表于 2011-7-8 11:04

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发表于 2011-7-7 16:21 | 只看该作者
jimmy 好厉害

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发表于 2011-7-7 17:53 | 只看该作者
回复 jimmy 的帖子  _1 Y/ W  o$ Q: E8 N
: l8 S* b& }2 L. k
请教LZ:
2 x1 B5 \% Z( F8 _, E% N& w5 [! t
我的电脑里安装了PADS9.0精简版(原来有安装过PADS2005,后来不行了重装也不行,没办法只好装了PADS9.0精简版),将LAYOUT好的PCB导出POWER PCB5.0.asc文件,再用另外台电脑PADS2005导入刚才“导出POWER PCB5.0.asc文件”,却出现以下“警告和ascii.err”问题(见附件),但用另台也装了PADS9.0精简版导入却没有问题;
还有原来用PADS2005LAYOUT好的PCBPADS9.0精简版打开后,再导出POWER PCB5.0.asc文件,用另外台电脑装PADS2005导入却没有问题。不知是什么原因,烦请楼主请教 ,谢谢!

, K+ Q4 `& c( f: q- {9 C

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我有点被你绕晕了,哈哈. 9.0打开或导入后会修正原来设计上的一些不符合"规范"的东西. 你最后面的导的asc应该不是之前说的第一份asc吧?  发表于 2011-7-8 11:07
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