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电巢直播8月计划
楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2011-7-8 08:37 | 只看该作者
jimmy,
' T% Z/ m' V9 q* k; T( I2 S6 M8 c4 X当地层设为CAM 平面层。选择CAM输出地时,在地层上还需要覆铜吗?为什么我看的一本书上没有介绍地层覆铜,只有在顶层和底层覆铜。知道你是高手。请指点。谢谢。
' G. b2 S# D7 i0 \% K

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高手不敢当. CAM为负片层,只要设置为CAM并分配了相应的网络,如GND后.在这一层可以不用作任何处理. 而TOP,BOTTOM都是no plane.所以要灌铜的话,还得用copper pour进行灌铜处理.  发表于 2011-7-8 11:11

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发表于 2011-7-8 11:23 | 只看该作者
请教,PADS里怎么隐藏某一个标号的飞线呢?

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选中这一"标号",右键,view net进行隐藏或开启.  发表于 2011-7-11 12:05

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发表于 2011-7-8 11:54 | 只看该作者
红土乡情 发表于 2011-7-7 17:53
3 a, b3 |( a* Z5 y, w! R回复 jimmy 的帖子
: J4 Y" V1 i+ Z) a/ f/ C0 ~- T
+ M/ U/ P) M* Q" g) G请教LZ:

: a$ x2 q& c9 a1 j是同一个asc文件,PADS9.0导入不只出现警告和错误问题,且打开后发现很多网络都没有了,真搞不懂,烦请LZ指教# a$ ?& F: _# f4 M0 B# n

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这个我也搞不懂,呵呵...我现在是用9.3版本.  发表于 2011-7-11 12:06

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发表于 2011-7-8 13:35 | 只看该作者
回复 talonzhang 的帖子. w: l9 w6 x/ y  W3 _1 T' Y
' G2 v0 k) ]% e& K8 s4 l
多谢JIMMY,我也是这样认为, 只是有个前辈认为也要覆铜,让我好困惑。现在确认不用再覆铜。( {; Z0 u- [) d9 D! _
再请教一个问题,分割电源后为什么选择PLANE CONNECT, 不显示HATCH, 不分割电源(即单个电源时,显示HATCH)。
) B: o. O$ @+ g& {& M$ w+ n$ U
2 S0 j# y. t" x2 a# t

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因为你的层属性是split/mix.  发表于 2011-7-11 12:06

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发表于 2011-7-8 14:44 | 只看该作者
回复 talonzhang 的帖子4 {! f* K0 y) b: \/ `

1 h0 ~, ?. ~; M# s0 [0 M. J6 }) M. K找到答案,可能是网络没有过孔接POWER PLANE

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发表于 2011-7-10 15:21 | 只看该作者
pads2007走线没有PADS2005方便,PADS2005走线比较快,顺手。是否设置有问题,楼主能回答一下吗?

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熟悉任何一个新事物,都是需要时间去适应的.  发表于 2011-7-11 12:07

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发表于 2011-7-12 09:56 | 只看该作者
想请教JIMMY,BGA布局、走线的思路,FANOUT出现错误C:\Documents and Settings\Administrator\桌面,有时间帮我讲解一下。谢谢!

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BGA的布局,布线,fanout在论坛里均有教程.  发表于 2011-7-13 09:12

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发表于 2011-7-13 12:33 | 只看该作者
jimmy:
6 p5 W! w9 q! W( D" F- c7 J您好!. T) r% N$ H, `- V
请您抽时间做个盲埋孔宏录制的视频教程吧,很需要,谢谢
" J& ^8 |& b9 W, U8 t) a7 u

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https://www.eda365.com/thread-46620-1-2.html  发表于 2011-7-13 12:56

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发表于 2011-7-13 13:32 | 只看该作者
本帖最后由 jimmy 于 2011-7-14 15:36 编辑
& e$ j- w( T' s$ O  Z( G7 y8 G& U) P8 ^, \. F9 h& E7 Y
jimmy:: ^+ K% \+ f$ X; j
您好!  A  Y% Y$ [! W- Z, M. L
您给的链接里只有6层板的宏,我是个8层板,过孔和您的不一样如:L1-2,L2-3,L3-6,L6-7,L7-8, 不知道怎样做宏,谢谢
9 t$ ?7 p- a- w! S1 W; Q  S2 x5 K
" b( }) o: z) p/ K; ^/ s( `0 J& j9 m' Z9 W4 d2 `
jimmy回复:
8 n( `  {7 @+ f8 n# \
3 G: T4 f3 t0 x: `5 o2 V8 |2 N$ f! y
3 V* n1 `2 }4 h 8L.rar (972 Bytes, 下载次数: 47) : O6 s: k. i: I4 t' L% e
! Q$ ?- ?  l" Y2 s2 |
8层板的宏4 `  L: G6 }+ i3 H4 q: z( O) x( q

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发表于 2011-7-14 14:43 | 只看该作者
本帖最后由 happymewnana 于 2011-7-14 14:44 编辑
+ u1 ~5 e* s: G1 n2 K! u& Q
( e0 D, d/ ]$ a) ?( s  _jimmy,你好,我想请教一个问题,我在pads logic原理图里改了元件的封装想要同步更新到LAYOUT里,使用ECO TO PCB功能时,会出现“ECOGen failed”的提示,还有一个ECO comparison errors file -- C:\PADS Projects\Logic.log 的文件,
, w% w! P  I0 Q1 X2 n& F文件内容如下:
& p6 C( }9 p  |: U; }+ Z* |0 s; FPADS Layout ECO Generator (Version 6.4v) 2011-7-14 14:40:15* D  O* V: K$ S
Copyright (c) 2003 - 2008 Mentor Graphics Corp. - All rights reserved
- i, \# n# w; z  b( B2 z1 b( p) KCommand line arguments:  -e C:\PADS Projects\Logic.log -r p -a PART,NET -f -l PCB,NETCLASS,NET( _4 C! v0 [- T
ERROR: Wrong gate pin data at the line: USB-PORT SIP-4P UND  1   0   0     0 Y! ?$ `# w) r- j
ASCII reading (part types and decals) - 0 msec
) n3 Z8 k2 W; R我想知道这是怎么回事,希望大师指点一下!谢啦!

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确认以下几点:1,是否只打开一份PCB文件?2,更改的PCB封装的管脚数量是否与原理图一致 最好有相关的原理图,PCB和库提供.  发表于 2011-7-14 15:38

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发表于 2011-7-14 16:34 | 只看该作者
本帖最后由 happymewnana 于 2011-7-15 10:09 编辑
( B: F/ {$ v: I  L4 v
; v4 y0 D1 s% p$ y. Y4 f- N4 Z我只打开一份layout文件呀,pcb的封装是由库提供的,原理图里的示意图是我自己画的,管脚数量也是一样的呀!8 E7 p, A) G/ N% O7 V2 X. B
9 S& f: X) u; d0 |0 g" H

' d+ A' l  X# h) k/ e+ s  H
9 R" @0 y3 g; \+ t& R) U3 L这就是原理图和pcb,还有库,麻烦帮我看一下,谢啦! mypcb.zip (1.46 MB, 下载次数: 27) 4 D1 {& p( k' W4 p& k- m" p3 `

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最好有相关的原理图,PCB和库发上来. Wrong gate pin data at the line:USB-PORT SIO-4P 说明问题出在此器件上.  发表于 2011-7-15 08:29

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发表于 2011-7-15 10:11 | 只看该作者
这里就是原理图和pcb,还有库,麻烦帮我看一下,谢啦! mypcb.zip (1.46 MB, 下载次数: 21)

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发表于 2011-7-15 11:19 | 只看该作者
回复 jimmy 的帖子
; C; H- Y6 d6 x6 Y+ Z* N  M: R' U6 \- e; r" y- N, c2 t
这个群是假的,我加了可是那个Q的主人跟我说他不懂什么PCB

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发表于 2011-7-15 11:42 | 只看该作者
为什么有时候需要制作多层板?每层信号的主流走向是如何规定的?他的信号走向意义是什么?如何指定电源层?如何在分割层上约束分布网络?

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发表于 2011-7-15 13:19 | 只看该作者
PCB板上放置文字标记,应当放在哪一层?

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丝印层.  发表于 2011-7-18 12:35
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