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电巢直播8月计划
楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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发表于 2011-6-27 17:46 | 只看该作者
回复 如风 的帖子
) X( ~! F0 f3 L* m0 l+ w/ j+ K3 O" A$ s6 Q( L
呵呵我也是被逼得没办法了,电子工程师老是改这改那,没办法, 有时赶时间就手工联线,发了板再改原理图,唉

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发表于 2011-6-28 09:24 | 只看该作者
谢谢,可以了,两层也行,层属性设置好久可以了
# n! g- _& W$ s' j' V$ N/ W1 A0 n8 i, D" ?

5 ?6 X' d# C. c) q# K( W+ Z                                                                                                                                                                                                                                                                                                                                                                                                                                                                                          

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发表于 2011-6-28 10:08 | 只看该作者
好像俩曾值与用si 计算的值不对应

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是的.还要更改介质厚度  发表于 2011-6-30 16:05
头像被屏蔽

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发表于 2011-6-28 15:34 | 只看该作者
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发表于 2011-6-30 10:52 | 只看该作者
回复 jimmy 的帖子5 z8 b( @& k0 y# i* l4 L  P3 p7 p0 A: m2 t

7 {; }6 }" k8 j0 z  A你好,我画的图出现这样的问题,怎么解决呢?https://www.eda365.com/thread-13627-1-1.html8 E% V4 w# ^& q' w

3 b1 x  A) O  x类似问题https://www.eda365.com/forum.php?mod=viewthread&tid=31122&extra=#pid4540871 g' l9 V! ^$ ?. V
求解
' X% @9 s: {* O0 I+ A& A& }" D

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贴子里面已有答案.  发表于 2011-6-30 16:06

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发表于 2011-7-2 12:44 | 只看该作者
请问下楼主,我在别人PCB上保存下的decals建起老是出错,我想知道这其中的差别是?

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别人PCB的层数是不是被max layer了?  发表于 2011-7-4 11:59

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发表于 2011-7-4 21:25 | 只看该作者
挖坟啦,挖坟啦! 28326856这个群貌似已经不允许加入。6 ^5 @( U0 I1 t$ g

& |4 E, m% B; c 加不了!!

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发表于 2011-7-4 21:28 | 只看该作者
PCB中,默认规则中,设为6MIL。由于有个芯片引脚间间距比较密(小于6MIL),如果采用默认的设计规则,DRC时,会显示报错。因而采用规则优先级,在COMPONENT中,对此元器件单独设置,间距设为5MIL
* l% r* @5 f" x! p% [8 W6 w1 T/ r    但再进行DRC时还会报错。不知道是什么原因?    注:此DRC虽然不影响最终的PCB生产,自己明白是由于引脚太密造成了,但这个问题不解决心里总不爽
. r* y7 X' E. N8 R5 F) ~   还请JIMMY指点下

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我是用6mil检查一次后,发现只有芯片这里报错.我会将规改成5mil再检查一次...如果没有问题就OK了  发表于 2011-7-5 09:58

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发表于 2011-7-6 10:21 | 只看该作者
本帖最后由 jimmy 于 2011-7-6 12:55 编辑
. v/ w3 ?4 O( q1 T
2 ~( ?3 }  Z1 F# f请教JIMMY,PADS ROUTE的用法,在PADS ROUTE里布线的话LAYOUT里没有同步啊.这是什么原因?5 F* k9 r2 D* I9 a8 Z5 Z; V7 ]+ I
4 X8 I0 c1 K! B4 }, M% o

( |5 h. q/ J% M" u& V/ y+ W; I9 j3 O8 Z  M+ \% k6 b! |8 [$ |) y
jimmy回复:2 K; A6 ~. T& L5 ?) _
, h7 X+ k8 X& K/ v  Z% {- `( Q

8 K) A. `: G3 u8 z  j- D, O6 f& t) u1 y' G

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发表于 2011-7-6 10:27 | 只看该作者
还有就是ROUTE里加过孔怎么加啊

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shift+左键  发表于 2011-7-6 12:55

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发表于 2011-7-6 17:13 | 只看该作者
本帖最后由 jimmy 于 2011-7-8 11:02 编辑 9 p# `8 Z% x& \  P4 r9 i6 {/ W
* i4 y5 o3 ], y2 ~
请教,如何把在布线的时候切换过孔,VIA我设置了有两种,但布线的时候一直是一种,不会切换,如何切换呢???
3 N9 u+ y* J  a# q* l9 r# r: `3 R6 u- C
) Q1 Z7 B4 l7 N4 r0 [# k
jimmy回复:
, L) p  j- W8 u" Y. Z" u
) ]4 d$ B4 C/ n6 |* ~: O  j键入无模命令VT,回车后,就可以进行选择了.
5 {- n6 g* F/ _( c7 `
* d) Y7 B9 C" K. [, F' A1 i
" i9 V/ A7 m- j2 h' |

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发表于 2011-7-7 08:59 | 只看该作者
请教JIMMY,PADS里要画多张原理图,有没有主次规定呢?就直接添加页,导出就可以吗??

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通过页间连接符off-page就可以了  发表于 2011-7-8 11:03

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发表于 2011-7-7 11:51 | 只看该作者
请问:
9 p8 r) @4 v* p( z6 c( D+ [pads2007在手动布线时,怎么看不到当前线的宽带?请高手指教!
2 f( e3 c+ f* J( x0 R  K& _$ M

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设好相关的规则就可以了,如default,class或net规则  发表于 2011-7-8 11:04

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发表于 2011-7-7 16:21 | 只看该作者
jimmy 好厉害

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发表于 2011-7-7 17:53 | 只看该作者
回复 jimmy 的帖子4 _- _, i( V; V" F

# L$ i2 }& d4 e! ~. j请教LZ:
# `, Y8 Q6 b1 B" A" D3 W
我的电脑里安装了PADS9.0精简版(原来有安装过PADS2005,后来不行了重装也不行,没办法只好装了PADS9.0精简版),将LAYOUT好的PCB导出POWER PCB5.0.asc文件,再用另外台电脑PADS2005导入刚才“导出POWER PCB5.0.asc文件”,却出现以下“警告和ascii.err”问题(见附件),但用另台也装了PADS9.0精简版导入却没有问题;
还有原来用PADS2005LAYOUT好的PCBPADS9.0精简版打开后,再导出POWER PCB5.0.asc文件,用另外台电脑装PADS2005导入却没有问题。不知是什么原因,烦请楼主请教 ,谢谢!

4 X, a% `% @+ t/ d- D6 I

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我有点被你绕晕了,哈哈. 9.0打开或导入后会修正原来设计上的一些不符合"规范"的东西. 你最后面的导的asc应该不是之前说的第一份asc吧?  发表于 2011-7-8 11:07
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