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allegro导入网表错误解决,不是封装和路径问题

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发表于 2014-2-19 10:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
本帖最后由 maozheng110 于 2014-2-19 10:04 编辑 4 o4 X; x- o3 D$ O' K6 i% V4 z  H
3 x% ]& e6 q3 n! n7 @
已布过一部分线,放了一些封装,并且有fixed属性,改原理图后重新导入网表出错。: I7 ~9 k8 r1 O. ]
不是找不到封装问题,不是路径问题,直接报下错。# B( ?2 }  S; {# K4 ~$ h: E) [& q
#1   ERROR(102) Run stopped because errors were detected
6 s- S2 y- J$ w% c解决方法:
' q- h7 _2 l4 Y, mImport Logic的时候选项Place Changed Component里选Never,再选always时也不报错了
& M( X7 H9 U! Y( w1 |* \; R( H* |  `$ q

3 a' Y" x" M! G, _" U! H( `: Z各选项说明:; g- ^# F, o4 V; T
# always 全部放置在原先的位置上5 n/ c! T+ ~2 L1 `3 S  k
#never   原先放置的零件拿掉,导入netlist重新放置
; B: h4 ?( O. n' I" J0 z+ b#if same symbol 当新旧零件包装相同时替换,并且位置相同
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发表于 2014-2-19 11:24 | 只看该作者
你选择never代表将所有的元器件拿走,然后重新放置,因为你的元器件有FIX属性,所以报错。我一般就用alwasys,而且你也只是修改一部分线路,选always就可以了,非要选never,就要勾选ignore fix property
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