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DDR3布线问题

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发表于 2013-12-10 15:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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大神们,好!!
4 x; v, x* w! T. G% e
1 a* Q& C7 s6 B* Z( g5 C! G请教DDR3布线问题:
  z' o. d% V4 j+ }1.地址线不知怎样来走好,看了好多资料说地址线参考地和电源 ,我原想参考电源 平面 ,从BGA出线到T点全部走第3层线,但T点到两端就无法 走线了,不知参考 那层好?如果 在不改变层叠的情况下,地址如何 来走?4 I6 ]; t- ^0 A" e8 l
" m! a" e9 t/ B/ k$ ~& K0 x+ Y) K( k
2.二边的数据线现在这样出线和走法,这样可以不,感觉 空间很紧,调等长会不会无法 调!也看看,给个建议??+ t1 {4 L! Y/ V4 B( O, Y6 v5 T
- {4 k) G/ J8 u& D* ?
; w2 ^7 u# ]. V$ Y- R
非常感谢!!!) y; U5 e+ ]) {- z* h$ H

: r% L/ |$ Q% X1 J5 k# B 1 [1 S8 v+ \: L9 W: s7 W
' d' U' u; N$ X8 j5 ~" ~
这是PCB文件 ,16.6版本的!!!8 q) ?2 B% K) a# f+ T+ @
ddr3.zip (417.45 KB, 下载次数: 242)
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发表于 2013-12-10 17:14 | 只看该作者
数据线要求比较严格,数据线同组同层,保持两倍线宽间距,你那样布局数据线可以全部用一层完成,优先参考地;地址线要求没那么严格,在空间有限的情况下可以按1:1的间距走,但有空间最好按1:2的间距,能够同层最好不过了,但T接是很难做到同层的,可以不同层。

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 楼主| 发表于 2013-12-10 18:30 | 只看该作者
谢谢二位的解答 ,数据线同组同层是不是指每8条为一组。5 |) y* R# Z' V- x; n6 G# [
                           目前数据线全部用第三层走,线间距是不够,这点以确定 。0 }! S$ k/ F4 r# P( K
                        地址线目前从BGA走一层,空间不大,要走到那层比较 好?& Q6 ]( }+ G- w" L+ ^8 G
                       还有一些控制线,是和地址线走一起吗?

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发表于 2013-12-12 09:22 | 只看该作者
molin 发表于 2013-12-11 19:02
. ~1 v5 O1 C" _" T* T7 ^5 n大神,数据 线用3 4层走线,参考层不是变了吗,2层是GND ,5层是VCC,这样也可以?
3 Q$ N6 g8 I7 i% d1 s+ P而地址线用走top和BO ...
- v' X; S4 ^) q. C+ L' l
你的板子分层有点怪,数据线应该走内层,同组同层(11根),最好是参考GNG层。但是你的只能两组数据线做到。所以我认为两组走3层,两组走4层。据我所知:地址线参考power层,但是时钟线又是要求参考GND层,所以地址线是很纠结的线,具体看你要求。

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发表于 2013-12-10 15:37 | 只看该作者
本帖最后由 tanyaofeng 于 2013-12-10 15:42 编辑 ! o  b4 `! j# N7 N

4 n% `2 ~/ S- `# ^( f  }看看

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发表于 2013-12-10 15:45 | 只看该作者
为何不用flyby

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 楼主| 发表于 2013-12-10 15:52 | 只看该作者
zcl2012 发表于 2013-12-10 15:45) o# U$ N9 h5 ~
为何不用flyby

, g" L8 H$ h% }0 V2 v+ y( k+ k7 L9 L' V( x7 m
FLYBY不会用,也没用过,还有就是从省空间方面考虑!!谢谢

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发表于 2013-12-10 16:27 | 只看该作者
个人建议:数据线同组用同层(内层),数据线用3/4层走线,一个DDR分别都用3/4层走线,这样不用考虑组间间距,目测你的距离太近。地址线要求不严格,建议上下两个DDR的注意fanout,用3/4层线连接,T点到BGA建议用TOP跟bottom面走线。建议完毕

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 楼主| 发表于 2013-12-10 16:46 | 只看该作者
天启者 发表于 2013-12-10 16:279 M) E. P+ U8 h/ o# _$ T
个人建议:数据线同组用同层(内层),数据线用3/4层走线,一个DDR分别都用3/4层走线,这样不用考虑组间 ...
4 y4 I8 H/ U8 `. d
谢谢解答!有问题:( A" N( O' t* [9 s1 a# m- ?; V
数据线现在全部用3层走线。你说的地址线上下两个DDR的注意fanout,是出线不对,还是什么 意思 。T点到BGA用TOP跟bottom面走线,这样参考平面 不一样,T点到DRAM二端用4层直线,这样可以吗

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发表于 2013-12-10 17:17 | 只看该作者
molin 发表于 2013-12-10 16:466 H- ~9 U. w8 {& ~
谢谢解答!有问题:1 L8 z7 k: m+ ?8 Z
数据线现在全部用3层走线。你说的地址线上下两个DDR的注意fanout,是出线不对,还是 ...
8 h( m$ w" K- I1 `6 X
据我以前经验:你的数据线全部用第三层走,目测是无法满足组内跟组间的线间距。至于上下地址线的DDR的注意fanout意思是方便你出线连线,地址线要求不严格,参考层不同也关系不大。

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 楼主| 发表于 2013-12-11 19:02 | 只看该作者
天启者 发表于 2013-12-10 17:17
8 a7 Z8 |/ l0 S0 b: [据我以前经验:你的数据线全部用第三层走,目测是无法满足组内跟组间的线间距。至于上下地址线的DDR的注 ...

. W+ ^  t1 y: p大神,数据 线用3 4层走线,参考层不是变了吗,2层是GND ,5层是VCC,这样也可以?
' o! M& z/ p6 c! f5 W& F, K而地址线用走top和BOTOOM参考层也是一样??

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发表于 2013-12-13 17:45 来自手机 | 只看该作者
兄弟用菊花连走,不要t形

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 楼主| 发表于 2013-12-13 18:08 | 只看该作者
newcomsky 发表于 2013-12-13 17:45
: d4 p% L+ q' `3 M9 z5 I兄弟用菊花连走,不要t形
6 H9 _8 K3 V5 U5 H
大哥 ,菊花连怎么走,无从下手啊,求教程 啊!!!

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发表于 2013-12-15 21:47 | 只看该作者
走菊花链的话得确定你的DDR3有读写平衡的,如果不支持读写平衡走菊花链也没用。问问硬件支持吗,如果支持的话可以走菊花链也就是flyby。如果不行的话按照上面的建议走T点。再不会的话可以联系我,加我Q,392575977.

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发表于 2013-12-15 21:49 | 只看该作者
另外你的fanout有问题啊,还有孔打的也有问题,才4片的DDR不至于没有空间的。
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