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DDR3布线问题

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发表于 2013-12-10 15:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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大神们,好!!
! `3 d5 C, b6 K+ @8 |
% E4 L3 N( q& A* x+ Q请教DDR3布线问题:. G: n8 n6 U( O
1.地址线不知怎样来走好,看了好多资料说地址线参考地和电源 ,我原想参考电源 平面 ,从BGA出线到T点全部走第3层线,但T点到两端就无法 走线了,不知参考 那层好?如果 在不改变层叠的情况下,地址如何 来走?
! Z) z4 B- x1 L& @& X/ R" V" H5 f6 ]9 g# C! G$ J
2.二边的数据线现在这样出线和走法,这样可以不,感觉 空间很紧,调等长会不会无法 调!也看看,给个建议??2 M* U& s7 r& h0 w% K' }
+ ~' \* G# Q8 O! }5 j, h/ s
6 J, T& K( S6 y- N3 f8 M$ A3 H! I
非常感谢!!!
2 U( F" g, l, k/ J5 M4 X9 q1 W
& V" h; R  G* \8 \9 s, F* ]* _! N
: N$ ^8 d* V) r9 ~7 _$ c! z2 ?+ i
2 }) W) F9 y% Z; J$ y0 o这是PCB文件 ,16.6版本的!!!
) x) C0 U( j( U0 ?) F6 e ddr3.zip (417.45 KB, 下载次数: 242)
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发表于 2013-12-10 17:14 | 只看该作者
数据线要求比较严格,数据线同组同层,保持两倍线宽间距,你那样布局数据线可以全部用一层完成,优先参考地;地址线要求没那么严格,在空间有限的情况下可以按1:1的间距走,但有空间最好按1:2的间距,能够同层最好不过了,但T接是很难做到同层的,可以不同层。

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 楼主| 发表于 2013-12-10 18:30 | 只看该作者
谢谢二位的解答 ,数据线同组同层是不是指每8条为一组。
2 t- x& \$ ^: d0 R9 \; `. I- m/ k0 V                           目前数据线全部用第三层走,线间距是不够,这点以确定 。
8 m. H6 i' Z5 m" H8 D% A  k                        地址线目前从BGA走一层,空间不大,要走到那层比较 好?
3 T- H% Q8 O9 p; l6 V' w/ K                       还有一些控制线,是和地址线走一起吗?

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发表于 2013-12-12 09:22 | 只看该作者
molin 发表于 2013-12-11 19:024 n" T2 g, c/ z8 Y
大神,数据 线用3 4层走线,参考层不是变了吗,2层是GND ,5层是VCC,这样也可以?
7 z  [9 A1 e. l5 C" s: m8 w而地址线用走top和BO ...
3 F( Q, `, _7 i
你的板子分层有点怪,数据线应该走内层,同组同层(11根),最好是参考GNG层。但是你的只能两组数据线做到。所以我认为两组走3层,两组走4层。据我所知:地址线参考power层,但是时钟线又是要求参考GND层,所以地址线是很纠结的线,具体看你要求。

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发表于 2013-12-10 15:37 | 只看该作者
本帖最后由 tanyaofeng 于 2013-12-10 15:42 编辑
* o1 W( I6 m- l+ E, k/ f( x* d) f6 L) T$ s! I
看看

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发表于 2013-12-10 15:45 | 只看该作者
为何不用flyby

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 楼主| 发表于 2013-12-10 15:52 | 只看该作者
zcl2012 发表于 2013-12-10 15:451 X3 }6 l  W3 u: b, W/ u2 Q- N
为何不用flyby
- Y' ]- M0 Z0 |& @
$ N- L; V9 w! W& V+ r* U
FLYBY不会用,也没用过,还有就是从省空间方面考虑!!谢谢

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发表于 2013-12-10 16:27 | 只看该作者
个人建议:数据线同组用同层(内层),数据线用3/4层走线,一个DDR分别都用3/4层走线,这样不用考虑组间间距,目测你的距离太近。地址线要求不严格,建议上下两个DDR的注意fanout,用3/4层线连接,T点到BGA建议用TOP跟bottom面走线。建议完毕

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 楼主| 发表于 2013-12-10 16:46 | 只看该作者
天启者 发表于 2013-12-10 16:27- H- L6 ^, A2 S, V% W0 t. m
个人建议:数据线同组用同层(内层),数据线用3/4层走线,一个DDR分别都用3/4层走线,这样不用考虑组间 ...
4 F1 Z7 k5 k. `- A4 i- ^  @- {
谢谢解答!有问题:
7 G7 ?/ y% X  H7 s4 }! F数据线现在全部用3层走线。你说的地址线上下两个DDR的注意fanout,是出线不对,还是什么 意思 。T点到BGA用TOP跟bottom面走线,这样参考平面 不一样,T点到DRAM二端用4层直线,这样可以吗

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发表于 2013-12-10 17:17 | 只看该作者
molin 发表于 2013-12-10 16:464 C; _% c3 z6 M( X7 A
谢谢解答!有问题:1 c; [2 H4 W' j* E, B/ k
数据线现在全部用3层走线。你说的地址线上下两个DDR的注意fanout,是出线不对,还是 ...

$ ^) S) C& p) \据我以前经验:你的数据线全部用第三层走,目测是无法满足组内跟组间的线间距。至于上下地址线的DDR的注意fanout意思是方便你出线连线,地址线要求不严格,参考层不同也关系不大。

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 楼主| 发表于 2013-12-11 19:02 | 只看该作者
天启者 发表于 2013-12-10 17:17
4 c6 S6 X9 d$ [据我以前经验:你的数据线全部用第三层走,目测是无法满足组内跟组间的线间距。至于上下地址线的DDR的注 ...
, I4 ^3 x* @+ `+ l5 T9 ~/ D
大神,数据 线用3 4层走线,参考层不是变了吗,2层是GND ,5层是VCC,这样也可以?
' C& q" L3 ?9 @: e, {而地址线用走top和BOTOOM参考层也是一样??

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发表于 2013-12-13 17:45 来自手机 | 只看该作者
兄弟用菊花连走,不要t形

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 楼主| 发表于 2013-12-13 18:08 | 只看该作者
newcomsky 发表于 2013-12-13 17:45
, Q+ b# r* u# B+ C/ n兄弟用菊花连走,不要t形

6 z. L9 r/ L& Y9 i3 O$ r3 m' I& q大哥 ,菊花连怎么走,无从下手啊,求教程 啊!!!

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发表于 2013-12-15 21:47 | 只看该作者
走菊花链的话得确定你的DDR3有读写平衡的,如果不支持读写平衡走菊花链也没用。问问硬件支持吗,如果支持的话可以走菊花链也就是flyby。如果不行的话按照上面的建议走T点。再不会的话可以联系我,加我Q,392575977.

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发表于 2013-12-15 21:49 | 只看该作者
另外你的fanout有问题啊,还有孔打的也有问题,才4片的DDR不至于没有空间的。
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