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刚学allegro,问几个比较低能的问题.....以后连载

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发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟刚学Allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !6 h$ g3 Q3 ~# t- w8 b
1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。5 y# ]4 t3 m/ A- ?8 v5 a% b' N
2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。& \6 i! j7 h& H6 q: @6 L4 t8 }1 n
3.今天学习Allegro遇到的几个问题:
5 Z9 `2 Z. ]& W( m3 {; `   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:" `" H" u2 w' ~" u* ~9 z
$ {- j% t2 r) F3 G* W
2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?
2 W, ?% t4 t( o5 o8 i  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?
; _! N1 v5 A: ]! r  u2 ]3 \3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:
6 h# f1 T0 B* t    LISTING: 1 element(s)* t* ]' Z: [/ e. p. T' d% x0 n* C9 @

9 U) m5 a; @# U7 T' o  N       < COMPONENT INSTANCE >      
) L+ t! s7 y; o7 R/ G# ]# n
9 \+ |6 m  w! c% q  Reference Designator: U7$ K. l1 e3 x4 X2 y+ ^" g
  Package Symbol:       PBGA400- ~2 r" {$ n; K
7 _  T, }4 w# _9 B, E
  Component Class:      DISCRETE% m* B& P6 k" E( l# c2 k5 i+ L5 U
  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB
8 Q4 G+ |1 a. O# K    Value:              KSZ9692PB
4 T9 f/ T6 O/ |3 n2 q! z
1 z' m+ s$ r8 `& X9 K! f% V0 P5 U  Placement Status:     PLACED0 Z  \% U" s/ s0 ?" d  u
    origin-xy:    (5150.000 4512.500)
- U8 Z! e! _" B# K    rotation:  0.000  degrees
0 f: a5 r( f) {) Q2 @/ |    not_mirrored
2 V, t5 b: t0 H$ f$ a( d3 b8 T( H" a. W* X% B9 X
  Function(s):
/ b' ^7 ?, ?# q* M* R: w, V    Designator: F11
0 d" X4 W  {7 I7 z    Type:       TYPE4
4 w8 W4 H$ M+ C. u: j    Pin(s):     C10, E10, A7, A6, A8...
0 }* Q+ m/ P. |+ t9 K7 j) C% h; x0 W' j# V
    Designator: F10; C+ q. V) n' c( Z+ p
    Type:       TYPE3
7 B. B( v& U) g6 O. e3 J- U    Pin(s):     V16, Y18, T16, U17, V18...
0 y4 a, P# }7 K9 h' Q) F
1 G6 [" {8 W: w    Designator: F9
* l! P# M! T- d    Type:       TYPE2
8 h, J. i; c) }0 Z    Pin(s):     H10, H11, H7, H8, H9...
4 Q1 u$ Z" r8 W; i, l9 ]4 f! Q" K# z9 u$ k- Z- }& t  D" a
    Designator: F8, q% |* C% J, m$ t. v8 `
    Type:       TYPE1$ ^! @9 J0 U9 [8 }! S4 f2 _# h
    Pin(s):     H19, H18, H17, P20, M17...; P' g8 C7 g" A; [$ u; Z9 }) F: J

$ N; }$ Z( a( r  Properties attached to component instance
0 X7 _& `: v( m) ^    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB5 t, F/ p' _: S

. k( k% r) d- L. x  ]( f4 e- I  Properties attached to component definition: `  r7 d' s/ h
    VALUE             = KSZ9692PB
" `+ @1 j! y* U" i" D% C( p" ?5 G2 A: ^0 [& T, {
请问这个Function(S)和SIGNAL_MODEL是指的什么属性?
& L; e: w+ |2 j+ d/ U( r  H: j9 ?先就这么多了。希望哪位兄弟能尽快帮我解决一下。
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 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:
- q* i6 W: h  g9 T$ i3 S我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?6 B2 w3 J; p- \2 F' p3 s* O! W8 v
如附件:; b! m, _/ v2 y6 e/ j3 s" e

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发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,+ c, r( Z* W8 `4 a3 G( M
  传个给我好吗!  @ 谢谢啊!@  
3 m! X% {, H) t" \. J1 A- O7 w1 ~! b8 a
我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng
/ r0 }' z0 @/ ?7 a9 \  o4 t
( Z, G* s; o* A  K: n$ y
5 ~# f9 D7 L  [0 ~* u4 T/ q9 Q开防焊是不是为了用此via做测试点啊?

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发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
, w4 j  X& M6 e' |论坛里有比较好的教程的

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发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。
* p. S6 D, A* F, l! M# \% \. q只能说:你多加油吧,多加班吧!!!
MENTOR奋斗中!!!!
GOOD GOOD STUDY,DAY DAY UP

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 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?
4 Y+ U1 h; v5 k: g7 S6 X. K
1 s- U5 A6 w) m5 Z2 h3 m5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过...6 o% c! v: {, k/ a: a0 b
前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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 楼主| 发表于 2009-7-31 08:49 | 只看该作者
6#
* C" U. }( Q7 J7 @. Y. P
4 f1 A3 R0 A2 K% f% c0 s) G建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
6 p5 n# `# d% U3 f! b论坛里有比较好的教程的.3 U$ t- |& L9 U

& ~2 w+ R0 `3 u/ e这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑 8 A7 b- @/ g, m, c
' p2 C# K: ]% v- C6 m. S( \
8# caiyongsheng
& i0 @' G6 s* U% V& o( X1 T
- r4 g$ V" J  D過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。
, B4 ~2 W! N7 q( G3 b# z9 aNo_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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