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刚学allegro,问几个比较低能的问题.....以后连载

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发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟刚学Allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !
% x) y. M* N: I) C7 q% }, `1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。, w! e8 O. _0 T+ B, A6 S$ B' ?% J
2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。. Z7 h7 Y0 o- n+ k; ?
3.今天学习Allegro遇到的几个问题:% u' J% R7 Z& D3 F: r
   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:7 C+ \1 E# t9 m/ F: A( i
: B9 w" J& K, T5 N1 G; E- ]4 I6 ?! Q' Y
2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?
" ?- Y+ x+ E7 C( z  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?: S3 m1 N% v. |% v  x2 \, M; K
3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:: o" ]. _3 W7 A
    LISTING: 1 element(s)
5 i9 E4 e: Z. s+ q0 n
* ^  p, u$ f; y! }3 K# l- u! r# v; @       < COMPONENT INSTANCE >      
- {+ r) ?" D3 R! E7 e& `+ m0 o  ]
4 H# K* O1 @: ^" Q3 {; P  Reference Designator: U7% f* s+ u$ W4 X
  Package Symbol:       PBGA400" X) p! r2 E# b
, s' \) A$ Z8 S. U6 ?
  Component Class:      DISCRETE4 p4 t/ Y5 v1 y7 l! T& L
  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB9 d" ?. n" ^, i1 B- g
    Value:              KSZ9692PB
; E& X, h# S- c4 H" K. C
' y  w/ @5 y! H% s  Placement Status:     PLACED
) X5 _/ B1 m1 P+ }3 I' H2 E    origin-xy:    (5150.000 4512.500) / Y! t) v7 e$ S' Q
    rotation:  0.000  degrees
9 d# k. q4 {$ Q8 {0 l* M4 _    not_mirrored  F% C; x( N# m
) ?; [( B% w( U$ x* H/ f
  Function(s):
* m# }0 x: _% P3 E6 p+ P. F0 R    Designator: F11
0 D3 o% e$ c' U$ B5 [    Type:       TYPE4
# [- Z/ O! Y* P8 S/ l2 B    Pin(s):     C10, E10, A7, A6, A8...4 v/ c, P# }0 H
4 n, W. f) H5 H3 G! E
    Designator: F10+ g3 i2 C9 A" S9 _  m
    Type:       TYPE3
/ h/ t1 I- G/ p8 l9 T    Pin(s):     V16, Y18, T16, U17, V18...
+ f4 q: ^2 g5 ]7 j1 W" U1 X4 c; D- z9 V& ]* J$ I( [% n% r8 [! _; z
    Designator: F9- _' W0 }. a% a& v6 A& W" p
    Type:       TYPE21 F$ B7 \- [, G  y' |7 T
    Pin(s):     H10, H11, H7, H8, H9...2 y6 u; h- I2 A% }) M! }
2 K3 m* L1 M$ U$ V
    Designator: F82 ]* u, H3 j' @6 l/ ]) {' _
    Type:       TYPE1+ a; }2 L  `3 U
    Pin(s):     H19, H18, H17, P20, M17...
7 {. H' d$ `6 K8 J4 e
( }' Q. C" D- ^1 [: m  Properties attached to component instance* O' S4 F0 T. u" M) y7 n0 ?# B
    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB; t4 z+ Z$ [9 U2 D7 `+ O7 C* }: [

+ ?/ P! }8 \, \0 t# {0 s6 r, L  Properties attached to component definition
/ y8 u9 U. D8 B, \2 |& r    VALUE             = KSZ9692PB
$ D1 K) A8 N/ I# m
" v5 R: Z5 Z) C1 n% J请问这个Function(S)和SIGNAL_MODEL是指的什么属性?* X5 F) `6 V& @( X
先就这么多了。希望哪位兄弟能尽快帮我解决一下。
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 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:. U/ `9 x, I! z4 C/ L9 Q$ y
我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?% K1 f: b* h; X2 K8 ~
如附件:- k1 t* y+ K) T: Y( u( [

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发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,
5 g- g" t  R- X  传个给我好吗!  @ 谢谢啊!@  3 ]6 _! X8 o# ]2 E+ k5 Y
. {7 q; w' r7 p& f& j: B) V
我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng
- @  j7 q- b! N  y* Y+ s. U/ [' I2 ]  ^. G

6 ]* Q2 k  _1 \9 ~开防焊是不是为了用此via做测试点啊?

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发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下8 \5 @2 Z# ?' a6 X$ b' q0 g: v, Q
论坛里有比较好的教程的

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发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。
0 E* B: Y7 k/ W* ?( w只能说:你多加油吧,多加班吧!!!
MENTOR奋斗中!!!!
GOOD GOOD STUDY,DAY DAY UP

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 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?
! x5 A. Y; P# A; e9 i
5 `5 j% ?0 Z* A7 i: V  \! t5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过...
9 M3 `+ b' G" k2 S# B; s4 C前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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 楼主| 发表于 2009-7-31 08:49 | 只看该作者
6## }0 p- q( R# P8 ?0 _( y0 M% |
  H# W) N$ z2 r0 x: ]/ B
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
: d2 f( R/ a3 X论坛里有比较好的教程的.+ h7 K2 U! }# E$ q

, S- j3 ~5 x" H, Z0 `4 j这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑
3 M0 Z$ o* Q, I3 v; _& N# U# J2 _. t3 A* \  ]
8# caiyongsheng . U5 P3 l  ]/ d' m% k" O0 Y" {

$ I1 a2 f( Q6 a8 M4 }& R2 p過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。
: P% t7 D! E7 L( S* e7 HNo_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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