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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 请教 关于数字信号延迟和逻辑门
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请教 关于数字信号延迟和逻辑门

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cloudy19880824

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发表于 2017-6-16 16:25 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位好，
: {, z$ ]3 @+ T% q' ?每当遇到一些拿不准的问题，就习惯性的发到这里和大家探讨一下：
3 Z' Y0 T. g# W  M3 A我现在有一个脉宽只有2ns的脉冲，要把它反向，常规的非门输入到输出的延迟就有2.8ns以上，请问这种情况还能用非门给这个2ns的脉冲做反向吗？非门会把上升沿和下降沿都延迟2.8ns还是可能会探测不到这么窄的脉冲？非门的型号暂时定为SN74ALVC04。
+ D- ?& B, {. J- J* m$ a
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江门彦祖

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发表于 2017-6-17 16:56 | 只看该作者
坐等高手解释

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dqwuf2008

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发表于 2017-6-19 09:44 | 只看该作者
我觉得跟延迟没关系，会不会把2NS信号吃掉得看芯片处理信号频率的最大值

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hefuzhang

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发表于 2017-6-19 23:50 | 只看该作者
楼主可以考虑考虑告诉运放，通过高速运放反向

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cloudy19880824
嗯，是个办法，谢啦  详情 回复 发表于 2017-6-23 11:08

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超級狗

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发表于 2017-6-20 22:33 | 只看该作者
樓主這個疑慮是應該存在的。多年前一位同事用 74HC04 設計一個 66MHz 有源晶振電路，結果根本不會動作。6 s; A$ B) U7 m$ Y4 W

8 k3 N- [1 l. Q# g, D+ t6 ^/ J% D/ U2 V! D後來發現傳統 CMOS 邏輯閘的延遲時間約為 25ns，換算成頻率只到 40MHz，改成 74AHC04 就會動了。# L0 t" k8 p( _0 q- z* c8 v
5 Z9 V; B3 n7 A' n& V) ^/ u8 ?2 l8 T

( R1 ]/ H. {+ B6 d6 V: G
哈士奇是一種連主人都咬的爛狗！

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超級狗

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发表于 2017-6-20 22:56 | 只看该作者
啊哈～9 a. V2 c# y* S4 B: `

3 n) `' d* z% q$ t) K" F4 x9 sECL 2-Input Differential XOR/NXOR Gate MC10EP08-D
0 y3 n2 J3 G0 R; P: f
/ C9 S0 U. U& R# ~  ], l不過你的訊號源要怎麼搞成這樣咧～？？？( Y+ j' l( c/ G- g
: ^6 O7 s) b4 D  v9 B, a
+ t4 l* [7 L- f$ `
& _5 S* E) y' `$ I

MC10EP08-D.PDF

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发表于 2017-6-20 23:10 | 只看该作者
開卷有益; |  ]5 Z- v+ G$ q% x2 w, B
4 c0 v8 h  `8 t# R" k- [# V

5 N; \3 {: O. y

AN1002.pdf

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超級狗

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8#
发表于 2017-6-21 23:02 | 只看该作者
ECL Logic Gate 有 Single-End 的啦！
% C; _: H+ q0 {5 z# G3 K( l) L1 q! w- F9 t% r2 U

MC10EP01-D.pdf

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cloudy19880824
太感谢版主的支持了！我把板上留个选项试一下  详情 回复 发表于 2017-6-23 11:08
哈士奇是一種連主人都咬的爛狗！

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cloudy19880824

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 楼主| 发表于 2017-6-23 11:08 | 只看该作者
超級狗 发表于 2017-6-21 23:028 S6 e6 D' e6 T9 F' M) i
ECL Logic Gate 有 Single-End 的啦！
( v; _; D) l5 o
太感谢版主的支持了！我把板上留个选项试一下
5 C. m9 G2 O- r* M( B

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cloudy19880824

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 楼主| 发表于 2017-6-23 11:08 | 只看该作者
hefuzhang 发表于 2017-6-19 23:50
+ L; v0 q4 V6 I1 o& [; a楼主可以考虑考虑告诉运放，通过高速运放反向
0 p7 T3 l/ P1 J& K- J7 d1 d
嗯，是个办法，谢啦) E0 ]! q( V& A2 a" e

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duzz

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发表于 2017-7-4 16:23 | 只看该作者
狗版主的狗粮，一撒一大把啊

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