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allegro 生成测试点没有自带丝印外面的白圈圈

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发表于 2015-11-23 16:50 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如题,怎么能在生成测试点的时候自带白圈圈呢,没有白圈看起来很怪啊& [( ~4 Q; j+ u+ K$ i

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发表于 2015-11-23 17:14 | 只看该作者
这个测试点不是在这里生成的
/ Z4 p. \% B" o( l" \5 P5 Y是做成封装元件,网表导入的

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我知道,只是我比较喜欢这种通过系统增加的方式,能不能搞成和做成封装一样的效果  详情 回复 发表于 2015-11-23 19:57

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发表于 2015-11-23 17:14 | 只看该作者
白圈圈是TP的丝印吧,如果是丝印,增加封装的丝印,然后调进来就有了。

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可是我现在使用的方式是pad的形式,增加不了丝印层  详情 回复 发表于 2015-11-23 19:58

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 楼主| 发表于 2015-11-23 19:57 | 只看该作者
5718366 发表于 2015-11-23 17:14/ |3 V8 t& j& O" M/ m* N' S/ t- _' c
这个测试点不是在这里生成的/ M( p0 {$ A$ ~2 Z
是做成封装元件,网表导入的

' ^! ~1 U, k' P# J, `% O( m# {" i我知道,只是我比较喜欢这种通过系统增加的方式,能不能搞成和做成封装一样的效果
0 m8 w& m; r7 H2 @  F4 ~% x1 E- H. q6 L; I" m* Y  r

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 楼主| 发表于 2015-11-23 19:58 | 只看该作者
我lay个去 发表于 2015-11-23 17:14
/ a6 t* Q& J! t' `白圈圈是TP的丝印吧,如果是丝印,增加封装的丝印,然后调进来就有了。
% G) D" X" c7 ~7 t$ i
可是我现在使用的方式是pad的形式,增加不了丝印层) s1 l. [% S& C( _

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发表于 2015-11-24 08:41 | 只看该作者
在PCB里加也行啊

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怎么加  详情 回复 发表于 2015-11-24 09:44

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 楼主| 发表于 2015-11-24 09:44 | 只看该作者
hh3020 发表于 2015-11-24 08:41
$ X9 q4 M7 g7 x) b/ Y在PCB里加也行啊

8 x# g; F. g6 T" @怎么加5 U- Z9 a1 e3 w5 {. F4 B+ m7 ?( Z; X
9 A4 M2 y0 t* s7 j0 {5 _6 x

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发表于 2015-11-24 09:55 | 只看该作者
在每个测点上手动去加丝印啊

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发表于 2015-11-25 13:42 | 只看该作者
打via加的测试点就是个via  你觉得板子上的via都有圈圈会不会很奇怪

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发表于 2015-11-26 09:24 | 只看该作者
这个功能一般都很少用的
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