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本帖最后由 w5555456 于 2014-8-2 22:32 编辑
- s' ?5 j* ]+ [- J2 F" N$ s0 D* \' c0 L% K& l
描述:
- e9 K! H4 l" |& B 1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。
) l2 f" I* R2 L" j 2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。
+ q5 K" R$ w! t* n: j6 c 3、时钟线从TOP换到Mid1,阻抗100欧。+ c K$ |6 s6 x
4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。
% W+ N) A6 B2 k% n, l' [ 5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。( |" [& O- @1 x# T
6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。% Q" M8 G. Z; c2 e
7、所用软件,Altium Designer 10.0" T6 T1 ] L) f+ J
1 M/ @9 V$ V: B
PS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?
3 h( D2 a+ @0 l, P) D# Y4 r. `) l! s! z
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