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ARM+DDR六层PCB,附件是原图,请高手前来指点!!

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发表于 2014-8-2 22:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 w5555456 于 2014-8-2 22:32 编辑
- s' ?5 j* ]+ [- J2 F" N$ s0 D* \' c0 L% K& l
描述:
- e9 K! H4 l" |& B        1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。
) l2 f" I* R2 L" j        2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。
+ q5 K" R$ w! t* n: j6 c        3、时钟线从TOP换到Mid1,阻抗100欧。+ c  K$ |6 s6 x
        4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。
% W+ N) A6 B2 k% n, l' [        5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。( |" [& O- @1 x# T
        6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。% Q" M8 G. Z; c2 e
        7、所用软件,Altium Designer 10.0
" T6 T1 ]  L) f+ J
1 M/ @9 V$ V: B
PS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?
3 h( D2 a+ @0 l, P
) D# Y4 r. `) l! s! z

! y0 W' A5 ]! J$ ?$ v3 i0 |热烈欢迎各路高手前来指导!谢谢!!!

DDR_XXX.zip

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 楼主| 发表于 2014-8-18 21:40 | 只看该作者
本帖最后由 w5555456 于 2014-8-18 21:42 编辑 ! \% u' e) w- g9 w% f) [! m+ ?) P
kangguolong 发表于 2014-8-18 16:480 J( G! [* s2 S0 \
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需 ...
& `/ V: L; O! |& k7 v  N( G' H

# ~3 H2 H9 S. k. N. [  C8 K* _8 M3 ]6 H: v非常感谢这位兄台的点评!
4 E2 G, B6 \' R1、盲埋孔已经去掉了,直接6层的通孔,勉强画出来了,不过电源走的不大好(用盲孔的话总成本会增加大概60%的样子,而且制作难度大了很多)。8 u- z  Y- P; @, s+ A" u
2、差分时钟线绕成了下图所示:' h: G- O, {3 _/ }) L+ `
  C; B/ P2 a, ~/ g# l
3、差分阻抗控制100欧左右,3.5/9.5mil。据我的了解,差分对紧密耦合是为了提高抗干扰能力,如果太过紧密,两根线之间的相互耦合会对信号边沿产生影响,所以选了这个间距。某些芯片厂商的Layout Guide也建议间距不要过小。
1 w5 ~5 j6 ~/ ~& r- y0 X+ x4、数据线我基本都走在了Midlayer1,我用的1W原则,3W空间不够。# c1 y& \9 |; b$ [! @
. B* y& u# Y. q: U8 z

8 o& `% i1 R  m9 _' q' C) Y
: N% E8 J+ L( t4 a. V$ |5 W$ j+ h# T' k
! B8 q" n/ z$ y5 r" ?% Z- R7 \; T

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 楼主| 发表于 2014-8-18 21:24 | 只看该作者
本帖最后由 w5555456 于 2014-8-19 21:45 编辑 . x  _/ O4 P/ m
zgq800712 发表于 2014-8-17 11:16
* n; x: T8 }+ G这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm5 |# Z/ M: s1 c5 I8 m
: Q2 A: x. c/ }
这个板子要什么工艺?打样贵吗?

  {# W1 J% @8 t
. Q6 c, T' {% j, z3 K! `! B8 D一般的工艺就能做出来,6mil的孔是可以不用激光打的。# r1 J" R. S* a5 D
今天刚投的板,大概240*180的板子,六层,打样3000左右,五块。
8 u  j! B! O  N在深圳迅捷兴做的,有需要我给你他们销售的联系方式。

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发表于 2014-8-18 16:48 | 只看该作者
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需要调整,不知道差分有没有做阻抗控制,差分线间距过大!另外数据线每一组走线应该遵循同组同层的走法,线 与 线的部分区域间距还是不够3W!还有一些其它的小问题,还需优化。

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 楼主| 发表于 2014-8-4 21:24 | 只看该作者
帖子都好几天了,各路好汉都去哪了???:Q:Q

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发表于 2014-8-5 13:19 | 只看该作者
打开了,看不到东西
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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 楼主| 发表于 2014-8-5 21:52 | 只看该作者
zgq800712 发表于 2014-8-5 13:19
' J/ p' c0 z7 V% Y打开了,看不到东西
1 a! V7 M5 R2 D6 m' `6 k& M
我的软件版本是AD10.0,应该09及以上的打开都没有问题。- S, u4 P/ v9 R' P2 P4 _
试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-5 23:36 | 只看该作者
多AD14了
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发表于 2014-8-6 08:46 | 只看该作者
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

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 楼主| 发表于 2014-8-7 22:50 | 只看该作者
沙漠风铃 发表于 2014-8-6 08:46. p' B8 x' x/ c
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

% W/ |& I- h# K& e1 a呃,,多谢这位仁兄!4 u8 d; ^! `: p: W* g  c- ]6 U( V
话说我这板子有没有致命的地方?或者亟需改进的?

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发表于 2014-8-11 22:01 | 只看该作者
打开了,看不到东西

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 楼主| 发表于 2014-8-12 23:23 | 只看该作者
ROBERTZHANG 发表于 2014-8-11 22:01
( X8 W6 M" {; g4 N: t( A7 u打开了,看不到东西

4 O6 U! D) I% Z# R4 \; _/ O% r: Z  X我的软件版本是AD10.04 m/ l% ^' J2 j
试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-17 11:16 | 只看该作者
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm
1 V  b7 w! m) b+ F; s: @, u0 j5 a" [; j" ]0 }' ]+ T
这个板子要什么工艺?打样贵吗?
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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发表于 2014-8-17 21:35 | 只看该作者
AD的文件就不去看了

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发表于 2014-8-18 09:28 | 只看该作者
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

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 楼主| 发表于 2014-8-18 21:26 | 只看该作者
hb_ben 发表于 2014-8-18 09:28. D/ K4 J3 w( D
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

9 Q% C/ P" V! H没办法啊,BGA下面的焊盘间距20mil,焊盘占掉了10mil........
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