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16.6生成net 出错,请大侠看看原因,是否破解不完全》

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发表于 2013-3-19 22:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

$ V5 R' Y/ f( L8 {" S- N$ ?#464 ERROR(ORCAP-36022): Pin number missing from Pin "1" of Package L0402 , L1405: M9871_MAINBOARD_P1_0012, E DIGITAL AP (12.70, 4.60). All pins should be numbered.
% d  `) N, K' v/ z( J% N#465 ERROR(ORCAP-36022): Pin number missing from Pin "2" of Package L0402 , L1405: M9871_MAINBOARD_P1_0012, E DIGITAL AP (12.70, 4.60). All pins should be numbered.
4 ~9 e* x' ]  S#466 INFO(ORCAP-36107):  PCB Editor does not s8 d" s  Y8 A5 v$ o" \" [2 E
upport Dots(.), Forward Slash(/) and White space in footprint names. The supported characters include Alphabets, Numerics, Underscore(_) and Hyphen(-).
+ j% |  ~0 w  o9 B
, q5 u/ ^5 y4 `$ L#467 ERROR(ORCAP-36018): Aborting Netlisting... Please correct the above errors and retry.- c" [2 L1 E: v' @- G4 ?

% a( e0 d& U" N$ e& HExiting... "D:\cadence\SPB_16.6\tools\capture\pstswp.exe" -pst -d "E:\ALLEGRO\WORK\DSN\MTKDVB\MTKDVB.DSN" -n "E:\ALLEGRO\WORK\DSN\MTKDVB\allegro" -c "d:\Cadence\SPB_16.6\tools/capture/allegro.cfg" -v 3   -l 31 -s "" -j "PCB Footprint" -hpath "HPathForCollision", r; N5 V. A5 @+ g! Y* j# V
INFO(ORCAP-32005): *** Done ***
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 楼主| 发表于 2013-3-19 22:14 | 只看该作者
即使用自带的sample生成net也是报错。。
* r" i4 q4 `" o3 I5 _. j

error.png (183.15 KB, 下载次数: 4)

error.png

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 楼主| 发表于 2013-3-19 22:15 | 只看该作者
win7 64位系统。。

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"學會了" 就簡單了.

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发表于 2013-3-20 20:55 | 只看该作者
#464 ERROR(ORCAP-36022): Pin number missing from Pin "1" of Package L0402 , L1405: M9871_MAINBOARD_P1_0012, E DIGITAL AP (12.70, 4.60). All pins should be numbered.
2 A2 `& T8 U9 h#464 ERROR(ORCAP-36022)IN遺失踪引脚“1”的包装L0402,L1405:M9871_MAINBOARD_P1_0012,E DIGITAL AP(12.70,4.60)。所有的引脚编号。
5 G) F5 j; e; l3 b+ r' X5 j+ Y.
: h6 ?9 k5 k6 J4 U8 G.
3 l$ C0 W- T; m7 x, }# E$ S.
, h4 E2 ~# l% z$ B/ ?1 n#466 INFO(ORCAP-36107):  PCB Editor does not support Dots(.), Forward Slash(/) and White space in footprint names.
; Q5 _$ u$ O4 x" M6 H#466 INFO(ORCAP-36107):  PCB 编辑器不支持点(.),正斜杠(/)和空白字符,在引脚的名字上。
& T+ k0 L: v( }& ]+ p4 B9 F' n( y.( D' t& u. G8 d3 H) O. g
.
* o5 L$ e, \, H" ^" A+ E( r.  C" R% D+ f( x$ V

6 a: r8 G( ?, K8 S3 P0 X是不是你的元件的引脚命名有問題?好好檢查一下。

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 楼主| 发表于 2013-3-20 22:03 | 只看该作者
是管脚number没有定义,我就奇怪,16.6自带的demo原理图也会不定义pin number?

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EDA365特邀版主

"學會了" 就簡單了.

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发表于 2013-3-21 07:56 | 只看该作者
你是看哪個自帶的DEMO原理圖 ? 我也來試試,看看會不會發生問題。

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 楼主| 发表于 2013-3-21 20:41 | 只看该作者
这个路径下面的demo   X :\cadence\SPB_16.6\tools\capture\samples

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发表于 2013-3-22 17:43 | 只看该作者
最近也遇到了两次导网表出错的问题,尼玛检查了N次,都没检查出问题,) b* o( W' R4 u+ Q! T
开始觉得可能是软件的问题,换了电脑换了软件版本都不行,* J9 T; f5 s- Z* I  I, O
最后实在没办法了,试着把图拷到一个新建的原理图,竟然搞定了。
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