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前几天看了一个ddr的pcb布线,感觉很不规范,不过居然是厂家推荐的

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发表于 2008-6-4 10:22 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1 没有匹配4 j( z( q9 e! U) ?1 G  |- ?
2 没有严格差分
0 p  N' j4 x) a. Z( q3 没有严格等长,没有蛇形线。+ e2 d& A5 z/ B* C8 E
4 菊花链拓扑: l) a4 ]1 v4 \5 r2 k6 \( p; ~
6 s* }6 I: l/ @6 c' g, y
还是处理器的厂家给的参考布线,大家讨论一下,这也行吗?
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发表于 2008-6-4 12:06 | 只看该作者
不能说绝对不行,要根据具体情况看影响到什么程度。+ n' c/ Q9 H% Q, r' S* I1 S3 d
比如没有匹配,那阻抗失配到什么程度?足以影响信号质量?没有严格等长,那相差到什么程度?相差1000mil,2000mil?8 D6 i# Z0 w' P3 `+ {7 ?
平时遵守的规范是追求完美的规范,是个通用规则,可以适用于绝大多数的设计。我们遵守这个规范,就能保证大多数设计不出问题。
7 g: z% D1 P1 {6 i4 E3 R如果你是高手,可以不全部遵守规范,可以按照“够用就好”的原则来设计,比如等长线,你很有把握或很有经验确定误差200mil没有问题,那你完全可以按照200mil的公差设计,这样就比有些设计中误差严格控制在20mil或50mil省时省力得多。但对于新手,还是尽量遵守设计规范,保持一个良好的设计习惯更为重要。

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发表于 2008-6-4 18:34 | 只看该作者
原帖由 steven 于 2008-6-4 12:06 发表 5 `" k5 L9 T( Q5 @# a" ], y% C4 w
不能说绝对不行,要根据具体情况看影响到什么程度。' E3 e, f  _) ?8 n* A# d
比如没有匹配,那阻抗失配到什么程度?足以影响信号质量?没有严格等长,那相差到什么程度?相差1000mil,2000mil?$ v. H# b- A( Q) y4 l6 b1 ?
平时遵守的规范是追求完美的规范,是个通用 ...
说的非常好

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发表于 2008-6-5 10:41 | 只看该作者
有道理

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发表于 2008-6-6 13:47 | 只看该作者
不要被所谓规范束缚你,但你要知道他们是怎么来的,自然你就会有你自己规范了。

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发表于 2008-6-6 16:00 | 只看该作者
不是說得好﹐而是說得在理吧了
: r1 P; _5 D3 h  k2 M達到要求即可﹐應該理解為在一般情況下能成為QA的PASS品。但在環境惡劣的條件下呢﹐也許就不行了
- f& J0 [1 _" v# y' m* @就比如說電腦主板﹐一線大廠和二線大廠的區別﹐相信在資金允許下你肯定買一線的(不要說是買品牌﹐品牌也是靠實力來的)﹐不是二線廠不是不想做好﹐而是技朮跟不上
) l1 k1 h, W5 b4 A+ R5 k' D% }但是你有機會﹐就一定要做最好的﹗(在EMC理論指導下工作﹐當然也有經驗)

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发表于 2008-6-10 20:46 | 只看该作者
louzhu讲的好,繁体字看着怪怪的,台湾公司吧

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发表于 2008-6-11 14:00 | 只看该作者
我觉得是那样的,能用就好,有时规范多了,真把人搞晕啊,( V0 j0 A  J- `
性能OK,生产方便,成本低,老板高兴了.........

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发表于 2008-6-12 13:08 | 只看该作者

做产品也难啊!

产品不光性能好, 还要便宜! 你要想到客户可不是冲着你的功能 性能来的. 做生意要的都是利润!!$ ~' {: ^' {* L0 ~4 J
现在降成本,  能省则省! 经常把DDR匹配都去掉了 等长也只做关键几根! 华为给武汉的一款产品也是这样的!

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发表于 2008-6-13 10:28 | 只看该作者
原帖由 frankyon 于 2008-6-12 13:08 发表 2 i4 M( x/ h8 u8 k2 ~7 |3 E
产品不光性能好, 还要便宜! 你要想到客户可不是冲着你的功能 性能来的. 做生意要的都是利润!!
* \' Z+ k. Q) Q- H& a9 y现在降成本,  能省则省! 经常把DDR匹配都去掉了 等长也只做关键几根! 华为给武汉的一款产品也是这样的!
9 w! Z7 \% T1 A/ H6 l4 `2 `

) q& h: X1 K: L4 b: V! f成本和等长有什么关系?为了省几个匹配电阻的钱?也可用等长把匹配电阻做掉,但不意味着不做等长阿。

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发表于 2008-6-25 07:20 | 只看该作者
I think it depends on how fast the ddr is supposed to run - more matching means higher speed supported.

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steven + 5 I agree with you

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发表于 2008-6-26 13:11 | 只看该作者

弱问一下大家对DDR线的包地怎么处理的?

一般的数据和地址线一般多少根包地线呢?5 Y0 I6 I/ W4 o9 l6 M) v( f9 ]
四层板还好点 两层板很难处理哦!

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发表于 2008-9-14 20:17 | 只看该作者
最新的技术XDR是不需要match length的  因为它使用了Data和add的复用 lz最好看一下你的工作频率

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发表于 2008-9-16 16:03 | 只看该作者
感觉大家都有一个误区,那就是PCB上走线严格等长,但是这样做真的好么?为什么要这样做呢?

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发表于 2008-9-16 16:08 | 只看该作者
实际严格等长是指驱动端到接收端完全等长,但是这段长度不仅仅包括PCB上的走线,还包括SUBSTEATE和IC里边的走线长度,所以说如果参考设计中出现不完全等长的走线,请务必先确认是不是这种情况.
/ w  M& z8 ~! a当然也会有时序许可的情况下的不等长走线.9 Z9 k; V- T0 m/ ?% l
情况有很多种不能一棒子都打死!
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