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刚学allegro,问几个比较低能的问题.....以后连载

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发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
小弟刚学Allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !% q; C+ e0 s' I+ J' e( c
1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。
, K3 H/ Q$ B9 ~" G2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。
( X) I, S. Y" A( H9 j) w3.今天学习Allegro遇到的几个问题:
) |2 F6 W2 b; [: r& s   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:7 `3 I) @* j" a# Y  h1 r( V* Q
# N, C: i6 @3 F
2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?5 l0 x. `- I/ y
  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?+ N7 Q+ ~6 [- H- C4 o" y
3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:
* e' J; ]; z7 `5 Y    LISTING: 1 element(s)
. Q6 u/ d- w9 [5 q$ E) F0 Z7 W# ?( ]
       < COMPONENT INSTANCE >      
" k1 ^8 n; s0 i1 W2 b% o& s
" A2 f1 S. }- O5 t  Reference Designator: U7: `! P9 K7 G* M8 g! z6 j
  Package Symbol:       PBGA400' i* M8 I: A9 g- @6 p
" D# `) z' R% E! D# Y0 m
  Component Class:      DISCRETE; L* l7 X1 L! t/ C# b* z
  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB
) u# J& S, g# v* M! C* y    Value:              KSZ9692PB
$ L8 ~! \3 d2 v/ w% e- P2 C2 ?" i( A& `. C% |: x5 g4 {
  Placement Status:     PLACED, c$ l% P8 }% T! u+ ~8 R% G
    origin-xy:    (5150.000 4512.500) 0 y3 \& v* o: Q0 j( n
    rotation:  0.000  degrees
$ X7 F/ A! s$ A1 n& H; ^! h    not_mirrored
  E. U/ N4 ?$ D+ ~" U* l7 x
" c3 t1 t( F' N- b& I  Function(s):
6 ~$ ~. E: J  J1 p7 t7 e    Designator: F114 i  U7 w. d% G# x" m! }- A
    Type:       TYPE48 l; y9 I0 m8 r+ H, W( A
    Pin(s):     C10, E10, A7, A6, A8...
4 \( s( @" X6 u
9 G2 l. h4 p% T6 [$ b    Designator: F10; M$ f/ D) F& s: h1 \9 r* k
    Type:       TYPE3
$ n; b5 o( E0 g    Pin(s):     V16, Y18, T16, U17, V18...
( D4 N: v+ a! `- A$ [, C8 R! E2 s- Z* p
    Designator: F9
1 Y/ `' b1 x; h/ K1 o' H    Type:       TYPE2% J* r3 G9 w- C5 n- Y
    Pin(s):     H10, H11, H7, H8, H9...
" u' @% H6 l2 ~' `4 ^# P0 t! ^, g3 n3 q8 P
    Designator: F88 @5 h" s  I4 n+ ~6 L8 W! U
    Type:       TYPE1
9 N) n+ b0 ?8 c8 y  z2 K7 s+ A    Pin(s):     H19, H18, H17, P20, M17...
7 _7 `8 A. K8 @9 P8 y2 l$ V
% C+ y5 p' E8 q0 o  x  Properties attached to component instance
8 g; l6 S& k$ F7 G" e- d; A8 @/ ]    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB& {, c& v# ]% V& T% A& s

& ]0 ]0 X; e4 b" x' J# S  Properties attached to component definition
* ]0 ]8 u+ M% a% k+ F% T# L    VALUE             = KSZ9692PB4 I5 B  X5 @+ g6 G
: {0 b  V( k% Z" t
请问这个Function(S)和SIGNAL_MODEL是指的什么属性?+ @! t, R: \$ J& |0 f
先就这么多了。希望哪位兄弟能尽快帮我解决一下。
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 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:$ C+ ~/ d9 F$ m& z( E  l; H, A+ }* O
我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?
8 G! X) D& b) z- ]如附件:
5 _1 f; ]- R# }7 t: |/ T

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发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,# B0 L2 x, P; w: r5 E
  传个给我好吗!  @ 谢谢啊!@  
3 w$ i# A1 K, |; T+ S; S
" e$ ^5 i8 o( {  Z. X+ D  H0 l我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng
0 `" Q+ \' U; q' u# f# C
' J3 k8 B( C4 t# l$ t! l9 J0 A1 e' r' L1 a( R) K0 ^
开防焊是不是为了用此via做测试点啊?

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发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
+ X0 G5 u' i8 \论坛里有比较好的教程的

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发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。2 E, ?1 T& t& {) ?/ a6 C* U
只能说:你多加油吧,多加班吧!!!
MENTOR奋斗中!!!!
GOOD GOOD STUDY,DAY DAY UP

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 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?8 X' A1 ?  e" ]7 A  V- `# k/ y

, D. H' x0 D8 b% m: k- p% f5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过..., |7 X# q, s" i5 V; ]$ E+ ]- g
前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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 楼主| 发表于 2009-7-31 08:49 | 只看该作者
6#
* C' h* K) U4 j$ r3 C5 z; a" P2 c& ^6 f0 a' c4 \; Z
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
" d2 r: A. Z$ F; w3 Q; j4 i; \/ R论坛里有比较好的教程的.
! \& T& l6 s, @
/ j6 }/ X) k0 D6 c: `$ \这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑
8 U; u: T5 U, Z, {, C
$ c2 Q. C: u5 k4 M  G9 G6 z8# caiyongsheng
7 K6 z9 a8 {: c& g, i& {( }8 S9 d  D- S* k8 Q. |+ u! q
過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。
6 i! G9 T0 \" b$ N9 kNo_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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