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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 请教 关于数字信号延迟和逻辑门
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请教 关于数字信号延迟和逻辑门

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cloudy19880824

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发表于 2017-6-16 16:25 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位好，6 j7 x! Y( b) i: l9 i
每当遇到一些拿不准的问题，就习惯性的发到这里和大家探讨一下：* O% a' ^7 S7 `5 c6 t+ y
我现在有一个脉宽只有2ns的脉冲，要把它反向，常规的非门输入到输出的延迟就有2.8ns以上，请问这种情况还能用非门给这个2ns的脉冲做反向吗？非门会把上升沿和下降沿都延迟2.8ns还是可能会探测不到这么窄的脉冲？非门的型号暂时定为SN74ALVC04。! U& F; G0 `% j
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江门彦祖

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发表于 2017-6-17 16:56 | 只看该作者
坐等高手解释

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dqwuf2008

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发表于 2017-6-19 09:44 | 只看该作者
我觉得跟延迟没关系，会不会把2NS信号吃掉得看芯片处理信号频率的最大值

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hefuzhang

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发表于 2017-6-19 23:50 | 只看该作者
楼主可以考虑考虑告诉运放，通过高速运放反向

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cloudy19880824
嗯，是个办法，谢啦  详情 回复 发表于 2017-6-23 11:08

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超級狗

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发表于 2017-6-20 22:33 | 只看该作者
樓主這個疑慮是應該存在的。多年前一位同事用 74HC04 設計一個 66MHz 有源晶振電路，結果根本不會動作。3 F5 q5 L2 D, k
+ G/ X# O  I% w+ L- ~
後來發現傳統 CMOS 邏輯閘的延遲時間約為 25ns，換算成頻率只到 40MHz，改成 74AHC04 就會動了。; h* j& R5 q0 Y9 T, d

& w; U+ z- z) ~4 I$ E. M/ w8 ^5 c! \& k) J8 d/ d
哈士奇是一種連主人都咬的爛狗！

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超級狗

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发表于 2017-6-20 22:56 | 只看该作者
啊哈～- Q  a# F" H+ G, ]: W
* j" |3 G( _$ h1 `4 n3 }4 N# F
ECL 2-Input Differential XOR/NXOR Gate MC10EP08-D
$ R8 W" ]  ~/ y0 H1 T+ N: e2 \9 x7 h+ F, \7 G
不過你的訊號源要怎麼搞成這樣咧～？？？
4 J& j# J5 q2 i% q0 ]: c* F% I: u8 t1 H

6 L* r4 p% Q3 f
; R6 }8 u8 g+ z

MC10EP08-D.PDF

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哈士奇是一種連主人都咬的爛狗！

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超級狗

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发表于 2017-6-20 23:10 | 只看该作者
開卷有益( t1 u$ L" n- ~- ^9 N( |

9 N7 V2 \6 o' n# f. w; d% ?( n' J  k7 A" p

AN1002.pdf

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AN1672-D.PDF

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超級狗

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发表于 2017-6-21 23:02 | 只看该作者
ECL Logic Gate 有 Single-End 的啦！0 E: u6 m4 L2 Z( f
6 M8 v- n$ v) s; h- z- w

MC10EP01-D.pdf

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cloudy19880824
太感谢版主的支持了！我把板上留个选项试一下  详情 回复 发表于 2017-6-23 11:08
哈士奇是一種連主人都咬的爛狗！

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cloudy19880824

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 楼主| 发表于 2017-6-23 11:08 | 只看该作者
超級狗 发表于 2017-6-21 23:020 {! o7 A( ^6 E3 A3 z" r3 U
ECL Logic Gate 有 Single-End 的啦！
* I% ~4 u1 W1 T. H$ `2 ~
太感谢版主的支持了！我把板上留个选项试一下, r+ g/ M/ \, H

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cloudy19880824

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 楼主| 发表于 2017-6-23 11:08 | 只看该作者
hefuzhang 发表于 2017-6-19 23:50% m  U" W; ^  @* s
楼主可以考虑考虑告诉运放，通过高速运放反向

. G& E+ v, {2 ]2 l嗯，是个办法，谢啦+ W; s1 v$ e+ V5 e

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duzz

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发表于 2017-7-4 16:23 | 只看该作者
狗版主的狗粮，一撒一大把啊

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