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刚学allegro,问几个比较低能的问题.....以后连载

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发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟刚学Allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !" _$ ?( \5 N! j$ d* O( r
1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。
  y4 g# m/ J% ~/ s" ~2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。
# c- K8 Y+ f5 ?* K- U* u3.今天学习Allegro遇到的几个问题:6 v- J4 Q  f$ S6 \- [7 A
   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:
4 s# {7 T% B4 H
( I$ x, E4 h" \3 H" }5 P4 I  k9 o2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?( z2 N1 J' j2 u1 T! P
  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?  @8 r! h4 Q, o
3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:
( }6 A0 W8 D# W0 ~- G$ B* {9 q/ \    LISTING: 1 element(s)
  q0 P& e: K2 }8 p
0 Y# V4 L4 k1 B3 y6 N       < COMPONENT INSTANCE >       ( X0 e5 {$ ^4 }! q1 |' h

1 `' r* H) v6 O3 C8 t' M/ }. _+ i  Reference Designator: U7
/ N) X9 m3 h3 ]  Package Symbol:       PBGA4003 U0 h/ H/ ^9 M. ^

2 s- K+ k. ~7 G0 R5 h  Component Class:      DISCRETE
) }0 x# J3 C) p  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB
) r9 W: d& U/ ^; r9 D* y    Value:              KSZ9692PB
6 B% [- R$ R7 e# C7 f8 ~8 }
+ t: [9 _; I' f  Placement Status:     PLACED7 p& \" P$ _1 t! C( Q
    origin-xy:    (5150.000 4512.500) 6 F$ ^  y& Z- [9 x; H
    rotation:  0.000  degrees
% J# c' ^6 X0 F& S, t2 n, V    not_mirrored
6 W$ Y* M3 H: S  \1 V- I8 t
1 e: C. D1 Y( |' ~% Y  Function(s):
, Y; T: H* L8 c% ?    Designator: F11
$ n3 Q$ g9 H2 C( v5 R0 C/ n# P1 U% O    Type:       TYPE4
5 d/ j8 }' T, H9 M4 l' z  y    Pin(s):     C10, E10, A7, A6, A8...$ ~& W5 N& Y& e9 O8 C% A0 X: U

+ u, e5 [; K4 z  v3 C1 r+ n    Designator: F10
0 Q4 y' i+ D% Y    Type:       TYPE3/ F8 R( g, A7 G2 J: U
    Pin(s):     V16, Y18, T16, U17, V18...
  x. z7 |$ g1 e9 d$ ?; r3 t5 l) c8 P+ [
    Designator: F9
( o# d) P) z1 C- J/ ~: I+ u8 m    Type:       TYPE2. A9 s1 }+ d' t6 _6 \+ m7 _
    Pin(s):     H10, H11, H7, H8, H9...+ L8 s9 F) w1 G7 d% B( ~' o0 |

& ~! G- {2 d9 O- D. L/ u    Designator: F8
. o# e8 N' a/ R& V8 M    Type:       TYPE1
& Z: `2 N; g6 R0 v. K    Pin(s):     H19, H18, H17, P20, M17...3 P. u% Z( E' Y5 n
) F5 Y' E; E- h% Y2 V
  Properties attached to component instance
* ?; Y8 `$ h# y# W- T& P  G( [$ o: K    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB
4 Z$ h0 Y/ z) Q9 A8 k5 r; Q
8 e2 Y5 R2 u# _2 S- ]' p' S; ~  Properties attached to component definition/ b# [9 n5 o( B$ d2 [
    VALUE             = KSZ9692PB( ?6 _8 z  j- U8 s4 e
1 X4 k9 H5 e! y" L3 w3 F
请问这个Function(S)和SIGNAL_MODEL是指的什么属性?' |) I3 c$ V" P5 Z* _) y& C3 [2 X
先就这么多了。希望哪位兄弟能尽快帮我解决一下。
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 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:
/ q; J- ^6 z8 C/ o4 }+ @! K3 \: t2 e我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?
5 w- P: L8 F* ^+ @- y如附件:* M2 e8 E* ~) l' R

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发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,
, U5 H, z# v2 v# z- h+ w  传个给我好吗!  @ 谢谢啊!@  & n1 d3 e5 q" n9 X5 R
: e1 r1 B5 Y( J' I/ F7 n( k
我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng ( J) V" u5 y$ _! i& b* Y& `* F1 ^- l7 g
: I4 L5 K* W! X& R, D- b9 ]0 A& S) S2 W

% k8 ?6 v$ I# e. f  W3 g开防焊是不是为了用此via做测试点啊?

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发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下$ G- I7 a7 Z' t4 F* h0 V0 d+ e
论坛里有比较好的教程的

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发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。
" D5 m/ i8 C4 O  t; T: n& H4 ~" O只能说:你多加油吧,多加班吧!!!
MENTOR奋斗中!!!!
GOOD GOOD STUDY,DAY DAY UP

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 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?
" f1 E' J# w# Y0 x! D  L# R
  J) @, e8 t. A# ]! F) u/ M5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过...
5 O! i. t+ J( m: F" w+ l+ w3 O前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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 楼主| 发表于 2009-7-31 08:49 | 只看该作者
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2 L( f* M# \9 z1 ]& W5 ^. S
) o% I' q( x. d; f建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下, I) t, B' r4 f9 N  I
论坛里有比较好的教程的.
/ J, [" Y& j) w5 N
, E! A% R1 ]4 J  a2 H这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑 5 u4 ^# s( k3 m* n; Q6 i5 k& q; _
5 p* }: ~  ?7 M) @0 q$ F( B
8# caiyongsheng # C2 d# ?$ j0 o- ~

2 `, W1 ~9 k& Y" f9 V8 ^  a過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。
6 s  K. R; F* B* u1 ANo_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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