原理图顶层设计问题

zhanweiming2014 · 发表于 2017-11-10 11:50

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设计电路时候，由顶层到下层结构，用到数据总线，编译时候发现出问题。
顶层设计用到了总线方式，下层需要注意什么吗？

wanghanq · 发表于 2017-11-16 17:07

仔细查看项目的项目参数中的选项

zhanweiming2014 · 发表于 2017-11-24 09:23

wanghanq 发表于 2017-11-16 17:07
# l: p5 t+ Z. n% j) ^' C& A仔细查看项目的项目参数中的选项

是一张顶层电路图里面出现几个相同总线网络，其它的没有出问题

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