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EDA365电子工程师网»技术社区 › 电子技术社区 › Altium Protel论坛 › 原理图顶层设计问题
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原理图顶层设计问题

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zhanweiming2014

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发表于 2017-11-10 11:50 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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设计电路时候，由顶层到下层结构，用到数据总线，编译时候发现出问题。7 a* j% V# u1 l
顶层设计用到了总线方式，下层需要注意什么吗？& d8 j- e) ?2 w8 p, H

顶层设计.jpg (70.63 KB, 下载次数: 0)

顶层设计.jpg
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wanghanq

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发表于 2017-11-16 17:07 | 只看该作者
仔细查看 项目 的项目参数中的选项

点评

zhanweiming2014
是一张顶层电路图里面出现几个相同总线网络，其它的没有出问题  详情 回复 发表于 2017-11-24 09:23
业余，多多指正指教。

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zhanweiming2014

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 楼主| 发表于 2017-11-24 09:23 | 只看该作者
wanghanq 发表于 2017-11-16 17:073 \5 u: v! N" t# W2 k
仔细查看 项目 的项目参数中的选项

  z( U, n4 x$ o, w) e: h是一张顶层电路图里面出现几个相同总线网络，其它的没有出问题
$ [3 o# i( N0 O  j0 ^' Q& P& D

无标题.jpg (41.41 KB, 下载次数: 0)

无标题.jpg

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