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LPDD3稳定性测试

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发表于 2016-2-22 11:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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要验证DDR的稳定性,请问应该是什么思路,要测试什么项目。求大神指导~
  _4 G( G3 o6 Y5 {4 |7 q7 q6 F
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发表于 2016-2-22 12:55 | 只看该作者
有两种方案:3 Q' h' [1 O/ W8 m9 r
1.买仪器厂商的compliance license完成测试而且可以产生完整报告。$ A& w' M; V/ J* Z" G. L. ?+ e" M8 `
2.看Jedec规范或者dram规格书,测试时序和信号质量要求。: p0 l( D' V+ S) y+ V% i! T6 ^8 z
# G1 \1 j9 B: ?2 r5 t2 [$ H

点评

谢谢版主解答,对于第二点,是不是Jedec规范上给出的参数都要用示波器量  详情 回复 发表于 2016-2-22 13:50
新年伊始,稳中求胜

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发表于 2016-2-22 13:02 | 只看该作者
再增加一个软件系统跑,看是否有丢包的情况产生

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 楼主| 发表于 2016-2-22 13:50 | 只看该作者
cousins 发表于 2016-2-22 12:55. T/ k% V( t2 Q; j
有两种方案:
; ^) I$ |! F9 }! o/ p/ M: X- I; y, Z1.买仪器厂商的compliance license完成测试而且可以产生完整报告。. m& ~2 z. O$ c7 g. m' [1 z$ l0 L, _
2.看Jedec规范或者dram ...
9 f+ d; R. A& b% ~3 N
谢谢版主解答,对于第二点,是不是Jedec规范上给出的参数都要用示波器量2 g" n( a$ D4 ^, n( `

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发表于 2016-2-23 09:53 | 只看该作者
是的
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发表于 2016-3-6 22:22 | 只看该作者
高低温+电压拉偏 对全部DDR容量进行fullload测试。应该包括读写全0,读写全1,随机数读写,5A读写。

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发表于 2016-3-10 09:03 | 只看该作者
除了量信号,还要跑stress测试。

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发表于 2016-4-6 11:46 | 只看该作者
都是大牛的回答

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发表于 2016-4-28 12:14 | 只看该作者
1,如果DRAM厂家愿意配合,让他们测试waveform,没必要把jedec规范上所有的项目都测完。
8 X4 W) R0 ]0 J2 y: }2,主芯片厂家一般也有相应的评估方法;
2 o/ S+ h" J9 M5 l7 U2 r/ S5 N2 H3,最基本也是最重要的,多拿些机器(10台以上),高低温煲机5天以上;
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