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xiongbindhu 发表于 2013-8-12 23:31 ( |" a8 [3 v: F5 `: D1 Y估计是你做的板子DDR2时序余量小,DDR2底层驱动应该可以调的。
part99 发表于 2013-8-13 00:12 % B; u9 i k: v. ?/ q% K主要看看CLK和DQS的时序余量
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aeran 发表于 2013-8-14 10:55 * B7 Z# ?6 H! V 您好,请问有什么手段可以证明是clk和DQS裕量不足引起的这个问题吗?
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aeran 发表于 2013-8-15 02:29 1 u4 q7 T* K) ]% Q 将CLK和DQS的时序余量加到最大,ddr可以工作到50°。% e. k" _, z3 u8 a9 ^2 w! N. t1 _ Q, } 看来不只是时间裕量问题,还有其他问题在里面。
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