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板子回来出现一个很奇怪的问题

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发表于 2013-6-26 12:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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板子回来发现一个很奇怪的问题,上电前没有短路,一上电3.3V就短路,摸不着头脑,哪位大家帮忙分析一下。板子的主芯片用的是TLTERA的一个低端FPGA,BGA484封装,目前还查不到原因,望各位大侠指点。
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发表于 2013-6-26 13:12 | 只看该作者
不上电前将吃3.3V电的后端断开,看是3.3V电源问题还是后端问题。

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发表于 2013-6-26 13:35 | 只看该作者
先把你的电源贴出来吧?你这样说等于是白问了。应该是你电源哪里接错了或者封装做错了!

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发表于 2013-6-26 13:57 | 只看该作者
有用胆电容吗?

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发表于 2013-6-26 14:27 | 只看该作者
一个一个模块的拆再一个一个的加上去,从面到点就找到了哪个地方出问题了

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发表于 2013-6-26 14:31 | 只看该作者
“一上电3.3V就短路”,那断电后还短路吗?如果还是短路的话 估计可能是哪个位置烧掉了,那就一路路找吧,如果不短路了,那可以检查下你FPGA程序有没有逻辑错误呢

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发表于 2013-6-26 14:55 | 只看该作者
本帖最后由 超級狗 于 2013-6-26 16:40 编辑 ! u7 P# ?- x) E, y, X: Q8 j

  f* |7 K; q4 x' F4 M) h6 ?' l有可能是 I/O 衝突(I/O Conflict),沒接電前 High-Z,接電後 I/O = Low,但接到一個電源或是為 High 的 I/O,電源就被拉到地了。
' j0 E/ l  D. Z$ I+ }# R
' e( C4 c8 m: W4 Q; y+ ~或是反過來;沒接電前 High-Z,接電後 I/O = High,但接到一個地或是為 Low  的 I/O,電源就被拉到地了。( i2 ~" L5 Y" i

- C- o% E' O& m6 J  ^8 J) x/ s4 ]  ?9 y' c; z( T: x& [
{:soso_e136:}
哈士奇是一種連主人都咬的爛狗!

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 楼主| 发表于 2013-6-26 15:57 | 只看该作者
超級狗 发表于 2013-6-26 14:55 : T. D2 \" n2 |+ h, e
有可能是 I/O 衝突(I/O Conflict),沒接電前 High-Z,接電後 I/O = Low,但接到一個電源或是為 High 的 I ...
8 y; a5 e  i! E3 L3 Z  V. f) V
电源是这样的,12V输入经过DCDC变为5V,再由LDO变为3.3V,现在实验是拿掉LDO就不会短路,接上LDO就会。把LDO拿掉,直接从稳压源供电3.3V,设置过流保护,还是一样的现象,一上电就保护了。板子上其他3.3V的模块都断开了,只剩下FPGA了,所以问题肯定定位在FPGA,很有可能就是你说的这种情况,IO上电前是高,一上电就被拉低了。

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能知道是哪個型號 Altera FPGA 嗎?幫忙看一下哪些管腳開機時最好不要用。^_^  发表于 2013-6-26 16:38

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 楼主| 发表于 2013-6-26 15:59 | 只看该作者
lidean 发表于 2013-6-26 13:12 2 ]6 c8 q( p; l/ T4 p
不上电前将吃3.3V电的后端断开,看是3.3V电源问题还是后端问题。

" ]9 _. k! y% ]是后端问题,不是3.3V的电源问题

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 楼主| 发表于 2013-6-26 16:00 | 只看该作者
补充一下:目前3块板子中,有2块板子都是同样的现象,只有1块板子是正常的。

点评

如果是 PLCC 或 QFP 這類的封裝,拔下來看一下有無防銲脫漆造成短路,檢查完除錫後重新銲回去看看。  发表于 2013-6-26 16:44
對不起!沒看到這一點,那可能不是設計上的問題。  发表于 2013-6-26 16:41

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 楼主| 发表于 2013-6-26 16:02 | 只看该作者
jang2lin 发表于 2013-6-26 14:31
, S2 N6 b+ T: G& L5 B“一上电3.3V就短路”,那断电后还短路吗?如果还是短路的话 估计可能是哪个位置烧掉了,那就一路路找吧,如 ...
, U! D& q- F* y& ^8 Y: O- ]1 Q
断电后不再短路,FPGA的逻辑程序还没下呢,刚回来,先检查电压的。

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发表于 2013-6-26 16:04 | 只看该作者
检查FPGA IO冲突

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 楼主| 发表于 2013-6-26 16:05 | 只看该作者
nbhand 发表于 2013-6-26 16:04 * U  }  {. D4 l4 B4 _+ F  Z
检查FPGA IO冲突

) x8 O! w9 ^5 Z' _目前逻辑都没下呢,咋检查?

点评

看一下芯片資料,大部份 FPGA 邏輯沒下前管腳都是 High-Z,只有 ICP/ISP、JTAG 這類的管腳有作用,問題可能就出現在這些管腳上。  发表于 2013-6-26 16:49

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发表于 2013-6-26 16:48 | 只看该作者
zjg473 发表于 2013-6-26 16:05 , d* t7 z6 f0 A  |& R1 ?' X5 j
目前逻辑都没下呢,咋检查?

6 y8 F. W* R3 ^. z+ Q还在查吗,是短路吗?
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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发表于 2013-6-26 20:50 | 只看该作者
不良版的LDO輸出還正常嗎?) j! B; T* E" W* D
是否因為IC被LDO輸出電壓擊穿
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