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VERIBEST 就是现在的WG，呵呵。 ALLEGRO VS VERIBEST
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, y5 k& D1 t% z( o8 h* {+ ` |
; h. n ^; S2 {$ t4 f& E+ X+ W2 C
4 b. ^, B9 I; O6 p& _1 D& ?, l长度匹配的布线实现： Allegro―〉手工的方法；Veribest―〉成批量地自动完成（可以将设计时间从2周或更长到缩短几个小时） 3 e: O# X2 ?2 |2 _6 y
多线并行布线： Allegro―〉一次只能完成一根线；Veribest―〉一次可以多根线并能自动调整，打过孔等等（可得益10倍以上的设计效率的提高） ) @7 U+ {" I# M& l0 }
动态推挤（调线）： Allegro―〉有限的能力（比如出现毛刺）；Veribest―〉 随意推挤没有毛刺（5倍以上的效率提高）
$ i: W" H7 a& K6 ~6 a& `) Y H( G差分对布线： Allegro―〉 无 ；Veribest―〉可自动差分布线（手工布线下10倍以上的效率提高） % e7 D. z6 J" [! T) e6 o9 L! C! s
无限次的Undo和Redo Allegro： Allegro―〉无Veribest―〉可缩短总设计时间的10%
: W, b5 w: I2 n3 b% K5 M集成的库管理： Allegro―〉功能有限；Veribest―〉需很少的数据切换
6 q& n$ k Y1 T3 I- N原理图和PCB的集成： Allegro―〉基于网表的；Veribest―〉无缝集成（更出色的ECO和BOM,100倍的设计改进） 8 r% @; E( G3 I6 A6 b
中文输入： Allegro―〉不支持；Veribest―〉原理图中输入中文，PCB任意位置任意层输入中文，支持全部字体 ; S7 M! N2 r- u% K* u" L
使用Veribest的酷功能
- M1 Y( M# x- ?9 v9 Q0 e1. 差分对/多线布线
* @# T4 D/ y- [& `2. 高速网线的动态调整（比如可以调整或推挤蛇形线，而蛇形线的形状和长度可以动态的保持不变） 4 i, J8 e" i0 R, b2 c% i
3. 可以敷铜区中进行布局布线，并可以在已敷铜区域内推挤布线、过孔，移动器件
" v) `! H. Q7 d2 r* V4. 在一个集成环境下的单一layout设计系统(交互布线与自动布线统一环境)
. F6 T. h2 x; e5. 基于形状的交互布线和自动布线 - k0 G x. p7 X* C7 p4 {
6. 动态改变线宽和过孔大小的规则区域定义；
& _% T6 H; B* G: u: }1 x7. 能将电路从一边推挤到另一边
& ^( Z2 r p0 k( C* K8. 能将过孔合并到其他过孔和引脚；
( D; J& v1 w1 Q6 n& H2 Z; E' T9. 敷铜区易于编辑、拷贝和移动；
i3 G, c+ V, x/ _6 P' {10. 器件在动态敷铜区的移动；
; s' L; h& }, R9 O3 m' ?+ o11. 提供BGA扇出模板；
/ V) ?9 i: d1 ]6 o. t5 [12. 可以显示引脚号；
; ~( M$ C" {3 m* d$ q! ~, u- H13. 动态“冒险”显示； % [ r" J" U }: d8 n
14. 动态曲线调整（高速约束线）； 3 V1 }6 G8 w+ I2 f% I0 x
15. 钻孔显示；
) [& M" G+ u* \' c8 p16. 多线布线和多线自动连接；
3 O/ P8 Q! P- V" `17. 选择能力（特别是被选中的网线固定）； ; f$ N: R, O2 Z$ f* e) W
18. 差分对自动调整； v& M/ W% G( G: M6 x
19. 动态自动调整；
8 e/ k0 X1 E) M6 I20. 按网线/错误着色； 8 W# E9 T2 y) |& ?
21. 自动的热焊盘旋转； " d6 q* T; h% R+ U
22. 丝印字编辑； * r+ k+ L/ \% @. D( F
, I8 z1 o+ ]# x) a0 ]
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发表于 2008-8-5 23:10
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