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[Ansys仿真] SIwave进行传输线的S参数

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发表于 2013-3-28 19:50 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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SIwave在对传输线S参数提取时,是否也包含了传输线过孔处的影响?
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发表于 2013-3-29 11:32 | 只看该作者
是包含了过孔的影响的
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发表于 2014-3-6 11:15 | 只看该作者
电容在链路中,可以连电容一起提么?

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发表于 2014-3-6 12:21 | 只看该作者
可以,但是hfss这类的软件应该只支持rlc边界,如果有相对准确的rlc参数可以借鉴。
4 ], W1 p3 s. P$ x% o9 t& J  i  E3 ^否则就只能导touchstone到路分析。+ p5 T6 w2 f5 R; k$ K0 V9 m
新年伊始,稳中求胜

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发表于 2014-3-7 10:40 | 只看该作者
cousins 发表于 2014-3-6 12:210 I. B% z: s, n: b% j" X' w
可以,但是hfss这类的软件应该只支持rlc边界,如果有相对准确的rlc参数可以借鉴。
* w( _; U3 O$ u  i2 r2 z否则就只能导touchstone ...

+ T9 M; k/ A% M像SATA这种有耦合电容的线路,我在芯片端和CONN端建Port提s参数,在designer里看到的波形只有正没有负,如果在芯片端和电容端建Port提s参数到Designer波形就正负都有,请问这个耦合电容会有影响么,要怎么处理吗?
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