QUATRTUS II 9.1在编译时报10482，ROM_DATA未定义错误

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各位好：
4 A- I6 S9 P$ N$ k$ W/ A) h       才开始学习FPGA。在看清华的ALTERA FPGA工程师成长教程时使用第六章的源代码，在QUARTUS II 9.1进行编译时报10482错误，提示ROM_DATA未定义，不清楚如何排查故障，请指教。多谢！

0 ]* M) r# g1 ^1 [7 l- j

4 b+ Q# s% y; A* k- c% `

, h$ s$ I) O2 D9 J

LIBRARY IEEE;                                                                                                //调用标准库文件
2 F# K+ d% D( \8 Y: @USE IEEE.STD_LOGIC_1164.ALL;
1 Q7 I5 [1 b* |2 c6 L' Q" rUSE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY sinfsq IS
   PORT(                                                                                                //端口定义
       clk : IN STD_LOGIC;
       dout : OUT STD_LOGIC_VECTOR(5 DOWNTO 0)) ;
END sinfsq;
- g0 ]+ ]+ z. g7 Q1 b; dARCHITECTURE behavior OF sinfsq IS
  R) C& G# W" t2 f: D3 X6 U6 cCOMPONENT sin_rom                                                                              //声明ROM元件
# R1 G5 v: r& z6 ^) R        PORT(
( }) l0 d* [$ S. X                address        : IN        STD_LOGIC_VECTOR(5 DOWNTO 0);
                inclock        : IN         STD_LOGIC;
                q            : OUT        STD_LOGIC_VECTOR(7 DOWNTO 0));
END COMPONENT;
) \. z- y) v$ U9 J( p7 }   SIGNAL wt: STD_LOGIC_VECTOR(5 DOWNTO 0);
6 i& g  o! ^% JBEGIN
   PROCESS(clk)
   BEGIN
) C8 x$ [% f: {. {; y2 ?      IF clk'EVENT AND clk='1' THEN
         wt<=wt+1;
6 H6 f- K! B, T2 {3 e      END IF;
   END PROCESS;
   u1:rom_data PORT MAP(address=>wt,inclock=>clk,q=>dout);                        //例化ROM元件
0 |9 D$ V+ J' @9 m6 [  O! vEND behavior;