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在Layout的过程中,工程师的原理图通常会改多少次???

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发表于 2012-11-28 14:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在Layout的过程中,工程师的原理图通常会改多少次???" C* o2 g  k) D$ U
这几天快崩溃了,两块板,PCB刚改完,原理图改了,一块PCB改完了,另一块原理图紧跟着又变了,交替更改了几次,没完没了,真想骂人了。不知道各位同行,有没有这样的情况?
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发表于 2012-11-28 16:03 | 只看该作者
这个没一定的。硬件工程师有时候身不由己,上面太多意见,投板子前改好了总比投板后出问题强。

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发表于 2012-11-28 17:23 | 只看该作者
这个很正常,需要改,我们就积极配合改正,使我们的设计能够到达所要达到的功能。
- k6 @0 |& D7 J2 `我们可以用这种方法改,很方便:
/ |$ S; o/ x" X3 _- [$ u  i1、先导入新修改好的原理图的网表,在PADS中建立一个新的pcb文件,这个文件只有元件和网络,只要导入正确就可以了,然后关闭;; _! B, Z1 K% F
2、打开我们现在做好的PCB文件,在tool中用compare/ECO用当前文件和第一步做的新文件进行比较,形成一个ECO文件;4 }7 w1 D4 h+ p$ w2 @- S
3、把这个ECO文件导入到我们现在做好的pcb文件中,就可以只对修改的地方进行修改,而不需要修改的地方可以很好的保持下来。

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发表于 2012-11-29 09:42 | 只看该作者
修改来修改去,这是必然的,没事,慢慢你就习惯了,要淡定。。。。。。

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发表于 2012-11-29 11:52 | 只看该作者
没办法,做的时候什么都不让梛,结果纠结了半天出来了之后,对结构不让梛的全干涉,你说气人不
( I$ k2 c0 _6 m: k; c
天空没有飞过的痕迹,但我已努力飞过

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发表于 2012-11-29 15:33 | 只看该作者
这种情况应该比较多见,呵呵,不过确实对lay 板子的人造成不少困扰。呵呵。

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发表于 2012-11-29 22:32 | 只看该作者
哎,忍吧

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发表于 2012-11-29 22:38 | 只看该作者
这个不忍也没办法,谁叫我们是干这个的,投板钱如果不改,回来再修改更加难过!

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发表于 2012-11-30 08:19 来自手机 | 只看该作者
新产品,前期就是这样的,习惯就好了。

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发表于 2012-11-30 13:14 | 只看该作者
最好原理图和PCB是一个人

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发表于 2012-11-30 19:17 | 只看该作者
额自己弄SCH。自己LAYOUT

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发表于 2012-12-1 08:47 | 只看该作者
本帖最后由 xiesonny 于 2012-12-1 08:53 编辑
& k4 Y  T/ F3 X( i+ \: Q" `: t" G: b6 w7 O
只是做PCB Layout的话,这个的确是很烦的。我之前有过一年这样的经历。9 g" e. k6 ]; @% n
1,原理图,每次等你做板做好了,就说原理图要改这里那里,改几次。
$ {+ p# ^6 ^* u! O4 q5 q8 H2,结构原因,结构是领导给你的,没做PCB前,说OK,照结构绝对没问题的。等你做好PCB后,看了一眼,又说,嗯,这个结构的排座要换一下位置,尼玛哦,高密度的板,换一下排座的位置,布局布线全完了,相当于重做。
# v7 G! o: k$ X) n" ~
$ t% o% i# C3 q6 n其实设计一个复杂的PCB并不算困难,当你认为布局布线都很不错的情况下。由于上面的原因而推倒重来。真的要崩溃,发疯发狂的。

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发表于 2012-12-1 11:07 | 只看该作者
这就是你的工作。什么? 觉得烦? 那么你肯定还没习惯你的工作。时刻定位自己就好

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发表于 2012-12-1 14:29 | 只看该作者
3楼的方法很好, 有点像模块复用功能

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发表于 2012-12-1 14:29 | 只看该作者
3楼的方法很好, 有点像模块复用功能
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