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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 求助：关于DDR3的地址线等长的问题
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求助：关于DDR3的地址线等长的问题

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kingt001

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发表于 2011-10-30 22:24 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 kingt001 于 2011-10-30 22:31 编辑
; h2 D8 M- ?$ n6 q
2 G! t# S$ K. A) f- J请大家帮我看下这两张图片的DDR3的内存的地址和控制线要怎么走，从datasheet可以看出地址线之间的长度误差是25mil。但是我没看明白的是这个25mil指的是从arm到同一颗芯片内的控制和地址线误差是25mil还是arm分别到4颗DDR3的地址和控制线的误差都要保持在25mil之内！也就是图2中的T型线的一个分支内误差为25还是T型线的每个分支与其它分支误差为25mil！请各位指教，谢谢！
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mcu200689

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2#
发表于 2011-11-1 16:34 | 只看该作者
DDR3应该胜从arm到同一颗芯片内的控制和地址线误差是25mil，要求没有DDR2严格

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