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[HyperLynx] ddr2的数据线波形,高手指点

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发表于 2010-5-26 14:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 cwfang 于 2010-5-26 14:42 编辑 $ @9 @" S; N+ Q' j( c' `# O
% g/ Y, a( g& M! x. W  \
以下是我仿真出来的ddr2的其中一根数据线的波形,不知道有没有问题,怎么判断?希望高手指点一下。还有hyperlynx中能不能仿总线?

未命名.jpg (170.51 KB, 下载次数: 50)

未命名.jpg

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发表于 2013-8-31 18:20 | 只看该作者
jason_pa 发表于 2011-3-29 22:17
. r* E  D" Q! S7 t+ r仿真总线,还可以通过在boardsim中将走线按照s参数提取,然后在line-sim中调用s参数即可6 @+ C7 G% Q, J* s' c) m$ F) N
比较过,差异较小 ...
! s; o& B  Q6 @& w
大神你分析的听不懂 做培训不我想学

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发表于 2014-8-26 16:13 | 只看该作者
我觉得仿总线就是看下串扰吧,就数据线来说楼主的结果很不错了,数据线看电平,时钟线看边沿,数据线的电平时间窗口留的足够了,没有过冲和振铃,就行了啊。

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发表于 2013-11-6 13:16 | 只看该作者
DDR 不是集成了,用过DDR 向导,就可以对DDr 的读写时序仿真.

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发表于 2010-5-26 18:30 | 只看该作者
很不錯阿!9 q: F0 U! h2 B, Q1 r+ `- X
我估計線長約 2.5 inch

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 楼主| 发表于 2010-5-27 08:17 | 只看该作者
回复 2# honejing
6 I* ]" J% Q9 t4 T9 q8 i) i7 j0 d1 e8 p! z6 L

- o- Z8 V4 x. a: r4 a    怎么判断出好坏?还有能不能同时仿真多根数据线?
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发表于 2010-5-27 18:20 | 只看该作者
怎么判断出好坏?  x1 r! t$ ^. _9 w! m4 I- o: B
==> 參考時序的規格看容餘有多少,容餘越多越好。
* C# H' B8 C" c还有能不能同时仿真多根数据线?! k  Q* j# F, l1 H9 o( L
==> 我說過了,不行。

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 楼主| 发表于 2010-5-28 08:37 | 只看该作者
怎么判断出好坏?
" Z) o0 `! e9 F% Z==> 參考時序的規格看容餘有多少,容餘越多越好。
& Q5 v3 a# i* J( x$ K0 G1 K: Z2 c4 J还有能不能同时仿真多根数据线?: q) _5 H: D* h# {% a5 t0 {& ?
== ...
; K7 o( o0 X- _; Xhonejing 发表于 2010-5-27 18:20

$ H% b! j$ c8 B5 n7 e) M6 o' k: R: k2 W5 b/ E3 L/ F# A3 S; K

0 b* u" d$ U. z+ h/ {3 {    你的意思就是看建立时间和保持时间余量,但这必须是和时钟在一起比较才能看出来的吧!
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发表于 2010-5-31 22:15 | 只看该作者
你的意思就是看建立时间和保持时间余量,但这必须是和时钟在一起比较才能看出来的吧!3 z1 u9 U, Y2 D
cwfang 发表于 2010-5-28 08:37

; C, m0 l8 s! a1 P同问,期待高手回答。

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发表于 2010-5-31 22:59 | 只看该作者
數據總線的眼圖,搭配 DQS (此圖未加入) 就可以判斷時序的容餘。- t8 M  I* H5 _

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发表于 2010-6-27 15:45 | 只看该作者
怎么判断出好坏?
: F. r$ j2 x6 O' G( I==> 參考時序的規格看容餘有多少,容餘越多越好。* n3 k5 V, e3 x
还有能不能同时仿真多根数据线?, l- d! f1 }. ?6 [
== ...
: w" z$ b# f: D: d6 \2 e+ `  X4 ghonejing 发表于 2010-5-27 18:20
6 y' q( _; y9 T( C

. m& v, `; t7 @. y$ m. a, Q7 L
7 t# Z0 p) m8 ~. I! |sixplorer支持总线仿真
不問可不可行,而問如果一定要做,該怎麼做

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 楼主| 发表于 2010-6-27 19:44 | 只看该作者
回复 8# 袁荣盛
, u5 q; V" n9 r  Y! ^3 W/ c; S8 h( Z8 Z5 h! }+ y
9 h' U# T0 I1 J/ a9 ~& [3 {; D% q
    老大,sixplorer是哪个公司的仿真软件?cadence?
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发表于 2010-7-3 03:21 | 只看该作者
提取拓扑到linesim,全部复制到一起就能仿真总线了

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 楼主| 发表于 2010-7-3 19:18 | 只看该作者
回复 10# rx_78gp02a
8 }: D  ?$ w+ W/ D+ w2 }2 w+ o" w& X$ H+ f5 R0 C8 X6 x, D' g. Q  Z

" V1 U6 G& b. O& B' n8 j3 Z0 ?3 a    哦 其实我是想在boardsim中看
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发表于 2010-9-3 16:28 | 只看该作者
对照spec看余量

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发表于 2010-9-20 15:50 | 只看该作者
提取拓扑到linesim,全部复制到一起就能仿真总线了% _! ~! T) |0 Z$ b
rx_78gp02a 发表于 2010-7-3 03:21

+ N2 l0 }+ R4 S$ j9 C1 n$ u( P) F

! V* t. a8 a$ J6 V, \    我也是这样做的。。。

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发表于 2010-9-20 17:45 | 只看该作者
频率应该设置为800M
# z4 k7 S) R4 G1 X0 K你设置为400M 错了,除非你DDR2只跑400M

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 楼主| 发表于 2010-9-21 08:59 | 只看该作者
回复 14# wymei1204
/ J' a/ U: y' s1 Q8 `
% V7 F( |9 f% {  y, _1 `9 O+ J' B0 K$ a
    现在ddr2就跑200M的时钟,400M的数据率
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