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ddr必须要终端电阻吗

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发表于 2009-10-19 10:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 sanzi 于 2009-10-19 15:43 编辑
1 z2 q+ S( r9 y% I% W+ ~. }
' m, v: o. |2 W! d1 j0 [我只用了一片ddr芯片和fpga相连。不用终端电阻影响究竟有多大?0 t5 h3 }" N' n7 B
谢谢大家
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 楼主| 发表于 2009-10-19 11:05 | 只看该作者
帮帮忙吧,我设计的时候没有加上拉电阻。也没有vtt电源。pcb正在画,现在改还来得及。

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发表于 2009-10-19 12:57 | 只看该作者
接VTT的电阻阻吗?那个不叫上拉电阻,不加也可以,加了不多余。

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发表于 2009-10-19 12:58 | 只看该作者
那个不叫上拉电阻,不加也可以,加了不多余。

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 楼主| 发表于 2009-10-19 14:55 | 只看该作者
谢谢。
- q) w( {6 A& Z3 }) D2 A: J( @就是那个电阻。我看有的设计加了vtt匹配电阻,有的没有。第一次画这个板子,不知道在什么情况下不加。是不是有距离的要求?2 @, `3 f7 D1 p; D
找不到相关的文档资料说不加那个电阻的情况
: u% i* V" w, \2 l) L% |& O 4# mening

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发表于 2009-11-3 22:11 | 只看该作者
我的DDR2以验证成功,不需加如上拉电阻及电容!

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发表于 2009-11-3 23:48 | 只看该作者
DDR应该是要加的,因为ddr2是odt(on die ternate)
$ m1 N" o; B  h3 j; N2 R4 z( M要不,你这个就不是SSTL II电平了,所以建议你加上,省得出问题

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发表于 2009-11-4 09:38 | 只看该作者
UESTCC3200732好像是UESTC的校友,哈哈。parallel termination通常用于多于5片DDR芯片或者走线长度超过2inch的场合,其它情况可以不需要加的。

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发表于 2009-11-20 22:48 | 只看该作者
DDR应该是要加的,因为ddr2是odt(on die ternate)( ]/ c5 I" m; a8 p/ `$ g
要不,你这个就不是SSTL II电平了,所以建议你加上,省得出问题
3 j+ o7 ?) F1 m( z" ybraveboys 发表于 2009-11-3 23:48

' `$ H2 H% g, v/ C& n% o& n. WDDR2只有数据线DQ和DQS有ODT,在电脑主板上地址线还是要在板上加电阻的。DDR3所有的线就都有ODT了,于是就都不需要了。

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发表于 2009-11-21 18:15 | 只看该作者
最好仿真一下吧

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发表于 2015-5-12 11:25 | 只看该作者
DDR不加串联终端电阻呢?

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发表于 2015-5-12 11:50 | 只看该作者
串联终端电阻?DDR有这样的电阻吗?

点评

就是匹配电阻吧?数据线上是有的,ddr2之前。ddr3好像不用了,有个叫odt的新技能了~~  详情 回复 发表于 2015-5-13 09:34
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发表于 2015-5-13 09:34 | 只看该作者
dzkcool 发表于 2015-5-12 11:50. ?4 {0 x  s1 P) ^% U( f1 z
串联终端电阻?DDR有这样的电阻吗?

% u8 n; X! {$ x' p* P* @就是匹配电阻吧?数据线上是有的,ddr2之前。ddr3好像不用了,有个叫odt的新技能了~~
; v: B( l% Q* L* R7 G* g6 S  W
又累又out...............

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发表于 2015-5-20 14:23 | 只看该作者
没必要吧

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发表于 2015-5-22 11:41 | 只看该作者
感謝分享~~
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