EDA365欢迎您!
您需要 登录 才可以下载或查看,没有帐号?注册
x
本帖最后由 Cadence_CPG_Mkt 于 2018-6-14 23:49 编辑
/ W% p3 R, {( S! J
% }8 t2 |1 T2 v4 @6 cPowerDC 本节介绍Cadence® Sigrity™ 2017 PowerDC™ QIR2 版本中的新增功能。
$ _; O( L6 O! [; z
Allegro数据库相关更改
8 |* T4 ~) c2 W" h( Q
多区域层叠支持 在Stack Up 窗口,支持多区域功能。 多区域信息显示在区域管理器中。 ) A7 Y2 F, a0 ^: ~ D4 \* A# N
刚柔结合设计的3D热预览改进 在仿真之前,单击工作流程窗格中的“预览热3D模型”以查看3D热模型。 % Y% L- J( c3 Q T6 W- U
弧形走线支持 走线弧和铜皮边界弧被离散化为小段走线。
/ ~; v6 @) |: q9 b n
网状铜皮支持 在PowerDC中,网状铜皮被网格剖分。
9 e1 O0 v" V+ D
可用性改进
! u7 `$ r' W- d$ A多板连接器引脚电阻支持 在“设置引脚电阻”窗口中,每个引脚可以用特定的电阻来定义。 您可以保存并加载.csv格式的引脚电阻文件。 引脚电阻文件的格式如下图所示。 * v9 \ q: P- [8 M6 v7 U
连接器引脚电流/电压显示 多板/封装压降分析和多板/封装电热协同仿真工作流程中添加了新的View Connector Pins Results选项。 仿真结束后,点击此按钮,查看连接器的引脚电压、压降、功耗和引脚电流。 连接器信息文件被命名为ConnectorPins_SimulationResults.xml,保存在结果文件夹中。
3 F$ N: V- ]; k1 q# h
将多板VRM感应引脚定义为差分对 3 U) S9 n/ H' n# l' G. L, v) l: z
测量两点之间电压的功能 1. 要测量电压分布图中两个点之间的电压,请右键单击并从快捷菜单中选择测量压降或测量压降(参考点)。 2. 右键单击并选择结束测量压降以退出该命令。
5 T O/ r8 q# u: y选择扫描迭代功能 1. 单击扫描管理器中的“选择扫描集”按钮。 所有迭代都列在“选择扫描集”窗口中。 2. 一些或所有的迭代进行扫描仿真。 ; E, N+ `& w2 `: m |
将PowerTree拓扑添加到PDC签收报告的选项 1. PowerTree安装完成后,单击工作流程窗格中的“应用PowerTree”。PowerTree选项在“报告选项”窗口可见。 2. 选中此选项,将PowerTree拓扑添加到签收报告中。 $ R9 S, Y+ E) e2 K7 S
导出调试信息的选项 增加了导出调试信息的选项,用于在无法取得项目文件情况下检查问题。 1. 设置环境变量POWERDC_DEBUG=1。 2. 在仿真结果文件夹下找到文本文件Worksapcename_PowerDC.debug。 ; Z+ i& T/ d$ ^1 D$ N
AMM/PowerTree的相关改进
! p7 M! M/ \4 y( @( e. g支持热模型的AMM模型分配 在分析模型管理器(AMM) 中,您现在可以指定热模型数据。 在AMM模型分配之后,模型数据被传递给PowerDC以创建工作空间。 ; S9 T' I; q! T4 M6 B) I5 c9 g3 v
支持采用没有地网络的PowerTree 对于没有地网络的PowerTree拓扑,当您在工作流程面板中单击“应用PowerTree”时,PowerDC可以创建一个没有地网络的工程文件。 + j/ o! i' Y6 A- m! ~0 U
其它改进
3 v! s4 n$ F: [9 V; xPowerDC中的标记层支持 您现在可以根据分布图附加评论或备注。 " N) s' B/ z' z Q
这些备注是layout工程师修改layout的指导原则。
" n4 H Y: a( y2 s/ D8 `4 Z0 t
热精度改进 当空气流量为0时,系统使用自然对流。 →选中“使用增强传热系数模型”选项来提高精度。' f M5 j5 D% H" s* k/ r
默认情况下,如果选中此选项,则计算传热系数的三次迭代。 " M2 ]% D" h# B! D, C) d% V- b9 y3 [
更多TCL支持 加载PowerTree
9 B* D. D1 ]( @- g应用PowerTree : x4 D3 t* I: @( _9 Q" N0 r( J( o
sigrity::apply powerTree -net {power netgroup,pairing p/g net} -net : if no netpair is specified, all power net groups will be applied. ( s; c: f4 I; J$ I( N
更改所有层/过孔的材料 - ~4 u s `$ m2 G1 d
sigrity:: update layer model_name {FR4} {allDielectric layers} {!} sigrity:: update layer model_name {copper} {allconductor layers} {!} sigrity:: update layer dielectric_name {FR4}{all conductor layers} {!} sigrity::update PadStack -all -conductivity{5.85219e+07} -MetalName {copper} {!} ( _+ S* I3 `# O1 f( ~. c. I. i
/ D$ J- y& I6 O3 b6 f3 |
8 `9 g: B1 m5 y7 h8 ]/ F% `* C
欢迎您的评论! 您可以通过PCB_marketing_China@cadence.com联系我们,非常感谢您的关注以及宝贵意见。
/ g* T! d3 Q) m, C3 T
$ r# R$ ~" k+ f7 }6 m
) f3 ^" c) z4 z. \: N: m+ ^" Q8 C |