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[HyperLynx] hyperlynx9.4.1。timing module 时序模型

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发表于 2018-6-6 11:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我用hyperlynx9.4.1仿真DDR4,发现在设置timing module时没有默认的.V文件,后网上看论坛帖发现,原来安装路径下有。现贴出以方便新来的。
' f4 P8 `, @) T1 c0 i我的安装路径是:d:\MentorGraphics\9.4.1HL\SDD_HOME\hyperlynx64\Libs# g! Y' \% a7 t0 x& D
另还有个问题。9.4.1安装到win10后,PCB导入时没有brd的格式。但同样安装到win7下就正常,估计是win10的兼容性还不够好。
8 l2 d- i0 c  I: W; P混点积分。。。。
( R  M; y9 C# I( q7 [
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发表于 2018-6-14 08:42 | 只看该作者
谢谢分享

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发表于 2018-6-14 08:45 | 只看该作者
您好!方便把你的DDR4的timing module的.V文件的问价共享一份吗,谢谢,

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发表于 2018-6-14 09:15 | 只看该作者
同求DDR4的timing module文件,谢谢!

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发表于 2018-6-19 13:31 | 只看该作者
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发表于 2018-6-20 08:24 | 只看该作者
win10?还是win7吧
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