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如何把两个不同的网络用铜皮连接起来?

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发表于 2018-5-2 23:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题所示,allegro是否有PADS的copper bridge功能,可用一铜皮把连个不同的网络连接起来,DRC时不报警。
" }1 r7 i! a! ]. D0 S- V
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发表于 2018-5-7 14:13 | 只看该作者
打过孔,
! Y8 i- q( t3 R# N/ j* i- U1 S# ?! t( \

. ^9 K' w! R' I: }* ^/ Q+ K% p
# s, R7 Y) P2 b7 |7 N/ y
  ~0 g! N$ o8 U6 k2 k" O$ y, H深圳市惠达康科技有限公司: R$ f; b3 {1 ]: J- S" Z4 N
PCB层次:2-40层$ b, I2 d, f7 k
产品类型:PCB,FPC, R&F PCB.
! @7 A& a. C) ?( `' R& M& M4 m8 U' n最大尺寸:双面1200mm*1500mm 、 多层1000mm*1200mm
% d% Q3 W' V1 C2 P5 N按材质分:FR4、铝基板、铜基板、陶瓷板、无卤素、高Tg、高频板(Arlon、Taconic、Rogers、Isola)
4 p7 q0 K, X6 e5 a/ t表面处理:OSP、喷锡、沉金、沉银、沉锡、镍钯金、厚金板(最大金厚40U")
( T' u. n! v/ g制程能力:线宽线距3mil、激光孔0.075mm、机械孔0.15mm/ D6 o. }+ Y, `2 S0 Y9 v
铜    厚:1/3OZ--28OZ
: o. L" E3 E2 v" a+ L2 |5 R* [杨先生竭诚为您服务! 13316575121(微信同号)   sales007@witgain.com
: ], [! y- `6 q- B8 }9 b% D

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发表于 2018-5-4 09:10 | 只看该作者
tangqianfeng 发表于 2018-5-3 19:20
  U6 T/ n+ D( j* ?5 R" Hnet_short属性只有pad 或via有

' l* m% e( C$ I% `4 @5 l- z# e我给一个pin via都定义  net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让

点评

使用静态铜皮,就不会避让了  详情 回复 发表于 2018-6-21 00:06

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发表于 2018-6-21 00:06 | 只看该作者
王开鑫55 发表于 2018-5-4 09:10% G. g; l+ q* d) ~/ I2 s# ^, E
我给一个pin via都定义  net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让

6 D$ q0 D1 L. I0 a4 Q8 p5 W1 N* d使用静态铜皮,就不会避让了2 {9 }; j( r$ e* g
* N; m  }  n* G1 y

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发表于 2018-5-3 00:30 | 只看该作者
应该没有,短路肯定会报DRC的,DRC隐藏即可,没必要纠结!

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发表于 2018-5-3 04:34 | 只看该作者
有, 可把不同的网络连接起来.5 e9 k+ y& ?" c8 T! F. J
DRC时不报警.8 Q. z  {# C% b( j# [' J" k2 Y
7 ?& i, e* b+ w& [. L

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发表于 2018-5-3 07:14 来自手机 | 只看该作者
有的,要给他们定义net_short属性

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定义了net_short属性后,还是不能用连线或shape把不同网络连接起来。  详情 回复 发表于 2018-5-12 21:06
allegro中 edit properties没有找到net_short属性??  详情 回复 发表于 2018-5-3 09:19
这个办法好  详情 回复 发表于 2018-5-3 08:58

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发表于 2018-5-3 08:58 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:14, I9 k# C  O# E8 r
有的,要给他们定义net_short属性
; K- d+ c8 N( U! r
这个办法好, h) B0 H+ w- ?) i

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发表于 2018-5-3 09:19 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:147 U3 \# l4 y# M4 B
有的,要给他们定义net_short属性

6 x% M' `7 g8 f+ A' q' @# j' pallegro中  edit  properties没有找到net_short属性??
2 K0 ^; U% Q* }5 [

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net_short属性只有pad 或via有  详情 回复 发表于 2018-5-3 19:20

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发表于 2018-5-3 10:03 | 只看该作者
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发表于 2018-5-3 10:54 | 只看该作者
两个不同的网络连在一起,不报错,怎么可能呢。

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pads就有此功能。  详情 回复 发表于 2018-5-3 23:52

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发表于 2018-5-3 19:20 来自手机 | 只看该作者
王开鑫55 发表于 2018-5-3 09:192 D! k. t: E8 T: x: o( [
allegro中  edit  properties没有找到net_short属性??
# Z- l) O" W5 Y. `; z+ @
net_short属性只有pad 或via有$ u! r' F8 Q; w3 Q9 T4 w* _, }

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我给一个pin via都定义 net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让  详情 回复 发表于 2018-5-4 09:10

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 楼主| 发表于 2018-5-3 23:52 | 只看该作者
利涉大川 发表于 2018-5-3 10:54' {8 z. ^8 u: k
两个不同的网络连在一起,不报错,怎么可能呢。
- B2 r, S3 L$ X( S% @3 ]4 s% Z
pads就有此功能。
' v! ^& ~; k3 ]% L/ \( h

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我感觉应该是隐藏了DRC,你要是用CAM350去跑开短路都跑不出来的话,那这个功能就会出大问题的。  详情 回复 发表于 2018-5-4 09:12

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发表于 2018-5-4 09:12 | 只看该作者
myexpma 发表于 2018-5-3 23:52
/ Y$ ?9 @3 C2 w+ g4 ~pads就有此功能。
. m  B" u, c, v( E  ~6 L
我感觉应该是隐藏了DRC,你要是用CAM350去跑开短路都跑不出来的话,那这个功能就会出大问题的。
# ]3 J/ N& }) [; _: `0 Q6 r& s

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发表于 2018-5-7 11:17 | 只看该作者
可以把铜皮画在其它层,出光绘时注意要把这个铜的层加上+ E( }7 X0 Z6 G
4 c) P1 y& O6 R9 F: {

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已经使用此方法,但是感觉不完美。  详情 回复 发表于 2018-5-12 21:04

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 楼主| 发表于 2018-5-12 21:04 | 只看该作者
superlish 发表于 2018-5-7 11:17
+ N( |$ N# K: ?- ~  B- F3 E; k可以把铜皮画在其它层,出光绘时注意要把这个铜的层加上

5 P+ F4 L; N4 s& ^6 c; f. P已经使用此方法,但是感觉不完美。
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