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再问一个铺铜的约束问题

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发表于 2009-1-6 19:18 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有一块要求将几个管脚用大片铜连在一起,如果用动态铺铜的话就变成了图一的形式(shape的约束是0.2mm space),如果没有约束的话则铺地的时候全都连在一起了。
. C$ _9 ^7 L5 A) E没约束肯定不行,可是有约束,又无法将这几个管脚连在一起。也尝试用出的trace连,可是太难看了。
- n: z2 N& M8 H; Q5 g! u1 e: {如果用static方式的到时可以,可是出现了DRC符号.) u& H% F9 y  |3 [
该怎么办呢?

dym.jpg (87.09 KB, 下载次数: 7)

dym.jpg

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发表于 2009-1-6 22:51 | 只看该作者
点shpe select命令钮,点击那块铜箔,右键parameters....>>然后在thmermal relief connects中找相应的pin选上full contact就ok
其实做梦是最好最理想的娱乐方式~!

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发表于 2009-1-6 22:54 | 只看该作者
比如你这个是属于SMD PIIN

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shape.JPG
其实做梦是最好最理想的娱乐方式~!

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 楼主| 发表于 2009-1-7 00:18 | 只看该作者
谢谢,领会意思了

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发表于 2009-1-7 09:08 | 只看该作者
这种焊盘铺大片铜箔会有问题吧,看你的焊盘间距比较小,一般SOLDERMASK板厂最小做到7MIL,如果铺大铜箔,会造成吃锡面过大而虚焊。3 h9 t# w& q  P4 g5 M- X  Z
所以,还是引线,线宽不要超过PIN宽。
MENTOR奋斗中!!!!
GOOD GOOD STUDY,DAY DAY UP

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发表于 2009-6-17 19:58 | 只看该作者
两种方式都要吧,对了,为何要全铜啊?还可以在内部的IC下连通吧!

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发表于 2010-1-25 12:20 | 只看该作者
关键遇到这种问题如何解决  上面说的我也领会了

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发表于 2010-11-23 12:01 | 只看该作者
,en; ]  P9 d+ }" ]0 o. `. i/ b% w# F' D

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发表于 2013-1-30 19:13 | 只看该作者
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