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2017年8月8日公益PCB评审报告节选

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发表于 2017-8-9 08:55 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  开关电源连接电感太细了.  K! d* u) c2 O7 c

! o, B  E( J* |6 N/ }- N
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 楼主| 发表于 2017-8-9 08:56 | 只看该作者
3.  ESD尽可能靠近接口.
8 `; f, `8 L# `' Z3 y7 C 7 C9 p4 B7 B2 x* a; a

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 楼主| 发表于 2017-8-9 13:33 | 只看该作者
jiache 发表于 2017-8-9 11:40$ K% ~- F: q  h; j. N# g
这个问题,此页内出现两次,请大神给个正确示例。在此问题上是否区分滤波电容和退耦电容?请大神指点。

7 M+ j1 H% u  M# W不管是滤波电容还是退耦电容都不要放通路的最后面.滤波电容是靠输入端,退耦电容靠近用电管脚.
/ r* }$ a8 D: }! [3 [7 l) j

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谢谢。  详情 回复 发表于 2017-8-10 00:05

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发表于 2017-8-9 11:40 | 只看该作者
EDA365QA 发表于 2017-8-9 09:00
: e0 [, w" c7 a( w1 l10.   电源过电容靠近PIN脚,不然电容只是摆设.

0 `$ c( [0 z% ~4 K4 Y这个问题,此页内出现两次,请大神给个正确示例。在此问题上是否区分滤波电容和退耦电容?请大神指点。
1 a6 H2 F# b1 U: t/ z( A

点评

不管是滤波电容还是退耦电容都不要放通路的最后面.[/backcolor]滤波电容是靠输入端,[/backcolor]退耦电容靠近用电管脚.[/backcolor]  详情 回复 发表于 2017-8-9 13:33

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 楼主| 发表于 2017-8-9 08:56 | 只看该作者
2.  电源应补强加宽.
9 x5 m# i: Z5 N# B
2 u- c" N6 c+ Z- }2 J

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 楼主| 发表于 2017-8-9 08:56 | 只看该作者
4.  跨分割.
0 _7 R0 ^  z5 x# P% ?6 e& ?3 }
9 P2 E  ~4 m7 G9 b( u

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 楼主| 发表于 2017-8-9 08:57 | 只看该作者
5.  部分器件没有开钢网.
# _/ T. q  f- i9 I: p5 F 6 a) M+ J  u/ Y$ ~# \

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这个问题出现好多次了,是allegro经常出现的问题吗,建议在版块置顶该问题。  详情 回复 发表于 2017-8-9 09:15

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 楼主| 发表于 2017-8-9 08:57 | 只看该作者
6.  PCICLK没等长.
* }9 X4 I- G5 J; E) h! a) @ ) g1 G* y( n. y1 P. {4 e

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 楼主| 发表于 2017-8-9 08:58 | 只看该作者
7.  电源要先过电容.
1 Z0 l# R1 w% d! M5 v& ?- f
" s' I# v1 K8 z& H' c

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 楼主| 发表于 2017-8-9 08:59 | 只看该作者
8.  晶体电容尽量不要在末端.& |; u$ M& V+ a) U3 V; l

9 L, V* q, e! T2 b+ X  Z4 [1 J

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这个是为什么呢?有些两脚晶体,芯片厂家评估板就是远离放,影响大么,如何空间比较紧张情况下。  详情 回复 发表于 2017-8-9 10:26

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 楼主| 发表于 2017-8-9 08:59 | 只看该作者
9.  电源没加粗没过电容.5 G2 i3 T/ T0 G& E! W0 K+ I9 c
7 }$ g- \$ j8 ]0 `+ q. t

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 楼主| 发表于 2017-8-9 09:00 | 只看该作者
10.   电源过电容靠近PIN脚,不然电容只是摆设.' R! R; s, B- w. j5 ~
; r  O4 d+ j6 r5 j) f5 i0 ~

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这个芯片貌似电流不大,需要这么多大电容?  详情 回复 发表于 2017-11-7 17:34
这个问题,此页内出现两次,请大神给个正确示例。在此问题上是否区分滤波电容和退耦电容?请大神指点。  详情 回复 发表于 2017-8-9 11:40

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发表于 2017-8-9 09:15 | 只看该作者
EDA365QA 发表于 2017-8-9 08:57: X: L7 ^7 h2 e( J  t
5.  部分器件没有开钢网.
0 B- z! \& v* C+ ]2 C1 }5 z
这个问题出现好多次了,是allegro经常出现的问题吗,建议在版块置顶该问题。6 K0 t( _# t* [

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发表于 2017-8-9 10:26 | 只看该作者
EDA365QA 发表于 2017-8-9 08:59
8 V  F- b; W* [% O- ^7 J/ p8.  晶体电容尽量不要在末端.
% q9 ]/ u% w; _+ ]
这个是为什么呢?有些两脚晶体,芯片厂家评估板就是远离放,影响大么,如何空间比较紧张情况下。
# ]; C' _6 E# W* M6 A

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是晶体的两个电容不要放末端.  详情 回复 发表于 2017-8-9 13:27

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发表于 2017-8-9 11:36 | 只看该作者
同问,请大神分析一下,谢谢。
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