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2017年7月19日公益PCB评审报告节选

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发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.. ~% B: ]% m& D% W1 g# j& n( D9 h
' X% T7 V- L/ W" B7 b
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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32( j/ w3 W6 ?) `" R& Z( u
请问这条如何理解? pcb小白求教

2 c& u2 Q% `6 O1 _2 p' {1.平面铜只有一个VIA,肯定的说这块铜没有作用.. @& w0 T* F' V8 K, f. g" H6 s  I
2.电源被VIA隔小了,电源通路太细.

2 W$ C. s  L3 [8 \

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58# x  T# F, ^' o1 t8 [% q) w- H* F
10.  平面铜只有一个VIA,电源被VIA隔小了.

* b4 Q, q  W: ~请问这条如何理解? pcb小白求教/ W" B, c" `4 i2 J

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.# t8 S3 K% U) I! \( g& l1 t
+ {3 }* |' S. O

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 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.
' w9 V0 L4 d5 e6 K4 Q* r, o  O* @ 6 |& |# j1 x* `! q) k

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 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.
2 {& Q( A5 a6 U3 S
, U- r! L* v5 y9 J1 ~

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 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.
( [7 G0 q4 I  @
7 q5 T" K' g" i6 }) Z; N# ]' ?3 ]/ W

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.( i0 D, r1 ~2 r. t" t8 D$ D& l) _4 e
# a. G$ T  g: C: Z2 U6 ?3 z! m

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
! g0 [! ]1 [1 b$ k
0 r) P  y4 x6 l. l/ X4 L

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啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.3 X4 f0 K8 l: y3 L6 o8 c9 [
/ z8 C% l5 D. u/ b

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.. }6 e) U: ^9 ^2 Q! t1 R

& o1 P$ h/ [  p1 P! w

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 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.
9 ^5 H9 d" U  `- m
( K4 E9 a" [$ U4 P

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请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
: e4 j" \- A* U1 [

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发表于 2017-7-21 08:43 | 只看该作者
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