VIA隔离太大，铜覆盖不到

sketty · 发表于 2017-7-17 14:18

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VIA隔离太大，铜覆盖不到，如图，怎么破？从哪改？谢谢！

yangjinxing521 · 发表于 2017-7-17 15:06

改小，没毛病。。。。。

xueling2009 · 发表于 2017-7-18 08:56

是不是地的网络单独设置了规则？

pcb · 发表于 2017-7-18 09:14

设置区域规则.

xueling2009 · 发表于 2017-7-21 11:23

xueling2009 发表于 2017-7-18 08:56
! \1 F6 _$ i, d7 d$ e是不是地的网络单独设置了规则？

不客气的。

IKE · 发表于 2017-7-23 14:35

孔到铜规则改小，默认规则/层规则/网络规则/class规则都看一遍。。。。

chengdandan · 发表于 2017-7-26 10:02

1. 孔设置满接，不要热焊连接
2.设置敷铜框为5mil、

chengdandan · 发表于 2017-7-26 10:06

哦，还有　设置敷铜格点为0.1　

li262925 · 发表于 2017-9-21 15:33

最后怎么解决的？

tanke · 发表于 2017-9-28 15:48

谢谢，，学习了，

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