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2017年7月6日公益PCB评审报告节选(一)

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发表于 2017-7-7 08:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-7-7 09:17 编辑
. t' N- y' ?; r  i& Q
2 E. @  U, {$ f4 y. |# Z1.  隔层参考没对应布线.* |4 W5 w1 Z  R
8 s. z6 \. |1 @+ g+ \7 S8 h
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发表于 2017-7-27 17:09 | 只看该作者
junieya 发表于 2017-7-27 16:22
7 `0 M# \+ j( l! m$ D' U3 Q- t隔离处理就是画出来的地方的电路元件要离电感远一点嘛?
* a4 q& o  s5 F; M
隔离这类名词要多学习多看一些资料,下面是EMC方面的说法.. y0 Y/ H/ w8 ]0 X2 s: F/ ]9 A

. m7 i# S, E. ]9 g2 }; p9 k

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发表于 2017-7-27 16:22 | 只看该作者
EDA365QA 发表于 2017-7-7 08:526 A2 T4 }4 P3 i+ A, x: s
4.  共模电感前后做隔离处理.

- H3 h' d1 n& ^+ H" H2 n+ E隔离处理就是画出来的地方的电路元件要离电感远一点嘛?: i% E& e0 s) b

点评

pcb
隔离这类名词要多学习多看一些资料,下面是EMC方面的说法. [attachimg]129100[/attachimg]  详情 回复 发表于 2017-7-27 17:09

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 楼主| 发表于 2017-7-7 08:56 | 只看该作者
6.  隔离的电源地分割要一致,不能有跨分割布线./ h2 `- L" {# k7 ~6 T

# C( h0 ?8 e  `

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 楼主| 发表于 2017-7-7 08:49 | 只看该作者
2.  有多余线段.! _7 f" I8 _! F/ j5 s& v! ^
: Z6 ~3 p0 s9 @3 ]6 a

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 楼主| 发表于 2017-7-7 08:51 | 只看该作者
3.  加热部分为大电流,布线应铺铜加宽.
9 s: Q/ I& y& V* R1 v
# b6 E5 p: e' D$ a% r$ j1 k1 w" v

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 楼主| 发表于 2017-7-7 08:52 | 只看该作者
4.  共模电感前后做隔离处理.
) ~% Q! x6 C* S2 U. \2 i
- m. p/ r2 l; x, p6 D* [

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隔离处理就是画出来的地方的电路元件要离电感远一点嘛?  详情 回复 发表于 2017-7-27 16:22

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 楼主| 发表于 2017-7-7 08:54 | 只看该作者
5.  共模电感所有层前后做隔离.
  @/ v, C& {0 e0 `$ q: k$ P4 p
9 [/ ~, j/ T# s. O

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 楼主| 发表于 2017-7-7 08:57 | 只看该作者
7.  光耦前后做隔离.  ^9 T1 `) ^7 E7 q
* r8 T, E' ]! `( \7 q

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 楼主| 发表于 2017-7-7 08:58 | 只看该作者
8.  DDR的DQS没走差分.0 k5 T8 B7 Z' j( G$ H9 a

7 l& i8 D. y8 S9 r

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 楼主| 发表于 2017-7-7 08:59 | 只看该作者
9.  差分走线不耦合太长了.6 X, r. o# {! u0 F# S6 ~$ R
7 a: z5 ]( u; K6 j* u: A% ~

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 楼主| 发表于 2017-7-7 09:00 | 只看该作者
10.  电源电感两端走线要加宽./ v/ ?% c) @( K/ Q0 |

: `4 v3 P" K- k' A& V

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发表于 2017-7-7 09:02 | 只看该作者
细节上能见真功夫呀。

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发表于 2017-7-7 09:04 | 只看该作者
:)

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发表于 2017-7-7 09:44 | 只看该作者
謝謝分享

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发表于 2017-7-7 12:25 | 只看该作者
可以学习,还可以加分,幸福

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发表于 2017-7-7 14:22 | 只看该作者
以后我画好板子也要发给EDA365的各位版主帮忙评审。
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