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Protel 布线规则总结

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发表于 2008-11-29 02:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
Electrical(电气规则)
3 j3 |) |/ i; X4 s Clearance(安全间距规则) 0 j: W$ w, I: Z+ K
short-circuit(短路规则) $ m9 x" {6 y  q2 _$ [/ P
Unrouted Net(未布线网络规则) & R7 A4 q4 f( k& |0 [1 B
Unconnected Pin(未连线引脚规则)
1 k3 r2 H# X& X  pRouting(走线规则) 6 Z0 L' |7 @! X& w9 b4 h! g
Width(走线宽度规则)
  @2 y+ B+ y9 ^; O Routing Topology(走线拓扑布局规则)
  H' H/ Z0 d: q* D9 } Routing Priority(布线优先级规则) ) o" a3 |) G  Z$ @
Routing Layers(板层布线规则)
5 P; }6 ~  M7 g" h1 s Routing Corners(导线转角规则)
$ T. x9 R3 H* r7 F1 l, A+ i Routing Via Style(布线过孔形式规则)
5 ?- q( P+ S! r! Y! j( K# D$ d Fanout Control(布线扇出控制规则)
" e. Q' k; T. e5 U- G3 }8 K6 L5 }SMT(表贴焊盘规则)
" {& N: q' y: j SMD To Corner(SMD焊盘与导线拐角处最小间距规则)
! n3 s6 a+ P4 j7 @6 ^/ Y SMD To Plane(SMD焊盘与电源层过孔最小间距规则) 4 r5 M: T$ p, K9 m3 ~* B1 [# E
SMD Neck-Down(SMD焊盘颈缩率规则) * T% p$ r0 a$ ]' O" j
Mask(阻焊层规则) ; `, X5 ^* T. P& [4 |; A
Solder Mask Expansion(阻焊层收缩量规则) * Z5 d! ~# q  |$ T5 A
Paste Mask Expansion(助焊层收缩量规则) 2 ~, D  e  A2 m
Plane(电源层规则)
9 R* U4 ~% S1 ~ Power Plane Connect(电源层连接类型规则)
$ a! v, w- Z9 ]+ Y9 o  Power Plane Clearance(电源层安全间距规则) 6 X/ S4 t, G, s. ]$ ]3 a1 r8 C
Polygon Connect Style(焊盘与覆铜连接类型规则)
0 _* Z0 b! a* I- ^) LTestpoint(测试点规则) & u# K6 g0 X' k# ?% }% i
Testpoint Style(测试点样式规则) . s& T# w+ _+ v6 ^7 L0 u/ [
Testpoint Usage(测试点使用规则)   m- ]$ r+ F. A$ w
Manufacturing(电路板制作规则) ) s0 A; R4 h6 ]9 z2 q/ O) j. x
Minimum Annular Ring(最小包环限制规则) # ~' b& T! z$ w  y: W
Acute Angle Constraint(锐角限制规则) : Z5 e+ w! H1 G5 \4 }" S2 V
Hole Size(孔径大小设计规则)
# }4 [* `$ h7 `! v- ~. d Layer Pairs(板层对设计规则)
: U2 K( }" O' oHighspeed(高频电路规则) ( y  R  Q0 s( j8 ?
Parallel Segment(平行铜膜线段间距限制规则) / f% D$ Y% k; H3 D% g( o  E) U$ r$ c
Length(网络长度限制规则) % J5 n" U0 m7 T! T4 y6 d
Matched Net Lengths(网络长度匹配规则)   Q& G' K  w9 _6 x3 i2 n
Daisy Chain Stub Length (菊花状布线分支长度限制规则)
+ T# ^4 y1 ~* t. i/ v Vias Under SMD(SMD焊盘下过孔限制规则) 4 p% S# T! B; t- t/ f* k+ A
Maximum Via Count(最大过孔数目限制规则)
  p+ U' X$ c! u" H$ f7 iPlacement(元件布置规则) $ O; V) c( g9 E' c  o
Room Definition(元件集合定义规则)
7 G2 t( P) p- C Component Clearance(元件间距限制规则) " P6 l0 r) n0 L4 e: w8 ]) K! f
Component Orientations(元件布置方向规则)
8 X6 C6 v) A# |( D Permitted Layers(允许元件布置板层规则)
! B9 X# p6 h/ t Nets To Ignore(网络忽略规则)
* o( ]0 n: a9 t; i Hight(高度规则)
; z4 ~9 |% E  r7 U8 ASignal Integrity(信号完整性规则)
) ~- C' d9 L  D2 F Signal Stimulus(激励信号规则) . }6 L6 Q5 L+ w# E) J
Overshoot-Failing Edge(负超调量限制规则)
( i) P- k% \& V) k  z  E' V Overshoot-Rising Edge(正超调量限制规则)
+ M/ \$ ^) C* Z Undershoot-Falling Edge(负下冲超调量限制规则) 5 t1 J: o  M+ N* r, m5 n
Undershoot-Rising Edge(正下冲超调量限制规则)
) m2 g9 n' [) Y  w, f Impedance(阻抗限制规则)
0 K* ^# a- |/ ~, {3 }! D- Z Signal Top Value(高电平信号规则) # T6 U8 m% I( j
Signal Base Value(低电平信号规则) 8 E) B5 n  n4 S! ~
Flight Time-Rising Edge(上升飞行时间规则)
% {- _$ f: j; H* V4 K* L# k Flight Time-Falling Edge(下降飞行时间规则)
1 ~7 F9 t. ^0 G% ]% S Slope-Rising Edge(上升沿时间规则) 5 h- {9 u; y0 B% E/ L
Slope-Falling Edge(下降沿时间规则) 3 X: o/ O# d- j, t6 b$ w
Supply Nets(电源网络规则)
* X; }, n: Q. ~0 \, \* f! L* w5 r
! `8 Z7 g5 O5 y6 Y" {更多资源与交流尽在电子工程师社区电子工程师社区欢迎您的光临!
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发表于 2008-12-1 08:44 | 只看该作者

多谢

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发表于 2008-12-1 16:01 | 只看该作者
要有细则的讲解就太好了!

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发表于 2008-12-1 17:03 | 只看该作者
请问步进和步长,拐角次数在哪里设置?
骆驼,狮子
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