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[仿真讨论] [求助] ddr4 中的 data training 是什么意思

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发表于 2016-11-15 17:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位老大,
& `5 \* Y" j" M; h8 Q* p. b8 ?- r7 P! y$ [2 \/ T
    ddr4 中的 data training 是指什么, 看协议看糊涂了, 不是很理解.
9 @2 K4 ?* q: A7 F" x3 X, M- |
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发表于 2016-12-9 07:42 来自手机 | 只看该作者
可以理解成数据信号的一个自适应接受的过程,ddr4的数据信号参考电平是不固定的,所以判决门限也不固定,在系统启动的时候就要自适应的去找这个门限,使得数据眼图最优化。

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发表于 2016-12-23 13:13 | 只看该作者
training是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。

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可以调delay的话那不是不用做等长了?  详情 回复 发表于 2017-1-13 15:11

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 楼主| 发表于 2017-1-13 15:11 | 只看该作者
ljzyhjbfwh 发表于 2016-12-23 13:13
9 l5 ]8 ^" i4 ~+ T9 |0 straining是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。

* f" f  J6 g! _& M5 X可以调delay的话那不是不用做等长了?, u0 x+ J( A2 x

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等长还是需要做,内部调delay有个范围,超多了,就调不到align了。  详情 回复 发表于 2017-1-16 13:45

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发表于 2017-1-16 13:45 | 只看该作者
l888888h 发表于 2017-1-13 15:11! {& x' d* H. q. C6 ^
可以调delay的话那不是不用做等长了?
2 \: Q! \0 B: ~8 N) L
等长还是需要做,内部调delay有个范围,超多了,就调不到align了。3 v- S$ A) h$ ?2 f5 o9 A1 m" b$ N, r

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内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?  详情 回复 发表于 2017-1-16 19:50

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 楼主| 发表于 2017-1-16 19:50 | 只看该作者
ljzyhjbfwh 发表于 2017-1-16 13:45
1 O' y9 E* K, j. L6 @等长还是需要做,内部调delay有个范围,超多了,就调不到align了。
) L* h4 q& [' S" {; w! v
内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?
3 g- X$ q- l0 J; t$ M6 M

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协议上没有。  详情 回复 发表于 2017-1-17 14:02

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发表于 2017-1-17 14:02 | 只看该作者
l888888h 发表于 2017-1-16 19:50  [! h: H  @6 ]" _1 R( ]
内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?
. r) M4 G3 F( F6 Z
协议上没有。
5 M" D7 k$ B5 B  @0 P' n

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 楼主| 发表于 2017-1-18 19:00 | 只看该作者
了解, 谢了

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发表于 2017-3-18 10:14 | 只看该作者
有ddr4的文件吗?能不能分享下1145441303@qq.com,多谢
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