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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 74AHC32 的逻辑图，最后加了两级的非？
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74AHC32 的逻辑图，最后加了两级的非？

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Quantum_

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发表于 2016-8-29 21:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如下图.  为何， 74AHC32 的逻辑图的最后加了两个非。  I3 P9 w2 d" G" j5 X9 z
1. 不加， 逻辑上也正确。
0 Q. j: z% b+ `' L' g7 H2. 为了增加延迟吗？
8 G7 J' s* ~4 j; i; N" [4 O3. 还是为了驱动TTL?
7 m, t# w6 x# Y0 V1 l8 B1 l, b, `' k/ J
) |5 i7 h6 a' L9 @" t  d谢谢！

OR.png (11.62 KB, 下载次数: 0)

OR logic Diag

OR logic Diag

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超級狗
支持！: 5
可以送我 2TB 的硬盤嗎？^_^  发表于 2016-8-30 11:19
分享到:  QQ好友和群QQ好友和群 QQ空间QQ空间 腾讯微博腾讯微博 腾讯朋友腾讯朋友 微信微信
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超級狗

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EDA365特邀版主

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2#
发表于 2016-8-29 22:42 | 只看该作者
打完收工！
! J# f( D% d7 V9 X( X
& E$ M2 ~6 f6 \) N# |- x7 v% \1 V- R- t; C9 w4 h- t& [$ t

Buffered and Unbuffered CD4001B.jpg (28.67 KB, 下载次数: 0)

Buffered and Unbuffered CD4001B.jpg

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Application of Buffered and Unbuffered Logic Gate.jpg

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kobeismygod
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狗然是老司机啊！  发表于 2016-8-30 11:20
jacklee_47pn
支持！: 5
支持 ! 讚 !  发表于 2016-8-29 22:46
哈士奇是一種連主人都咬的爛狗！

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超級狗

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EDA365特邀版主

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发表于 2016-8-29 23:36 | 只看该作者
jacklee_47pn︰
* e* U; p8 h0 D! w' J% u7 y讚 !

; s+ w! Q* S% k5 I3 ~) P: S: t+ H5 V% w
看！' [$ j  C% \2 m0 c, L7 m/ J
2 X: Z# n( J5 D! K& I5 V
- ^- l8 d1 _" x3 Y% h2 ~

9 B; b- _1 i9 I沒有啦！我是叫大家看內容。
, d  l( D4 d- n5 W: ~( D$ Y: Q3 |

点评

jacklee_47pn
也對！ 要用力看，努力看，好好看！ ^_^  发表于 2016-8-31 07:49
哈士奇是一種連主人都咬的爛狗！

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newcomsky

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发表于 2016-9-15 22:55 来自手机 | 只看该作者
mark

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hliu0129

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发表于 2016-9-21 17:07 | 只看该作者
4楼这个图片，比楼主的问题亮得多。个人认为是同步时序。

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cdbluerian135

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发表于 2016-9-26 09:19 | 只看该作者
学习了~

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