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请问图中红色圈中的电容有什么用?是必须要加的么?

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发表于 2016-2-2 06:34 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
/ B8 g' t7 r2 N* J. |
+ W. n. O/ G% p6 x
VTTREF 是DDR3 termination voltage, 1.5V是DDR3电源电压.4 _5 M# e- D# k4 `
/ v/ Y1 T! d3 q. {4 z

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建議加、但沒說一定要加才會動。詳細請參考我的貼文!^_^  发表于 2016-2-3 00:24
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发表于 2016-2-2 23:47 | 只看该作者
VREF control2 o! U1 I  i% v" Y( S
Setup and hold time margin could be reduced if VREF has noise. VREF integrity should be provided by the user to optimize noise margin in the system. The VREF level is expected to track variations in VDDQ , and the peak-to-peak noise should be met with specification:5 C. f7 c5 C& O
  • 1KΩ±1%/1KΩ±1%/ from VDDQ power panel
  • Place a 0.1uF capacitor between VREF and VDDQ
  • Place a 0.1uF capacitor between VREF and VSSQ
  • VREF should have a minimum trace to reduce inductance
  • VREF should keep a distance from other signals to reduce the potential of a decoupling effect
    8 H. H. Z, U) k; y
4 j0 ^  ^/ J5 ?4 z
還真的有 DRAM Design Guide 這樣教!0 ?4 _( T7 v/ L' [

/ F- r6 f" N2 g, `; v0 I' I8 y% P/ ^* D% Z/ M( X5 E

- @; S! P3 ^5 u" o% h/ X7 R; V
哈士奇是一種連主人都咬的爛狗!

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发表于 2016-2-3 00:02 | 只看该作者
美帝雖然邪惡,但人家畢竟是科學治國。咱們這群義和團,真的能振興中華嗎?
9 m8 i" g, c, B, T+ |
  f( E4 k3 `3 I4 B
# _) G% _* G. ]0 n
* U- }# p8 u1 Z. @, k( H3 _5 ?6 ]1 z1 ]Figure 5 shows the schematic diagram of a VREF network suitable for PC desktop applications. We recommend using a decoupling capacitor at each DIMM socket location and a decoupling capacitor pair near the resistor divider. The capacitance network at the resistor divider will lower the equivalent AC output impedance of the divider. This decoupling will provide better termination of noise voltages induced onto the VREF line.
. E4 v0 L% P0 J- \' o; ?/ i. w9 N+ X- C/ O* d

7 T; T* |% d# n" j9 [' y

VREF Network.jpg (30.33 KB, 下载次数: 0)

VREF Network.jpg

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这样画图,道破真相了,楼主的图画在IC处,分压电阻不可见,故而难懂。 在很多DDR电路中都是这样接的。  发表于 2016-2-15 14:26
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降低分压网络输出阻抗!  发表于 2016-2-5 13:20
哈士奇是一種連主人都咬的爛狗!

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发表于 2016-2-2 11:06 | 只看该作者
你确定没有接错?

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 楼主| 发表于 2016-2-2 12:29 | 只看该作者
没有啊,请看下面Xilinx AC701的参考设计,也有类似做法。
1 k, s% V: X$ { - ?! {( @9 i. [2 y

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发表于 2016-2-2 13:31 | 只看该作者
這要看LAYOUT圖了,猜測是"縫合作用"的電容器。

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请教哈縫合作用是神马意思[/backcolor]  详情 回复 发表于 2016-2-2 15:17
请问Layout中 缝合作用 主要是指什么呢?  详情 回复 发表于 2016-2-2 15:02

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发表于 2016-2-2 15:02 | 只看该作者
jacklee_47pn 发表于 2016-2-2 13:31
& i! |! }8 i8 j. ]6 q6 f7 E' `這要看LAYOUT圖了,猜測是"縫合作用"的電容器。

5 ]# K0 k+ K. {9 u; R9 J请问Layout中 缝合作用 主要是指什么呢?2 Y- R' Q4 Z9 a
  |) T; C: B) z0 ~8 X9 `$ j" T5 A

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缝合电容(stitch cap),在电源层被分割,而又作为参考平面时,就需要这样的电容,给高速信号提供尽可能短的回流路径。一般4对高速差分信号可以共用一个这样的电容,且电容放置在高速信号跨分割区域200mil以内。 h  详情 回复 发表于 2016-2-2 17:14

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发表于 2016-2-2 15:17 | 只看该作者
jacklee_47pn 发表于 2016-2-2 13:310 K0 _4 F/ m# c; c4 c
這要看LAYOUT圖了,猜測是"縫合作用"的電容器。

& i% v2 L& x' x2 n4 k" \' D请教哈縫合作用是神马意思
) i. x, Q3 K/ U0 W

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參考文件  详情 回复 发表于 2016-2-2 17:19

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发表于 2016-2-2 16:15 | 只看该作者
这个看不懂了,两个电压中间用电容连接,等大神继续回复

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发表于 2016-2-2 16:21 | 只看该作者
类似于参考面不完整需要加跨接电容。

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发表于 2016-2-2 17:14 | 只看该作者
1341858424 发表于 2016-2-2 15:02
! l  _) h2 G; S9 w, ]% O& M$ s请问Layout中 缝合作用 主要是指什么呢?

# _8 `4 u0 C3 Z* o缝合电容(stitch cap),在电源层被分割,而又作为参考平面时,就需要这样的电容,给高速信号提供尽可能短的回流路径。一般4对高速差分信号可以共用一个这样的电容,且电容放置在高速信号跨分割区域200mil以内, X6 {# ~/ z; _6 T
http://baike.baidu.com/view/4682119.htm
2 t/ h1 t4 O) P3 _. t

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发表于 2016-2-2 17:19 | 只看该作者
Lora 发表于 2016-2-2 15:17  m# p% o' p: x: B0 O& D! o
请教哈縫合作用是神马意思

, Y! i1 y9 s) L參考文件

EMC Issues on Printed Circuit Boards_2011.pdf

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小弟對黃金狗大的景仰,有如濤濤江水、綿延不絕!^_^  发表于 2016-2-3 00:29

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超級狗 + 5 不愧有天眼通絕技!^_^

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 楼主| 发表于 2016-2-3 02:09 | 只看该作者
多谢各位!!!!

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发表于 2016-2-3 10:00 | 只看该作者
可以叫做前馈电容。

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发表于 2016-2-3 16:51 | 只看该作者
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