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CPU端的Vswing小的issue

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发表于 2015-12-15 14:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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CPU端的Vswing很小,使得CPU端的数据margin很小或者fail。每个channel接两根DR的UDIMM,DIMM端的drvier strengthen已经是最强(34ohm),有什么方法能使CPU端的Vswing变大,需要找DIMM厂家将DIMM的drvier strengthen再加更强的step吗?或者还有其他方法吗?CPU端的ODT已经调高过(从60ohm到120ohm)。
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发表于 2015-12-17 12:11 | 只看该作者
请问 是X86的主板产品吗,那目前是read信号的margin小?

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 楼主| 发表于 2015-12-17 12:34 | 只看该作者
是的。read信号的margin小,整个的read信号的Vswing很小,导致C-的margin不过,C+的margin也很小。DIMM端的driver strengthen已经是最强,CPU端的ODT也调高过,可是整个的Vswing还是很小。不知有什么其他好的方法,改进read时的Vswing,使其变大。

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 楼主| 发表于 2015-12-17 12:41 | 只看该作者
目前是每个channel接2根DIMM,满负载。DR+DR, SR+SR, SR+DR, DR+SR

点评

X86的内存没实际测试过,看描述应该是示波器自动测试吧。ARM架构我一般也是手动测试,你在鼎阳的智库群吗,可以在群了问问。另如果有解决方法了,也请在论坛分享,谢谢!  详情 回复 发表于 2015-12-17 21:37

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发表于 2015-12-17 21:37 | 只看该作者
ljzyhjbfwh 发表于 2015-12-17 12:41) g& f: v9 L7 X3 q$ Z7 W( F
目前是每个channel接2根DIMM,满负载。DR+DR, SR+SR, SR+DR, DR+SR
# A: y) u2 m# K8 U/ n& R
X86的内存没实际测试过,看描述应该是示波器自动测试吧。ARM架构我一般也是手动测试,你在鼎阳的智库群吗,可以在群了问问。另如果有解决方法了,也请在论坛分享,谢谢!$ Y9 C0 D- K9 d

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 楼主| 发表于 2015-12-18 14:51 | 只看该作者
谢谢Devin回复。是用软件工具测试的margin。请问如何可以加入智库群

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发表于 2016-1-14 18:21 | 只看该作者
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发表于 2016-3-7 13:24 | 只看该作者
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