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发表于 2015-5-14 20:22 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问怎么根据原理图区分是千兆位还是百兆网?" z9 [% z! n  J; j
千兆网mac芯片到phy芯片之间的单端的数据Tx,Rx,时钟,还有一些控制信号需要做等长吗,时序要求严格吗,,7 ~( l: k$ p5 p% `# F; U, d
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发表于 2015-5-15 09:54 | 只看该作者
没有做过,感觉不需要。频率才125M,SDRAM的都是133M,SDRAM的线基本上随便画。

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之前有人说,那个千兆网是两个沿(上升和下降)都采样数据的,,,可能比sdram要快一些  详情 回复 发表于 2015-5-15 18:08

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发表于 2015-5-15 10:19 | 只看该作者
1. 100Base-T/1000Base-T可以兼容的,采用兼容设计方法设计一个百兆网也是有可能的,他是为了将来升级到千兆网,所以从严格意义上说,100Base-T/1000Base-T不能仅靠原理图区分。但如果只接了四根线,那就是百兆网9 Q) p* z8 I$ [, ^- S
2. 曾经有人遇到过RGMII的时序错误,所以有必要根据芯片I/O spec评估时序裕量,应该是不需要严格的等长的,其实等长不过是时序设计的一种偷懒手段罢了。

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我们公司原理图有四根tx 四根rx,那这是千兆还是百兆网呢,四根应该是百兆才对啊,,但是有人说是千兆网,。。。。  详情 回复 发表于 2015-5-15 18:12

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 楼主| 发表于 2015-5-15 18:08 | 只看该作者
fallen 发表于 2015-5-15 09:54
7 o2 g+ ^0 A: j; E5 v没有做过,感觉不需要。频率才125M,SDRAM的都是133M,SDRAM的线基本上随便画。

2 h) C$ n( i; Z之前有人说,那个千兆网是两个沿(上升和下降)都采样数据的,,,可能比sdram要快一些
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 楼主| 发表于 2015-5-15 18:12 | 只看该作者
ingwt 发表于 2015-5-15 10:19
" Y. J" [# |9 N; e1. 100Base-T/1000Base-T可以兼容的,采用兼容设计方法设计一个百兆网也是有可能的,他是为了将来升级到千 ...

! S- L% b$ o; N* N7 v! ]6 q我们公司原理图有四根tx 四根rx,那这是千兆还是百兆网呢,四根应该是百兆才对啊,,但是有人说是千兆网,。。。。8 @& R& G$ u9 h; _) }" Z1 R

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四根线的千兆网也有,sgmii, 1000base-x,他们一般不走RJ45接口  详情 回复 发表于 2015-5-15 22:02

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发表于 2015-5-15 22:02 来自手机 | 只看该作者
ann_wz 发表于 2015-5-15 18:12
9 M% Y4 d: H" p. D) x+ g我们公司原理图有四根tx 四根rx,那这是千兆还是百兆网呢,四根应该是百兆才对啊,,但是有人说是千兆网 ...

* j+ Y( }  R$ W四根线的千兆网也有,sgmii, 1000base-x,他们一般不走RJ45接口

点评

哦,我看过ddr时序的读分析,根据发送端有效时间窗口跟接收端的保持建立时间,来估算保持建立时间裕量,,,你说的芯片I/O spec评估时序裕量是不是就是这个意思,有没有这个方面好一点点资料呢,麻烦群主共享一下,  详情 回复 发表于 2015-5-15 22:10

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 楼主| 发表于 2015-5-15 22:10 | 只看该作者
ingwt 发表于 2015-5-15 22:02' S# b; j  H1 \. f5 u
四根线的千兆网也有,sgmii, 1000base-x,他们一般不走RJ45接口

# X$ V3 x9 [' M4 w& a2 a哦,我看过ddr时序的读分析,根据发送端有效时间窗口跟接收端的保持建立时间,来估算保持建立时间裕量,,,你说的芯片I/O spec评估时序裕量是不是就是这个意思,有没有这个方面好一点点资料呢,麻烦群主共享一下,,感谢,,
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发表于 2015-5-17 19:06 | 只看该作者
百兆和千兆差别可以看差分对数,一般百兆是2对差分,tx和rx;
1 F1 P# w9 W1 k1 s5 _3 _/ l千兆是4对差分,没有tx和rx的区别,4对同时工作的
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