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DDR3详解....各种技术参数

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发表于 2015-3-12 11:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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打算发个DDR3详解....各种技术参数,看看有没有人顶。

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给力  发表于 2015-4-22 11:12
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  发表于 2015-4-5 09:21
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此贴必火  发表于 2015-3-12 17:04

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 楼主| 发表于 2015-4-8 14:47 | 只看该作者
DDR3 timing simulation report20140210.pdf (1.11 MB, 下载次数: 210)   p2 e2 q: p6 X$ }

  G4 }. T" l0 Q$ A& U; r; a下载请点赞。。
4 b, n4 f0 y0 y9 r
' p' N8 }% t$ W% S不懂可以问。
# Q" `2 w4 e5 M+ H. W
9 ]5 ~/ p# q# m# A

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赞,timing report是学习最快的,可以很快的清楚应该抓那个点,对应那个参数。  发表于 2015-4-8 17:20

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 楼主| 发表于 2015-4-8 14:46 | 只看该作者

! i# `1 c% q6 ~( q/ N+ e+ y
& G% p) a6 o& v1 X9 x7 h; G精心准备的实例来啦。。。按需求下载!!!9 ]( q2 p( {, m( H
! \! f+ x$ }6 [; _1 n3 Z4 r% t# X

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发表于 2015-3-19 16:25 | 只看该作者
shark4685 发表于 2015-3-19 13:354 g" N  c7 W2 D7 u  l, f6 l2 A0 [+ v
你上来就点穴,这是关键点,一句二句解释的清楚么,你这是要累死我啊。4 o( @3 O/ a( p
要不你先来一把。悬赏50分。 ...
1 l8 C! V; s. S
这是我没搞清楚的地方   5 y5 b6 a& J, S5 u, t5 k6 _

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我想扣分。。。。。。。。。。。。。  详情 回复 发表于 2015-3-19 16:53

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发表于 2015-3-19 13:29 | 只看该作者
shark4685 发表于 2015-3-14 15:49
. b* |5 }! D5 f2 aDDR3的突发长度(Burst Length,BL)- d" \7 O6 g9 }4 X. Q' x, R

6 Y  x' q- A* n# d+ ]  {由于DDR3的预取为8bit,所以突发传输周期(Burst Length,BL)也固 ...

; X# f& |2 F6 s# U) M请教版主,突发长度是什么作用呢?
, v3 {3 v% Y' J0 `) O能否讲解一下DDR上电初始化的过程" ?" p8 P* o) A6 C

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你上来就点穴,这是关键点,一句二句解释的清楚么,你这是要累死我啊。 要不你先来一把。悬赏50分。  详情 回复 发表于 2015-3-19 13:35

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 楼主| 发表于 2015-3-16 14:35 | 只看该作者
本帖最后由 shark4685 于 2015-3-16 14:38 编辑
9 S2 _) k9 ?7 c5 L- ]3 S/ @$ a9 i, ]- y( T# C& r  c( N
新增的重置(Reset)功能-------响应号召,低碳环保。4 [+ S% y( U% a. D; D( ^

0 y- `$ _: C, t# @重置是DDR3新增的一项重要功能,并为此专门准备了一个引脚。3 B/ w9 T* [- M" z
DRAM业界很早以前就要求增加这一功能,现在才终于在DDR3上实现了。
. x2 n( _; F( e' O% P! P! R% M这一引脚将使DDR3的初始化处理变得简单。
, x8 d) @* a  a7 @1 G$ F6 m8 _当Reset命令有效时,DDR3内存将停止所有操作,并切换至最少量活动状态,以节约电力。5 Y2 ]/ O$ W4 u$ o- `; N* N
- [, ^6 P" ?* Q) |  X/ B
在Reset期间,DDR3内存将关闭内在的大部分功能,所有数据接收与发送器都将关闭,  |/ C4 `0 D9 N$ c7 o6 e% d
所有内部的程序装置将复位,DLL(延迟锁相环路)与时钟电路将停止工作,% h  Q5 s6 A7 O; ?
而且不理睬数据总线上的任何动静。这样一来,将使DDR3达到最节省电力的目的。7 u4 }8 e& S# O4 u) I& H
0 _) {2 D: w$ N- E5 I) l3 d

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 楼主| 发表于 2015-3-12 15:32 | 只看该作者
2.数据锁存(Strobe)类型0 T1 }; J- }; n+ q

) h: d: M. F2 j; v" v5 G, U1 K1 _DDR3 DQS (DQ Strobe) 只有差分# f( I. f( r% g$ O  m
DDR1 strobes 为单端信号9 S7 D) G$ i! d6 l: I- x7 j" @
DDR2 strobes 有单端,也有差分
# [9 v2 x& V, _6 E& W单端信号会增加额外的Derating: i7 `! O/ ?- ]% v! Y* b% l" M
差分strobe的好处抑制共模信号,抗干扰,有更高的电压裕量
- E, C8 N1 v" N# c  G% k' ?减小了因上升下降沿不对称引起的占空比抖动,改善时序$ N7 H0 q8 K2 {, ]8 c
/ v5 \6 V  `. w1 K3 l

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strobes其实是伪差分  发表于 2015-3-16 14:13
大神加油,我坐板凳来学习!  详情 回复 发表于 2015-3-12 16:04

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发表于 2015-3-12 14:56 | 只看该作者
昨天在科学园的课程很精彩,顶一个

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大哥,不要这样啊,搞的俺一点安全感都木有了,现在在科技园走路都要低着头。。。。  发表于 2015-3-12 15:11

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 楼主| 发表于 2015-3-12 11:46 | 只看该作者
有人加分么?

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发表于 2015-3-12 13:28 | 只看该作者
很好,最好弄点案例

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 楼主| 发表于 2015-3-12 15:14 | 只看该作者
1.先来看看DDR2和DDR3的不同点& B( N* Y0 }5 W6 n
数据传输速率9 s3 X4 Z$ r" \! E  G
DDR2 400Mb/s – 800+Mb/s
6 S0 b1 \; \- y1 n" r! FDDR3 800Mb/s – 1600+Mb/s
% E% Y: m9 F/ r8 C( ]
8 r  W# s' [, g; U! M电平
4 w' `) i' V$ v8 q5 A2 cDDR2 1.8V (对低功耗有1.5V)- D% e* o6 f( y7 P
DDR3 1.5V (对低功耗有1.35V)8 ]& L: W) m+ N" b/ D7 b% q: c

+ {; r! Z' e! |9 ~驱动阻抗% J5 C6 x) @9 r& E
DDR2 18Ω & 34Ω; r2 K9 k+ c0 m, h0 b8 H
DDR3 34Ω & 40Ω(可能会有48Ω)
7 @, R) K5 t) b9 }/ D' K
* `; q( N" j% }! T6 Z4 j-------------------------------------------------不懂可以问,有问题希望指正,免得误导了网友,在路上更没安全感了。4 ]$ c$ L/ O, G9 R0 R
3 L( X/ Q  Z7 `. ~& E- t2 ~

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  发表于 2015-4-5 09:22
驱动阻抗和ODT, 其实芯片里面超过3种,大概有十几种可调,IBIS为了简化,一般只给出3种给SI人员使用。 当然这3种也是最常用的。具体取哪种,需要仿真分析下。  发表于 2015-3-31 09:59
应该是频率,不是速率。 DDR3速率目前最高可以超频到3.2GT/s  详情 回复 发表于 2015-3-12 15:27

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发表于 2015-3-12 15:27 | 只看该作者
shark4685 发表于 2015-3-12 15:148 M6 R, S- X. |/ d' j
1.先来看看DDR2和DDR3的不同点
1 {- p! O4 E: x, ~" L数据传输速率! X: x  ~* d  l* A
DDR2 400Mb/s – 800+Mb/s

5 ?# }* a8 d0 }' D应该是频率,不是速率。
, Z/ ?/ j5 V- F9 @DDR3速率目前最高可以超频到3.2GT/s
1 q, F6 m8 ~0 q7 Z- K9 Z% x% g4 x/ r/ w. l2 {0 T6 ?1 s( N& [

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后面有“+”,是速率,MTS 和Mps是一个意思。  发表于 2015-3-12 15:29
新年伊始,稳中求胜

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发表于 2015-3-12 16:04 | 只看该作者
shark4685 发表于 2015-3-12 15:32. [( \# A+ v, B4 H
2.数据锁存(Strobe)类型; u, \1 Q# ~2 G4 r( Y" P

, c3 M- F( ~; y, k( R$ qDDR3 DQS (DQ Strobe) 只有差分
" o3 c# D7 |+ b: z
大神加油,我坐板凳来学习!
  R9 j. T5 O1 }' d3 u* z( N( x/ C
IC封装设计

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 楼主| 发表于 2015-3-12 16:12 | 只看该作者
DDR3的驱动能力
# W% U8 B2 J1 H* z6 O, Q5 ]* u! N+ WDDR3 驱动有34欧姆和40欧姆,34欧姆驱动能力强点,一般用来驱动于2根插槽的系统,
( F% c( }! `- \4 R% y对点到点的拓扑,40欧姆比较合适
) \5 S7 D' x$ [1 w  lDDR3 使用ZQ进行驱动校验,上电512个周期内自动调整ODT的阻值,使公差更小
) U' ?& h. `8 i0 ^7 B% ~9 J

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发表于 2015-3-12 16:17 | 只看该作者
学习中,DDR4有没有,

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版主加油啊,持续关注学习ing

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很好,最好弄点案例

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发表于 2015-3-12 17:25 | 只看该作者
继续啊。。。不断关注中。

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顶顶顶!

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