请教各位大侠，cadence HDL如何生成网表？

ayalcy · 发表于 2015-2-25 09:46

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cadence HDL如何生成网表？
怎样更新到PCB啊

ACE_ASL · 发表于 2015-2-25 10:24

在原理图中，file选项中export physical

fishplj2000 · 发表于 2015-2-25 10:49

楼上正确

ayalcy · 发表于 2015-2-25 11:39

fishplj2000 发表于 2015-2-25 10:49; A& Y; V$ u0 x& e; Y; F; a/ f& a! W
楼上正确

那怎么调入啊，我们调网表一般就是第一方第三方（TEL/TXT格式）啊

非常感谢！

风刃 · 发表于 2015-2-25 13:24

直接调用第一方网表，就是那个file-import-logic，选择那个packaged文件夹

ayalcy · 发表于 2015-2-26 09:01

风刃发表于 2015-2-25 13:24- s/ }' u$ C7 b
直接调用第一方网表，就是那个file-import-logic，选择那个packaged文件夹

谢谢！

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