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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准% Z+ w- n. Q* Q/ m* K1 [/ K
哪位大师可以给参考资料
! \. J9 l: I" ]% [0 @; F
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发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02
5 w6 M. c7 V2 D7 ~0 o# h9 Y* `+ T我公司的某PCBA 发到 I....公司做测试。
8 p. }: h: V/ a! y3 z6 Z2 B. J他们反馈的信息是.
! }) W2 ^5 ?% o  }9 U0 j, |/ ^--Find a problem during return loss tes ...
1 }8 [+ S! K, J; w. e. R
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
( ?6 U6 ]  ?/ t" ~8 }/ j( ~6 i* H1 jReturn Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
4 G# P) T- t* ^/ q# t+ _+ a, I: Z0 N; E. I7 N9 w
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
. \1 X8 B, C& }; t7 m' j) A# i2 G0 wRL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。
2 O5 e; B* A" R- @2 G

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发表于 2014-11-22 09:36 | 只看该作者
先参考协议
9 \+ j8 @9 m& d# `  M再根据走线长度来定,关键还是接收端可接受level
新年伊始,稳中求胜

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 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36
" r) E6 a3 [7 `3 l7 O先参考协议, ]' g' Z% }4 v5 @
再根据走线长度来定,关键还是接收端可接受level

+ x) F) d7 A$ n虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08
( f8 o) X" E, a, p6 B# W& ?* E虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
) Z4 s* r8 v2 [
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。
, Q3 J7 v  H5 Y1 l1 l' Z/ S

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那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03/ X4 z5 s3 j8 v" Z2 i( ^2 K- h
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

5 L7 @' h7 r# E, b3 ?" q8 N7 \我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况2 r1 r  X: r5 f- ^

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发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
6 `! D  K+ c' x8 m) T0 o因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

6 O3 b7 x$ V; S2 s3 M; n那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?6 m& ?5 L( P+ J* X9 d/ p

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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964008794 发表于 2015-10-31 23:36
" [) o9 S: l* y: E5 e) t& I那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?

8 n4 W9 ]( e' U7 {7 V建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32
& I  _( ?# a# ]  L) s& H7 |建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

; |1 i) W9 W- [/ y我公司的某PCBA 发到 I....公司做测试。6 ?4 W9 A* \: f$ l) k5 ]! G
他们反馈的信息是.
- f; I1 z- m0 z% F--Find a problem during return loss test on T..3 connectors.   p7 Q. R* T6 T5 N. B$ g
此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。 & S# m9 t2 T6 S! \! [1 ~# X" n
我的问题是:
1 [7 h! I% |5 i+ {; e1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?! m* W- _5 H! I( ]$ x3 K$ L, ~
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!% E( c& Z; l+ n$ J2 d
" x0 y, V5 H0 T$ z, M# b, A! S% g
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; d. p5 z$ W9 U/ ?; d( q; a9 p+ G

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10
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