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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准. G0 Q2 f/ t( v9 v* @
哪位大师可以给参考资料
* V9 |  z- d9 @' m
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发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02
6 R; w! N6 Q3 R* N  k( q我公司的某PCBA 发到 I....公司做测试。
$ v0 T$ l' e/ l他们反馈的信息是.
3 W2 R0 D( A/ j" a" U) \, K( }--Find a problem during return loss tes ...
' u, Z- d3 x8 a) M
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?7 H0 s8 R, N+ i, ?+ }
Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
) k/ g0 |/ P2 |/ g+ L# X1 A; H# p- E+ ?/ Y: P
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
, O' Y  V2 D5 \3 [RL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。9 z( Q  T3 A* q

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发表于 2014-11-22 09:36 | 只看该作者
先参考协议+ x- ]: A) T% J, v, I, r' U! U
再根据走线长度来定,关键还是接收端可接受level
新年伊始,稳中求胜

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 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36
6 K: X/ r7 }  K$ [先参考协议; C+ s3 o, Z8 G" U  }5 ]3 h
再根据走线长度来定,关键还是接收端可接受level
9 r* G2 k- L6 ?0 u* J* g
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:086 L/ B' Y4 M+ |7 h6 `% {! O( G
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
! Z* O- _* q( S- @6 x# i  `
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。
% s0 _& w8 V5 g8 ~5 i! h

点评

那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:035 P. s+ Y* ~8 L4 H  D0 [( ~
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

: r; D. e* a. O. E+ Y! I% {5 }我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况* J. {4 |* z# ]/ S  }* v: c9 l

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发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:033 L, X6 N! k4 l( n
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
5 V$ N- b! C/ \) m; T
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?; N1 K& f7 S' u3 o* Q

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:36' ?. }! U$ z" m1 t
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
# Q' B* ^1 t. d& k- ?
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32
4 d8 B2 X7 K5 S建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

9 S8 u: O' y* X7 W3 U, a9 A我公司的某PCBA 发到 I....公司做测试。% i6 V& D+ D) @
他们反馈的信息是.
* Q6 d& G' X$ M- ^" L--Find a problem during return loss test on T..3 connectors. , o$ Z% `* O8 b0 ^# }; M) m" E3 l1 P
此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。
/ f: P) t6 c) U  P我的问题是:3 N; ~! N. K' r& ?( o
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
# D1 v0 s- b, Y$ D, S2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
2 H# }! \8 r1 E8 F. V/ T! w$ Z& t

& L" ^9 p0 z* I/ v  p1 ?$ i- a  t; P: C$ L2 _

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10
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