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自己重新总结一下reuse的功能,大家一定也遇到过类似的情况

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发表于 2014-11-15 10:28 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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x
在设计中经常会有一些电路结构完全一致的模块,一般画好一个模块后,都需要将其他模块使用reuse的功能来实现复用,减少布线布局上浪费的时间  m" w1 I# p7 r. z# p
在之前使用reuse的功能的过程经常遇到一个让人比较头疼的问题就是:- l2 b8 A- m/ {$ r
使用make like reuse功能的时候
8 p8 {  W9 [; q! D( g: X+ o% u1 x元件布局走线与标注的text都能正常的摆放在合适的位置(跟原始模块一模一样);但是你会发现元器件的标号摆放时乱七八糟的,如果重新一个个调整也是耗时耗力的
! e* |4 k3 M3 r. ^7 V1 G+ k" r4 T# ~1 E9 Y0 \  W9 w* c+ X
之前在网上也看过一些,没有发现特别好的方法
& n/ v, O! Y9 ?& |& b% h) O
( u8 s3 F% g8 D9 _3 k; f$ Z, I今天我用eco里面add reuse的功能重新进行了操作,发现可以实现我期望的效果;不过有一个地方需要注意
: P# D2 H( i, p: o5 |/ u: ~" e就是在添加reuse模块的时候,要记得将NET PROPERTIES里面罗列的rename in design全部添加到到右侧列表中
/ m& Y' `/ R+ n/ L# j3 T+ H) P# y
! L- q. d7 t) A( N7 f增加完需要的复用模块之后;直接原理图eco同步,即可完成。7 R- C2 u) n, U/ ?( a2 d

& I8 e" ~, n2 f% ?否则你会发现原理图同步后,有些元件会重新甩到零点位置,摆好的元件编号会重新恢复到初始化状态
7 n7 v4 h7 v0 |% e) y( }7 G- n( S% [' W0 e" x1 j
上面的功能需要慢慢体验与实践,根据具体情况再做修改,减少工作量是终极目标7 t3 n5 Z- E: B2 \: c
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发表于 2015-7-24 15:29 | 只看该作者
请问你ADD REUSE 的模块, 是包含元件的吗?

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发表于 2014-11-16 23:41 | 只看该作者
mengzhuhao 发表于 2014-11-15 23:50
2 `, l4 T; J, }2 B( P没错 如果能把make like reuse做的更好就没啥问题了
' x2 r  X& x+ L6 M5 ~) V3 ^' ~& I0 N& V% U- w
可以提高效率

7 k' R) \; g6 K; }0 w/ p是啊,一个很好的功能,就是还没很完善,弄好了,画PCB真的太轻松了

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 楼主| 发表于 2014-11-15 23:50 | 只看该作者
myl593799546 发表于 2014-11-15 23:47
4 G& q+ Z  |, `4 t1 c这个功能感觉还是蛮不完善的
7 z; b' `7 K7 H$ d
没错 如果能把make like reuse做的更好就没啥问题了8 m! V$ \4 H4 X2 u5 E1 C8 a! b

5 ]! |  v& H. b& q. g可以提高效率
6 J+ _+ D" O0 f" Q7 u8 H; `8 p

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发表于 2014-11-15 23:47 | 只看该作者
这个功能感觉还是蛮不完善的

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 楼主| 发表于 2014-11-15 22:04 | 只看该作者
本帖最后由 mengzhuhao 于 2014-11-15 22:08 编辑 2 [# b3 U* s' ?

7 ^  E2 u/ U* v, l3 _2 i# TECO功能下的Reuse操作实现完整复制过程
- F, ~& d6 b$ T' T1 T3 v3 Q1-首先在PADS-LAYOUT创建原始reuse,这个操作很简单就不详述了
+ |( y: W/ Z. ?2 L- b2 `) @) k; m! E! e, @1 @
2-在PADS-LOGIC中整体复制第一该模块的原理图
/ j9 K; g9 o. }& N) V3 M- j8 m. C* \$ X" h# }
3-在PADS-LAYOUT的ECO中使用增加reuse操作导入保存的文件
. k2 U+ i* Y; |9 v8 ~5 Z, v6 Y; O# ]# X2 O
4-在PADS-LAYOUT中探出菜单中点击网络特性将完整命名的网络添加至右侧(类似N19333279的网络不要选择上)
. {0 [1 l9 \# `. S, X8 y
0 H2 G) L8 A: n$ J5-在PADS-LAYOUT中点击取消报告的显示后复用模块完整复制( y5 @6 C0 Y; ?0 G0 j- g* G

7 H4 H* z* b  h/ {4 i6-在PADS-LOGIC中执行原理图到版图的ECO同步操作
) t$ h6 ^! J  y* T4 O1 ]5 Y2 G. Q; H/ {) g2 {8 F4 s! [3 l; b* A3 q
7-在PADS-LOGIC中ECO导入成功,没有发现元件异常甩到0坐标现象
8 B/ C7 q: Q, g! X4 r4 R! g. M, \$ z. H' S* K) v# |
使用其他方式reuse完再同步ECO都会出现有元件甩到0坐标现象的错误2 K' C9 @& Q. g3 X( U  `" A; w

0 o) B4 e0 T+ ^" {小结:0 K5 A: E6 }' }0 w
如果你在使用设计工具栏下面的make like reuse功能的时候总是发现复用后的模块中元件标号总是乱排,无法完整复制原始模块的摆放状态。7 d8 p2 B" [  y
通过使用ECO下的reuse功能可以完整复制模块的所有状态,但是在操作的过程中尽量采用下面的方法:
% X- g$ }9 ?% c(1) 复用电路最好一个一个通过复制导入再复用,减少最少的错误
) q( d# _. n, W+ l* A(2) 通过尝试发现多个复制再复用同步过程会发现模块直接会乱抓元件的问题,有时候虽然没有元件甩到0坐标现象,但跟期望的效果有差距4 @' E7 \- A5 [+ {( f
(3) 逐一导入逐一ECO同步,完成上面的全部操作后合理布局,再进行原理图部分修正,基本可以就可以减少很多的工作量
0 z9 p/ X0 b8 X- C1 P, q" ^# p8 y& k2 E* X* A

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 楼主| 发表于 2014-11-15 21:58 | 只看该作者
本帖最后由 mengzhuhao 于 2014-11-15 21:59 编辑 ; U1 F# [# q5 f, F2 k& \
. |7 a$ q" H# |1 s
附件是整理的一个操作过程,供交流用, X" f6 K! N* k- u; ]7 J
# ~, m# z& w+ \; |
如果有更好或者不对的地方请有经验的朋友指出,多谢" O  {, i& Y% w' R8 X9 ]( e( M

8 K6 d' S, l" Y  H( j( T* @& U: n" O% B( K5 ]
) X! m2 l9 [% G, H% x  {  W
为啥附件无法上传成功?" D* j4 ^: l% z; n, Z; P
' Q+ ~  ]8 C, w" h, J& s

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发表于 2014-11-15 13:01 | 只看该作者
有图有真相,都不弄个图来看看

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 楼主| 发表于 2014-11-15 10:31 | 只看该作者
make like reuse的功能 从目前的体验来说+ k7 n' w3 d% |3 g# W' A- f6 w% f

1 \% [3 q. I4 u比较适用 多人合作 ;然后再合并的方式
5 \9 j& Z# }8 h6 z2 _: D( Y8 W# f( V4 L- \9 g9 Y: t0 r
如果电路图中有多个类似的模块,使用这个方法依然会有大量的调整标号摆放位置时间需要耗; K, F6 P: u& w8 w' S% B
- N; V7 H/ O8 @6 v- y
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