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本帖最后由 w5555456 于 2014-8-2 22:32 编辑 ' I4 ~) e3 f" o- W V
. K3 j# h# _6 S3 G% N! w4 S
描述:
$ }3 N, m' [* [1 r: J6 m6 ?5 U1 W; d* b 1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。 R ?- x" a, L. C h6 y, I( w
2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。* X+ b' b& A% ^$ I* D
3、时钟线从TOP换到Mid1,阻抗100欧。7 W) a O% z9 F1 t
4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。# j" f6 L- |/ V) X# c9 M
5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。) `! `% X6 \* K1 e% e
6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。( J4 f7 ]/ A6 f4 \7 U
7、所用软件,Altium Designer 10.0
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. b7 I$ }0 w& wPS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?
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热烈欢迎各路高手前来指导!谢谢!!! |
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