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ARM+DDR六层PCB,附件是原图,请高手前来指点!!

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发表于 2014-8-2 22:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 w5555456 于 2014-8-2 22:32 编辑 ' I4 ~) e3 f" o- W  V
. K3 j# h# _6 S3 G% N! w4 S
描述:
$ }3 N, m' [* [1 r: J6 m6 ?5 U1 W; d* b        1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。  R  ?- x" a, L. C  h6 y, I( w
        2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。* X+ b' b& A% ^$ I* D
        3、时钟线从TOP换到Mid1,阻抗100欧。7 W) a  O% z9 F1 t
        4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。# j" f6 L- |/ V) X# c9 M
        5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。) `! `% X6 \* K1 e% e
        6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。( J4 f7 ]/ A6 f4 \7 U
        7、所用软件,Altium Designer 10.0

- W) ]( t' F, s, F8 W5 o' U  B
. b7 I$ }0 w& wPS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?
+ w9 F! H* f5 y; V( D
4 z9 ]( f" Y4 R
8 h* D* [3 T3 p7 R; v
热烈欢迎各路高手前来指导!谢谢!!!

DDR_XXX.zip

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 楼主| 发表于 2014-8-18 21:40 | 只看该作者
本帖最后由 w5555456 于 2014-8-18 21:42 编辑
1 A& ^0 e5 }" t. K% Q
kangguolong 发表于 2014-8-18 16:48
- b2 e9 E" A* h8 \* p' ]3 @这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需 ...
9 a3 I8 n) x* I4 i# o' C; k

8 a& A7 ]( G; q非常感谢这位兄台的点评!
, K9 ~& [# S6 m  K% C1、盲埋孔已经去掉了,直接6层的通孔,勉强画出来了,不过电源走的不大好(用盲孔的话总成本会增加大概60%的样子,而且制作难度大了很多)。
6 N/ P( e( a3 f+ z; m- a- ^7 T2、差分时钟线绕成了下图所示:  L7 \( z# N* W; h

$ }  f$ {7 m2 i3、差分阻抗控制100欧左右,3.5/9.5mil。据我的了解,差分对紧密耦合是为了提高抗干扰能力,如果太过紧密,两根线之间的相互耦合会对信号边沿产生影响,所以选了这个间距。某些芯片厂商的Layout Guide也建议间距不要过小。
- C1 p0 m  ^5 U: K' c) |" I% S1 h4、数据线我基本都走在了Midlayer1,我用的1W原则,3W空间不够。) p* _% F; W; ]/ z0 h
3 }( z; p% {6 t# N% q& b) k
: @+ m- E( M  v; m# Z
& K. E9 v# N4 M: h$ F# C' D$ `
6 C" @0 E3 J3 F/ y) X" l
) t: N0 C; }* e( d

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 楼主| 发表于 2014-8-18 21:24 | 只看该作者
本帖最后由 w5555456 于 2014-8-19 21:45 编辑
4 h& z* y5 ^  S. I
zgq800712 发表于 2014-8-17 11:16
  k9 n/ M" M. _9 E& c这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm& I( t7 r' ?0 s- e9 R9 z# A
( y+ o! ]+ A+ t0 B% Y0 Q+ e
这个板子要什么工艺?打样贵吗?
& k9 o, Z$ q8 I

5 C5 f! x8 Q9 H' Q6 s$ I一般的工艺就能做出来,6mil的孔是可以不用激光打的。
0 r' z& d# v" @; ~, Q今天刚投的板,大概240*180的板子,六层,打样3000左右,五块。
2 U+ M2 h: Y0 Z) m' I, j; r在深圳迅捷兴做的,有需要我给你他们销售的联系方式。

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发表于 2014-8-18 16:48 | 只看该作者
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需要调整,不知道差分有没有做阻抗控制,差分线间距过大!另外数据线每一组走线应该遵循同组同层的走法,线 与 线的部分区域间距还是不够3W!还有一些其它的小问题,还需优化。

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 楼主| 发表于 2014-8-4 21:24 | 只看该作者
帖子都好几天了,各路好汉都去哪了???:Q:Q

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发表于 2014-8-5 13:19 | 只看该作者
打开了,看不到东西
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 楼主| 发表于 2014-8-5 21:52 | 只看该作者
zgq800712 发表于 2014-8-5 13:196 f$ ?0 w2 }5 M5 m' K" p
打开了,看不到东西

+ R, K/ h" [( y6 T8 s我的软件版本是AD10.0,应该09及以上的打开都没有问题。
# d! m: z' w, Q/ q0 @试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-5 23:36 | 只看该作者
多AD14了
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发表于 2014-8-6 08:46 | 只看该作者
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

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 楼主| 发表于 2014-8-7 22:50 | 只看该作者
沙漠风铃 发表于 2014-8-6 08:46
8 q4 a$ d  u" v" H$ N( G$ S走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁
+ \6 g6 Q) W9 }. J2 I$ h0 w
呃,,多谢这位仁兄!
, u  c3 ?7 B. q: ]7 J. k2 m话说我这板子有没有致命的地方?或者亟需改进的?

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发表于 2014-8-11 22:01 | 只看该作者
打开了,看不到东西

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 楼主| 发表于 2014-8-12 23:23 | 只看该作者
ROBERTZHANG 发表于 2014-8-11 22:01
# K  I! }9 _4 Y  o# q打开了,看不到东西
  L0 B  F% q' K9 w
我的软件版本是AD10.0. }& F8 G2 i2 Q1 s3 s3 H3 y
试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-17 11:16 | 只看该作者
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm
" ^) A0 U2 a5 A: m  O/ ]) z4 P0 e: }5 E3 G4 V
这个板子要什么工艺?打样贵吗?
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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发表于 2014-8-17 21:35 | 只看该作者
AD的文件就不去看了

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发表于 2014-8-18 09:28 | 只看该作者
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

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 楼主| 发表于 2014-8-18 21:26 | 只看该作者
hb_ben 发表于 2014-8-18 09:28+ M% E0 r6 q3 g; B
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多
5 r9 N1 v, ~* i. F/ {
没办法啊,BGA下面的焊盘间距20mil,焊盘占掉了10mil........
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