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寻求电路板层叠结构,阻抗计算,参数指标的行家帮助

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发表于 2012-4-6 12:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 zengeronline 于 2012-4-9 21:51 编辑 5 p8 X0 N2 H4 s- e
; Y0 v5 ~9 b2 g' x6 Y% y
大家好,我需要设计一个板厚为1.6mm,层叠结构为top-ground-signal-signal-power-bottom的六层板.- E, k3 U2 i+ S. A* M
我用allegro以经把线都差不多链完了,只剩一些需要绕等长的地方的一些器件地没链.
% G9 q; U: e) \7 l现在需要先做阻抗设计
0 v& j8 x1 G) H+ p- ~单端50ohm,差分100ohm6 x( E$ S  e" e5 c) A4 [
在做的时候参考了本论坛的贴子,但是还是有一些疑问,希望得到行家的帮组# f8 K% w/ M+ {9 b6 |) N0 Z
因为疑问比较零碎,不好在论坛上提,所以希望热心的朋友加我的qq,15831****,谢谢# w/ w* l" I  H% \0 q- S0 \
2 x: e+ ^# a; B. R1 R
4 x4 l) Y# A1 J% E4 Z( K' ^3 z. G1 w
比如有个疑问就是; s' M3 P: \& n9 {4 h. m% _2 s5 e
下面的这个层叠制版厂能否制作,有什么样的问题,和一般的六层板层叠结构制作收费上有什么差异
' o! t6 _$ @( n3 m% x, W
7 J; S/ w- z# Q0 \' ?9 L3 R
' M, l$ k' q7 g0 {0 a: _2 p8 u! Qsilkscreen top      : ()[]. W" M$ v3 J% l9 z: ?
soldermask top      : ()[]
' \4 Z, m8 P) f: ^1 P/ N3 }paskmask top        : ()[]) R- ^- h9 L5 ~8 C# W3 {
. g, a1 I; c% d6 N
top                 : 0.6   
% ?7 O1 a. |0 k# J& F; i/ w5 F-- core             : 4     (0.10MM H/HOZ)[]5 M5 R$ X( c+ Y& E. Q$ L, B
ground              : 0.6   
3 _- J! u: P; Z5 }3 f-- prepreg          : 6     ()[2116+106]# t0 L* z5 K+ ~+ r3 D# N- C/ x
signal3             : 1.2   & t; [1 y  s  M- N8 c
-- core             : 32.63 (0.9MM 1/1OZ)[]
# S% N. z1 g- P+ [8 Rsignal4             : 1.2   
9 [/ x4 e) D) f-- prepreg          : 6     ()[2116+106]" n% ^: x2 S. C+ z4 Q# P2 k. Z
power               : 0.6   $ S0 a" L: g& M+ d7 R
-- core             : 4     (0.10MM H/HOZ)[]
7 U+ i( I' w) k# z  U4 b3 {6 c& [bottom              : 0.6     j* `7 U" a6 q% E9 `! N

$ m% q) u( {* Z6 {3 G! y7 _pastmask bottom     : ()[]4 f9 E: b7 R) `1 F& m8 q  f
soldermask bottom   : ()[]
1 g3 Z. S$ [* a8 J2 D# ~2 j9 Lsilkscreen bottom   : ()[]
  d- g6 W% P& z& S! P; O) i: B1 [6 [1 G: {
total               : 62(57.43). U. Z* u3 A) h0 U9 I
2 Z, j8 p  |" i1 S; H+ y, {

9 e/ M1 ~, @: O: p4 Kps:201204009,抹掉qq5 A- D3 O3 O6 ]6 X7 q- E
& [4 u. Q0 h2 w% N

) R, w5 W5 y. h7 u, e$ _
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发表于 2012-4-6 13:07 | 只看该作者
:Q:Q:Q

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发表于 2012-4-6 13:22 | 只看该作者
楼主,你的这个叠层好像不太对,一般是两块芯板加pp,你这个需要3个core加pp。( J( _0 [( b$ X. L
每个板子都不简单。

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发表于 2012-4-6 13:27 | 只看该作者
这种结构通常被厂家称为"假8层",按照8层板收费.3-4层之间往往需要增加一个core

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发表于 2012-4-6 13:48 | 只看该作者
如果使用你自己这个层叠方式,就是所谓的“core层叠”加工法,应该是特殊工艺了。

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 楼主| 发表于 2012-4-6 15:04 | 只看该作者
哈哈,我问到了 liuyian2011 大哥,他说我的这个结构没有问题,
' b% r- \0 R9 b' B( Score
  u- F2 d0 L6 o& cpp
$ Z5 L* N/ m9 kcore. h7 Z0 @: _" ~# _
pp
. }8 D$ O* V5 d* p* ucore2 b$ W% q1 P+ @# r
叠起来成为 top-ground-signal-signal-power-bottom" l5 n  W) W8 i; h0 V
我也是想到了上下的两个core板在叠板之前只刻蚀一面,叠好后再处理外层,不知道这样行不行就上来问了,也问了在制作上是否要另加钱, liuyian2011 说他们厂是一样的价格
% {/ Y0 v6 T; h/ ?  x两个core加外层的话在1.6mm的情况下阻抗不好搞,线太粗了,不然就弄成假8层

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发表于 2012-4-6 20:48 | 只看该作者
plane layer 有点薄。
-->--...-->-----?

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 楼主| 发表于 2012-4-9 13:39 | 只看该作者
chengang0103 发表于 2012-4-6 20:48 1 b' o7 k. h' D5 T8 E6 o
plane layer 有点薄。

$ M* _" a  p1 J* {% ^2 R; k8 `) b  E, _6 J
呵呵,我已经从新计算后修改为下面的层叠关系了4 M. g# T" i3 m3 o

8 `% T* C5 P' R$ S1 L; w' a
! ~' ]1 b+ \6 {8 j
( @) w" x0 I7 m* R9 ]2 R! ~1 [" {- i# b6 H
silkscreen top      : ()[]
( U- c* h8 {9 r) z6 \5 t( [soldermask top      : ()[]3 F6 h' T8 i/ v  j6 `, P
paskmask top        : ()[]- g7 c% V* n' P0 T3 w: H
/ O: |9 P- y4 v; e
top                 : 1.7   
( o  ?  X# d+ `1 ~-- core             : 4     (0.10MM 1/1OZ)4 m- R1 K0 }, g3 I4 d+ a
ground              : 1.2   
: I% [1 d- ?* p$ U6 U-- prepreg          : 5     [1080*2]
& m1 r0 g9 l3 _" z; c# Zsignal3             : 1.2   4 t3 |% o! }: X) F. c
-- core             : 32.63 (0.9MM 1/1OZ)( U! y/ B4 I6 y" C
signal4             : 1.2   
& T; x+ R, n; c: W-- prepreg          : 5     [1080*2]
5 k7 y5 _: z2 S; k5 a/ Z* u2 zpower               : 1.2   - m9 ^6 V( j4 ]3 l
-- core             : 4     (0.10MM 1/1OZ)
3 s: z* G1 I3 I; [bottom              : 1.7   
6 `/ Q- r# q# J' |+ H& g' C3 G% N: a8 I3 \" C" B% [
pastmask bottom     : ()[]
% I, M, _; W! {9 U$ vsoldermask bottom   : ()[]2 o. u+ N/ N% |
silkscreen bottom   : ()[]/ G8 V6 d7 c! Z+ a3 ~2 K7 i
: ]* `5 u9 x9 H2 y  J# q
total               : 63(58.83)
! A5 z: Q/ E- A6 n$ p$ |

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发表于 2012-4-9 14:51 | 只看该作者

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发表于 2012-4-9 18:50 | 只看该作者
top bottom镀铜,加锡后的在铜面只增加0.5mil,不知道这样控制有没有难度了。
6 e; r! g* ]! z" J/ @& @9 m6 M3 Y
  Z* n0 T6 @# V. t) W+ ?, q- I- }如果板子有重要的信号,还是问下工厂你这样的处理行否,看看阻抗的变化范围。
7 y: a' q+ ?1 z; N0 a* G# D
* }+ ]/ a7 D. [* g" N
-->--...-->-----?

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 楼主| 发表于 2012-4-9 21:35 | 只看该作者
chengang0103 发表于 2012-4-9 18:50 ; u1 C# d9 F3 v
top bottom镀铜,加锡后的在铜面只增加0.5mil,不知道这样控制有没有难度了。+ `' M& t4 b; K+ n/ U0 m8 v& p
# Q' G4 q. L" a2 X! n
如果板子有重要的信号,还 ...

: Q5 d! [" I) u9 b6 X5 \我上面写的那些参数都来自于网络,实际上也不清楚是否就是这样子的,
/ A& L; p% B" B' M! Q4 P7 d据你所知1oz的top层在所有的工艺都处理完后一般会有多厚啊,或者增加多厚?, w4 a1 y- @+ P$ y& |9 M
表层有一些重要的信号,底层没有什么线,大部分都走在3,4层,
+ `  o) M0 n/ O; v% y1 {我在算阻抗的时候,在polar里面表层是按照1.7mil的厚度来计算的

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发表于 2012-4-10 13:20 | 只看该作者
内层铜厚为0.5OZ和1OZ,内层铜厚基铜也就是成品的铜厚,因为内层不存在电镀铜,而外层一般情况下如果基铜是0.5OZ,则成品铜厚就是1OZ,因为外层存在电镀铜厚.按此类推如果外层一般情况下基铜是1OZ,则成品铜厚就是1.5OZ,当然也可以加镀至2OZ. 基铜是指基材的铜厚,也被称为下料铜厚,而成品铜厚是指最终成品的铜厚.大家在计算阻抗时Polar软件里的铜厚均为成品铜厚.$ ~$ O* c( F) M' {- y& T

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 楼主| 发表于 2012-4-10 15:09 | 只看该作者
飘小北 发表于 2012-4-10 14:49 + P, K; w1 A& B' [+ b: S+ ?2 k6 K) D
就是所谓的“core层叠”加工法,应该是特殊工艺了   感觉不错吧
8 _$ u) O0 U" S& w1 `
{:soso_e127:} ,好恐怖的皮卡丘

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 楼主| 发表于 2012-4-10 15:18 | 只看该作者
liuyian2011 发表于 2012-4-10 13:20 8 ?! \2 e1 Q4 v& K+ t
内层铜厚为0.5OZ和1OZ,内层铜厚基铜也就是成品的铜厚,因为内层不存在电镀铜,而外层一般情况下如果基铜是0. ...
  y3 W5 g0 S* Y' H6 L
哈哈,很高兴见到你啊,之前向你打电话请教的时候已经告诉我了的,呵呵+ _/ [) i5 U8 U, v$ T) B- J
上面的朋友怀疑1oz的基铜(1.2mil)电镀后只增加 0.5mil(最后1.7mil) 这个问题,就回问了一下
. g! d# N& V5 K5 H8 E从你的回答来看是没有错的

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发表于 2012-4-10 16:59 | 只看该作者
zengeronline 发表于 2012-4-10 15:18
+ T' [' ]  S4 }+ _* o哈哈,很高兴见到你啊,之前向你打电话请教的时候已经告诉我了的,呵呵2 {( z# p9 L: C3 B1 M+ @
上面的朋友怀疑1oz的基铜(1.2mil)电 ...
; j( {, Y8 S$ U6 O2 ?. N& P9 c
要让大家都明白清楚那就好了啊.{:soso_e100:}
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