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XNET_TEST.rar
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附件的原理图 我目前只画了一个数据等长 与上拉等长的 没有画差分对的 你可以在里面随便画与添加5 K$ i6 L* u; h% p
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目前我设置的上拉等长发现 pin到pin好像是等长了,但是会有上拉电阻段的DRC错误;不知道在规则设置的时候如何屏蔽掉这部分?是否可以设置
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另一个不是很方便的地方就是如何统一选择需要匹配的网络?只能通过原理图交互的方式这样的选择吗?0 v. \ `2 ?0 G' C0 ^
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在allegro里面如何一次性选择匹配组 然后做自动优化等长?
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在进行优化的时候 是不是常用的方法是固定一部分手动画的线,然后然工具自己调节?还是控制好区域 与自动等长的规则设置 然后自动调?(因为规则中可以好多个选择项进行设置,gap 幅度 等 )
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